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电子通信与软件工程系2013-2014学年第2学期《数字电路与逻辑设计实验》实验报告--------------------------------------------------------------------------------------------------------------------- 班级：姓名：学号：成绩：同组成员：姓名：学号：---------------------------------------------------------------------------------------------------------------------一、实验名称：组合逻辑电路（半加器全加器及逻辑运算）二、实验目的：1、掌握组合逻辑电路的功能调试2、验证半加器和全加器的逻辑功能。
3、学会二进制数的运算规律。
三、实验内容：1．组合逻辑电路功能测试。
（1）．用2片74LS00组成图4.1所示逻辑电路。
为便于接线和检查．在图中要注明芯片编号及各引脚对应的编号。
（2）．图中A、B、C接电平开关，YI，Y2接发光管电平显示．（3）。
按表4。
1要求，改变A、B、C的状态填表并写出Y1，Y2逻辑表达式．（4）．将运算结果与实验比较．2．测试用异或门（74LS86）和与非门组成的半加器的逻辑功能．根据半加器的逻辑表达式可知．半加器Y是A、B的异或，而进位Z是A、B相与，故半加器可用一个集成异或门和二个与非门组成如图4.2．（1）．在学习机上用异或门和与门接成以上电路．接电平开关S．Y、Z接电平显示．（2）．按表4．2要求改变A、B状态，填表．3．测试全加器的逻辑功能。
（1）．写出图4．3电路的逻辑表达式。
（2）．根据逻辑表达式列真值表．（3）．根据真值表画逻辑函数S i 、Ci的卡诺图．（4）．填写表4．3各点状态（5）．按原理图选择与非门并接线进行测试，将测试结果记入表4．4，并与上表进行比较看逻辑功能是否一致．实验结果：表4．1Y1=A+B Y2=（A’·B）+（B’·C）表4．2表4．3表4．4Y=A’B+AB’Z=CX1=A’B+C’+AB X2=A’B’+AB+C X3=A’B+AB’+C’Si=A’B’C+A’BC’+AB’C+ABC Ci=AC+AB+BC实验总结：此实验中因本就缺少一块74LS00的芯片导致线路不完整，原本打算用74LS20来代替74LS00，但电路还是出现了问题，原以为是电路接线的问题，也重新接线过，但是情况毫无变化。
《数字电子技术B》实验报告班级：姓名学号：实验二组合逻辑电路（半加器、全加器）一、实验目的1.掌握组合逻辑电路的功能测试。
2.验证半加器和全加器的逻辑功能。
3.学会二进制数的运算规律。
二、实验仪器及材料74LS00 二输入端四与非门 3片74LS86 二输入端四异或门 1 片74LS54 四组输入与或非门 1片三、实验内容（如果有可能，附上仿真图）1.组合逻辑电路功能测试。
（1）.用2片74LS00组成图2.1所示逻辑电路。
为便于接线和检查，在图中要注明芯片编号及各引脚对应的编号。
（2）.图中A、B、C接电平开关，Y1，Y2接发光管电平显示。
（3）.接表2.1要求，改变A、B、C的状态填表并写出Y1，Y2逻辑表达式。
（4）.将运算结果与实验比较。
表2.1Y1=A+B Y2=(A’*B)+(B’*C)2.测试用异或门（74LS86）和与非门组成的半加器的逻辑功能。
根据半加器的逻辑表达式可知，半加器Y是A、B的异或，而进位Z是A、B相与，故半加器可有一个集成异或门和二个与非门组成如图2.2。
图2.2（1）.在实验仪上用异或门和与门接成以上电路。
A、B接电平开关K，Y，Z接电平显示。
（2）.按表2.2要求改变A、B状态，填表。
表2.23.（1）.写出图2.3电路的逻辑表达式。
（2）.根据逻辑表达式列真值表。
表2.3（5）按原理图选择与非门并接线进行测试，将测试结果记入表2.4，并与上表进行比较看逻辑功能是否一致。
4. 测试用异或、与或和非门组成的全加器的逻辑功能。
全加器可以用两个半加器和两个与门一个或门组成，在实验中，常用一块双异或门、一个与或非门和一个与非门实现。
（1）.画出用异或门、与或非门和非门实现全加器的逻辑电路图，写出逻辑表达式。
（2）.找出异或门、与或非门和与门器件按自己画出的图接线。
接线时注意与或非门中不用的与门输入端接地。
（3）.当输入端A i、B i及C i-1为下列情况时，用万用表测量S i和C i的电位并将其转为逻辑状态填入下表。
半加器、全加器的工作原理一、引言在数字逻辑电路中，加法器是一种基本的逻辑门电路，用于实现二进制数的加法运算。
根据其设计复杂性和功能，加法器可以分为半加器和全加器两种类型。
本文档将详细介绍半加器和全加器的工作原理。
二、半加器1. 定义：半加器是一种能够对两个一位二进制数进行相加并输出结果的逻辑门电路。
它只能处理两个输入位（被加数和加数），不考虑低位进位。
2. 工作原理：➢当两个输入位相同时，半加器输出0；➢当两个输入位不同时，半加器输出1；➢当两个输入位有一个为1时，半加器输出1。
3. 真值表：➢输入A：被加数的一位；➢输入B：加数的一位；➢输出S：和的一位；➢输出C：进位。
4. 逻辑表达式：➢S = A XOR B；➢ C = A AND B。
三、全加器1. 定义：全加器是一种能够对三个一位二进制数进行相加并输出结果的逻辑门电路。
它可以处理两个输入位（被加数和加数）以及一个低位进位。
2. 工作原理：➢当两个输入位相同时，全加器输出0；➢当两个输入位不同时，全加器输出1；➢当两个输入位有一个为1时，全加器输出1；➢当低位进位为1时，全加器输出0；➢当低位进位为0时，全加器输出1。
3. 真值表：➢输入A：被加数的一位；➢输入B：加数的一位；➢输入Cin：低位进位；➢输出S：和的一位；➢输出Cout：高位进位。
4. 逻辑表达式：➢S = A XOR B XOR Cin；➢Cout = (A AND B) OR (Cin AND (A XOR B))。
四、总结半加器和全加器是数字逻辑电路中的基本组成部分，它们分别用于实现二进制数的简单和完整相加运算。
半加器只能处理两个输入位，不考虑低位进位，而全加器可以处理三个输入位，考虑低位进位。
理解它们的工作原理对于理解和设计数字逻辑电路是非常重要的。
与非半加器实验电路图6则以下是网友分享的关于与非半加器实验电路图的资料6篇，希望对您有所帮助，就爱阅读感谢您的支持。
实验1-2TTL与非门电路+半加器全加器（1）实验一TTL 集成与非门电路一. 实验目的1. 熟悉TTL 集成与非门外形及外部引线的排列。
2. 验证TTL 与非门的逻辑功能。
3. 试用与非门接成其它几种逻辑门的方法并熟悉它们的逻辑功能。
二. 实验仪器和芯片1. SXJ —3C 数字电路学习机2. 74LS00三. 实验内容和步骤 1. 熟悉实验设备：熟悉通用实验箱的结构和使用方法，熟悉74LS00集成块的外形和引线情况。
2. 测量与非门的逻辑功能将74LS00中的一个与非门的两个输入端分别接到实验箱中的两个电平开关上，输出端接到箱中的逻辑电平指示灯上，接通5V 电源和地，按表1—1 完成逻辑功能的测量。
并规定高电平为逻辑“1”，低电平为逻辑“0”。
3. 74LS00中的与非门分别接成与门、或门、非门、异或门画出接线图并将测试结果1-2表中，根据表分别写出它们的逻辑表达式。
表1—2四．预习内容1. 复习TTL 与非门的工作原理2. 了解74LS00集成电路的逻辑和引线排列图。
五．实验报告要求1．要求写出相应的表达式；2．画出相应的逻辑图；实验二组合逻辑电路的实验分析一. 实验目的1. 掌握组合逻辑电路的分析方法。
2. 验证半加器和全加器的逻辑功能。
3. 了解二进制数的运算规律。
二. 实验仪器设备 1. 数字电路实验箱 2. 万用表 3. 74LS00 三. 实验内容组合电路的分析是根据所给的逻辑电路，写出输入与输出之间的逻辑关系（逻辑函数表达式或真值表）。
从而评定该电路的逻辑功能。
组合电路的分析方法，一般是首先对给定的逻辑电路按逻辑门的连接方式逐一地写出相应的逻辑表达式，然后写出输出函数的表达式（如果需要列其真值表时，可由表达式通过运算求出）。
但这样写出的逻辑函数表达式可能不是最简单的，所以还应该利用逻辑代数的公式或卡诺图进行化简。
半加器和全加器实验报告数电实验报告半加全加器实验二半加/减器与全加/减器一、实验目的:(1)掌握全加器和半加器的逻辑功能。
(2)熟悉集成加法器的使用方法。
(3)了解算术运算电路的结构。
二、实验设备:1、74LS00(二输入端四与非门)2、74LS86(二输入端四异或门)3、数字电路实验箱、导线若干。
(74LS00引脚图)三、实验原理:两个二进制数相加，叫做半加，实现半加操作的电路，称为半加器。
A表示被加数，B表示加数，S表示半加和，Co 表示向高位的进位。
全加器能进行加数、被加数和低位来的信号相加，并给出该位的进位信号以及和。
四、实验内容:用74LS00和74LS86实现半加器、全加器的逻辑电路功能。
(一)半加器、半减器M=0时实现半加，M=1时实现半减，真值表如下:(74LS86引脚图)(半加器图形符号)2、S?B?A?A?BC?B(A?M)(二)全加器、全减器S?A?B?Ci-1Ci?BCi-1?(M?A)(B?C)五、实验结果半加器:S?B?A?A?B C?B(A?M)全加器:S?A?B?Ci-1Ci?C1M?C2M其中C1?(A?B)Ci?1?AB，C2?(AB)Ci?1?AB为了方便，以下Ci?1用C表示CI?(AB?AB)CM?(AB?AB)CM?ABM?ABM?ABCM?ABCM?ABCM?ABCM?ABM?ABM?ABCM?ABCM?ABCM?ABCM?(ABCM?ABCM?ABCM?ABCM ?BC?ABCM?ABCM?ABCM?ABCM?(M?A)(B?C)(BC)则Ci?BCi-1?(M?A)(B?C)六、心得体会本次实验做的是半加/减器和全加/减器两个电路，比上次实验复杂很多，因此充满了挑战性。
实验过程中，我认识到了在利用给定的电子元件进行实验设计来实现某一种或多种功能时，对电路的化简非常重要，而且要符合给定元件的限定条件，只有将电路化简成为能够与给定元件相符的情况下才能达到实验目的。
实验二半加/减器与全加/减器一、实验目的：（1）掌握全加器和半加器的逻辑功能。
（2）熟悉集成加法器的使用方法。
（3）了解算术运算电路的结构。
二、实验设备：1、74LS00（二输入端四与非门）2、74LS86（二输入端四异或门）3、数字电路实验箱、导线若干。
(74LS00引脚图) （74LS86引脚图）三、实验原理：两个二进制数相加，叫做半加，实现半加操作的电路，称为半加器。
A表示被加数，B表示加数，S表示半加和，Co 表示向高位的进位。
全加器能进行加数、被加数和低位来的信号相加，并给出该位的进位信号以及和。
四、实验内容：用74LS00和74LS86实现半加器、全加器的逻辑电路功能。
（一）半加器、半减器M=0时实现半加，M=1时实现半减，真值表如下：功能M A B S C半加0 0 0 0 0 0 0 1 1 0 0 1 0 1 0 0 1 1 0 1半减1 0 0 0 0 1 0 1 1 1 1 1 0 1 0 1 1 1 0 0(半加器图形符号)2、MAB00 01 11 100 0 1 1 01 1 0 0 1BABABAS⊕=+=MAB00 01 11 100 0 0 0 01 0 1 0 1)(MABC⊕=（二）全加器、全减器M A B 1-i CS i C0 0 0 0 0 0 0 0 0 1 1 0 0 0 1 0 1 0 0 0 1 1 0 1 0 1 0 0 1 0 0 1 0 1 0 1 0 1 1 0 0 1 0 1 1 1 1 1 1 0 0 0 0 0 1 0 0 1 1 0 1 0 1 0 1 0 1 0 1 1 0 1 1 1 0 0 1 0 1 1 0 1 0 1 1 1 1 0 0 1 1 111 111-i C B A S ⊕⊕=))((1-i C B A M BC C i ⊕⊕•=五、实验结果半加器：B A B A B A S ⊕=+= )(M A B C ⊕=全加器：1-i C B A S ⊕⊕=M C M C C i 21+=其中11()i C A B C AB -=⊕+，21()i C A B C AB -=+为了方便，以下1i C -用C 表示()()(()()()I C AB AB CM AB AB CM ABM ABM ABCM ABCM ABCM ABCM ABM ABMABCM ABCM ABCM ABCM ABCM ABCM ABCM ABCM BC ABCM ABCM ABCM ABCM M A B C BC =+++++=+++++=+++++++=++++=⊕⊕ 则))((1-i C B A M BC C i ⊕⊕•=六、心得体会本次实验做的是半加/减器和全加/减器两个电路，比上次实验复杂很多，因此充满了挑战性。
浙江万里学院实验报告
课程名称：电子技术基础
实验名称：半加器与全加器实验专业班级：
一、实验目的
1.学习使用异或门组成半加器和全加器；
2.测试集成4位二进制全加器74LS83的逻辑功能。
二、实验内容
1.用异或门和与非门构成半加器(电路如图所示)
半加器输入、输出关系表
2.用异或门和与非门构成全加器
（其他图类似，省略）
全加器输入、输出关系
3.74LS83型4位二进制加法器功能测试(电路图如图所示)
（其他图都是类似的，所以就省略）
4.用74LS83实现十六进制到BCD码的转换
(其他图类
似，所以省略) 实验小结
通过实验异或门和非门构成的半加器和全加器的实验，让我掌握了两种门是如何构成全、半加器，怎么实现逻辑功能，通过课上连接的实物电路图和课下的仿真得到数据，通过数据分析得到了所要预期的结果和功能；然后通过74LS83型4位二进制加法器和74LS83的十六进制到BCD 码的转换这2个实验，明白了74LS83加法器的逻辑功能，但是74LS83的十六进制到BCD 码的转化由于比较复杂，通过和同学、老师交流解决了一些难点，并且通过仿真得到了实验结果。
实验四组合逻辑电路的设计及半加器、全加器一、实验目的1.掌握组合逻辑电路的设计与测试方法2.掌握半加器、全加器的工作原理。
二、实验原理和电路1、组合逻辑电路的设计使用中、小规模集成电路来设计组合电路是最常见的逻辑电路。
设计组合电路的一般步骤如图图1.4.1 组合逻辑电路设计流程图根据设计任务的要求建立输入、输出变量，并列出真值表。
然后用逻辑代数或卡诺图化简法求出简化的逻辑表达式。
并按实际选用逻辑门的类型修改逻辑表达式。
根据简化后的逻辑表达式，画出逻辑图，用标准器件构成逻辑电路。
最后，用实验来验证设计的正确性。
1.半加器根据组合电路设计方法，首先列出半加器的真值表，见表写出半加器的逻辑表达式S=AB+AB=A⊕BC=AB若用“与非门”来实现，即为半加器的逻辑电路图如图在实验过程中，我们可以选异或门74LS86及与门74LS08实现半加器的逻辑功能；也可用全与非门如74LS00反相器74LS04组成半加器。
(a)用异或门组成的半加器 （b ）用与非门组成的半加器图1.4.2 半加器逻辑电路图2.全加器用上述两个半加器可组成全加器，原理如图图 表1.4.2 全加器逻辑功能表表1.4.1 半加器逻辑功能三、实验内容及步骤1.测试用异或门（74LS86）和与非门组成的半加器的逻辑功能。
根据半加器的逻辑表达式可知，相加的和Y 是A 、B 的异或，而进位Z 是A 、B 相与，故半加器可用一个集成异或门和二个与非门组成如图图1.4.4 用一个集成异或门和二个与非门组成半加器⑴ 在实验仪上用异或门和与门接成以上电路。
A 、B 接逻辑开关，Y 、Z 接发光二极管显示。
⑵ 按表，将相加的和Y 和进位Z 的状态填入下表中。
表1.4.3⑴写出图i C i = ⑵根据逻辑表达式列真值表，并完成表1.4.4，实验证之。
⑶根据真值表画逻辑函数SiCi 的卡诺图。
完成图1.4.6图 1.4.5图 1.4.6⑸试设计用异或门、与门、或门组成的全加器的逻辑功能并接线进行测试，将测试结果记入表，与上表进行比较看逻辑功能是否一致。
实验一TTL集成与非门电路一.实验目的1.熟悉TTL集成与非门外形及外部引线的排列。
2.验证TTL与非门的逻辑功能。
3.试用与非门接成其它几种逻辑门的方法并熟悉它们的逻辑功能。
二.实验仪器和芯片1.S XJ—3C数字电路学习机2.74LS00三.实验内容和步骤1.熟悉实验设备：熟悉通用实验箱的结构和使用方法，熟悉74LS00集成块的外形和引线情况。
2.测量与非门的逻辑功能将74LS00中的一个与非门的两个输入端分别接到实验箱中的两个电平开关上，输出端接到箱中的逻辑电平指示灯上，接通5V电源和地，按表1—1 完成逻辑功能的测量。
并规定高电平为逻辑“1”，低电平为逻辑“0”。
3.逻辑功能。
用74LS00中的与非门分别接成与门、或门、非门、异或门画出接线图并将测试结果1-2表中，根据表分别写出它们的逻辑表达式。
表1—2四．预习内容1.复习TTL与非门的工作原理2.了解74LS00集成电路的逻辑和引线排列图。
五．实验报告要求1．要求写出相应的表达式；2．画出相应的逻辑图；实验二组合逻辑电路的实验分析一.实验目的1.掌握组合逻辑电路的分析方法。
2.验证半加器和全加器的逻辑功能。
3.了解二进制数的运算规律。
二.实验仪器设备1.数字电路实验箱2.万用表3.74LS00三.实验内容组合电路的分析是根据所给的逻辑电路，写出输入与输出之间的逻辑关系（逻辑函数表达式或真值表）。
从而评定该电路的逻辑功能。
组合电路的分析方法，一般是首先对给定的逻辑电路按逻辑门的连接方式逐一地写出相应的逻辑表达式，然后写出输出函数的表达式（如果需要列其真值表时，可由表达式通过运算求出）。
但这样写出的逻辑函数表达式可能不是最简单的，所以还应该利用逻辑代数的公式或卡诺图进行化简。
1.分析半加器的逻辑功能图2—1（1）写出图2—1所示电路的逻辑表达式。
实验名称：组合逻辑电路（半加器全加器及逻辑运算） 一、 实验目的1. 掌握组合逻辑电路的功能测试2. 验证半加器和全加器的逻辑功能3. 学会二进制数的运算规律二、 实验仪器及材料器件 74LS00 二输入端四与非门 3片 74LS86 二输入端四异或门 1片74LS54 四组输入与或非门 1片 三、实验内容1. 组合逻辑电路功能测试（1） 用2片74LS00组成如图逻辑电路。
为便于接线和检查，需要标明芯片及各引脚编号。
（2） 图中A 、B 、C 接电平开关，Y 1、Y 2接发光管电平显示。
（3） 按表要求，改变电平开关填表并写出Y 1、Y 2逻辑表达式。
1Y A AB =+ 2Y A B B C=+（4）将运算结果与实验比较经检验，结果一致2.测试用异或门和与非门组成的半加器的逻辑功能根据半加器的逻辑表达式可知，半加器是A、B异或，而进位是A、B相与。
故半加器电路图可如图所示（1）在数字电路模拟实验箱上连接如图电路，A、B接电平开关，Y、Z 接电平显示。
（2）按表要求改变电平状态，填表3. 测试全加器的逻辑功能（1） 写出如图电路的逻辑表达式Y A B =⊕ i 1Z C -= 1i -1X C =⋅⊕（A B ）2X A B =⊕ 3()X C C A B =+⊕i i 11()i S A B C A B C --=⊕⋅+⊕1()i i C AB C A B -=+⊕（2） 根据逻辑表达式列真值表（3） 根据真值表画逻辑函数的Si 、Ci 卡诺图（4） 填写表各点状态（5） 按原理图选择与非门进行接线测试，将结果填入下表，与上表比较看逻辑功能是否一致。
4. 测试用异或门、与或门和非门组成的全加器逻辑功能全加器可以用两个半加器和两个与门一个或门组成，在实验中，常用一块双异或门、一个与或非门和一个与非门实现。
（1） 画出用异或门、与或非门和非门实现全加器的逻辑电路图，写出逻辑表达式。
i S A B C =⊕⊕ ()i i C AB A B C =+⊕⋅（2）找出异或门、与或非门和与门器件按自己画出的图接线，接线时注意与或非门中不用的与门输入端接地。
实验二、组合逻辑电路的设计与测试1．半加器真值表逻辑表达式：B A S ⊕=式1 AB C = 式2实验原理图：A BSC图1. 半加器逻辑图1（异或门+与非门）与非门下搭建的半加器逻辑电路如图2：A B图2. 半加器逻辑图2（与非门）2、全加器真值表表2. 全加器真值表逻辑表达式：1-⊕⊕=i i i C B A S 式3i i i i i i B A C B A C ⋅⊕=-))((1 式4实验原理图：A iB iC i-1图3. 全加器逻辑图1（异或门+与非门）与非门下搭建的全加器逻辑电路如图2：A iB iC B A 1-i图4. 全加器逻辑图2（与非门）3、两位数值比较器设计目标：一个四输入三输出系统，如图5所示：ABB图5. 两位数值比较器其逻辑功能为：当A1A0> B1B0时，O L＝1、O E＝0、O S＝0；当A1A0= B1B0时，O L＝0、O E＝1、O S＝0；当A1A0< B1B0时，O L＝0、O E＝0、O S＝1；具体逻辑如表3所示：4、实验要求：本次实验要求：a. 完成在异或门及与非门组合下的半加器以及全加器，填写表1和表2；b. 完成在与非门组合下的半加器以及全加器，填写表1和表2；c. 有能力的同学在表三的基础上完成完成O L、O E以及O S的逻辑表达式的推导，以基础逻辑门来搭建实现两位数值比较器；实验报告的要求：1、应该有半加器和全加器的逻辑表达式的推导化简过程；2、推导两位数值比较器的逻辑表达式；。
实验名称：组合逻辑电路（半加器全加器及逻辑运算） 一、 实验目的1. 掌握组合逻辑电路的功能测试2. 验证半加器和全加器的逻辑功能3. 学会二进制数的运算规律二、 实验仪器及材料器件 74LS00 二输入端四与非门 3片 74LS86 二输入端四异或门 1片74LS54 四组输入与或非门 1片 三、实验内容1. 组合逻辑电路功能测试（1） 用2片74LS00组成如图逻辑电路。
为便于接线和检查，需要标明芯片及各引脚编号。
（2） 图中A 、B 、C 接电平开关，Y 1、Y 2接发光管电平显示。
（3） 按表要求，改变电平开关填表并写出Y 1、Y 2逻辑表达式。
1Y A AB =+ 2Y A B B C=+（4）将运算结果与实验比较经检验，结果一致2.测试用异或门和与非门组成的半加器的逻辑功能根据半加器的逻辑表达式可知，半加器是A、B异或，而进位是A、B相与。
故半加器电路图可如图所示（1）在数字电路模拟实验箱上连接如图电路，A、B接电平开关，Y、Z 接电平显示。
（2）按表要求改变电平状态，填表3. 测试全加器的逻辑功能（1） 写出如图电路的逻辑表达式Y A B =⊕ i 1Z C -= 1i -1X C =⋅⊕（A B ）2X A B =⊕ 3()X C C A B =+⊕i i 11()i S A B C A B C --=⊕⋅+⊕1()i i C AB C A B -=+⊕（2） 根据逻辑表达式列真值表（3） 根据真值表画逻辑函数的Si 、Ci 卡诺图（4） 填写表各点状态（5） 按原理图选择与非门进行接线测试，将结果填入下表，与上表比较看逻辑功能是否一致。
4. 测试用异或门、与或门和非门组成的全加器逻辑功能全加器可以用两个半加器和两个与门一个或门组成，在实验中，常用一块双异或门、一个与或非门和一个与非门实现。
（1） 画出用异或门、与或非门和非门实现全加器的逻辑电路图，写出逻辑表达式。
i S A B C =⊕⊕ ()i i C AB A B C =+⊕⋅（2）找出异或门、与或非门和与门器件按自己画出的图接线，接线时注意与或非门中不用的与门输入端接地。
实验名称：组合逻辑电路（半加器全加器及逻辑运算） 一、 实验目的1. 掌握组合逻辑电路的功能测试2. 验证半加器和全加器的逻辑功能3. 学会二进制数的运算规律二、 实验仪器及材料器件 74LS00 二输入端四与非门 3片 74LS86 二输入端四异或门 1片74LS54 四组输入与或非门 1片 三、实验内容1. 组合逻辑电路功能测试（1） 用2片74LS00组成如图逻辑电路。
为便于接线和检查，需要标明芯片及各引脚编号。
（2） 图中A 、B 、C 接电平开关，Y 1、Y 2接发光管电平显示。
（3） 按表要求，改变电平开关填表并写出Y 1、Y 2逻辑表达式。
1Y A AB =+ 2Y A B B C=+（4）将运算结果与实验比较经检验，结果一致2.测试用异或门和与非门组成的半加器的逻辑功能根据半加器的逻辑表达式可知，半加器是A、B异或，而进位是A、B相与。
故半加器电路图可如图所示（1）在数字电路模拟实验箱上连接如图电路，A、B接电平开关，Y、Z 接电平显示。
（2）按表要求改变电平状态，填表3. 测试全加器的逻辑功能（1） 写出如图电路的逻辑表达式Y A B =⊕ i 1Z C -= 1i -1X C =⋅⊕（A B ）2X A B =⊕ 3()X C C A B =+⊕i i 11()i S A B C A B C --=⊕⋅+⊕1()i i C AB C A B -=+⊕（2） 根据逻辑表达式列真值表（3） 根据真值表画逻辑函数的Si 、Ci 卡诺图（4） 填写表各点状态（5） 按原理图选择与非门进行接线测试，将结果填入下表，与上表比较看逻辑功能是否一致。
4. 测试用异或门、与或门和非门组成的全加器逻辑功能全加器可以用两个半加器和两个与门一个或门组成，在实验中，常用一块双异或门、一个与或非门和一个与非门实现。
（1） 画出用异或门、与或非门和非门实现全加器的逻辑电路图，写出逻辑表达式。
i S A B C =⊕⊕ ()i i C AB A B C =+⊕⋅（2）找出异或门、与或非门和与门器件按自己画出的图接线，接线时注意与或非门中不用的与门输入端接地。
