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面向HDTV应用的音频解码软硬件协同设计

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HDTV 信源解码器的实现

HDTV 信源解码器的实现

HDTV 信源解码器的实现
吴晓芸;余松煜
【期刊名称】《上海交通大学学报》
【年(卷),期】1997(31)6
【摘要】提出将高清晰度电视级的ＭＰＥＧ－２传送流（其中视频符合ＭＰ＠Ｈ－１４４０）分成四个标准电视流（视频符合ＭＰ＠ＭＬ）分别进行解码，然后再合成一路高清晰度电视（ＨＤＴＶ）数据，经过数模转换后输出到高清晰度电视监视器进行显示．这样实现ＨＤＴＶ的信源解码器可行性高，易于调试，可以充分利用现有的专用芯片，并与ＳＤＴＶ级的解码相兼容．
【总页数】13页(P123-135)
【关键词】高清晰度电视;信源解码;传送流;数模转换
【作者】吴晓芸;余松煜
【作者单位】上海交通大学图象处理与模式识别研究所
【正文语种】中文
【中图分类】TN949.17
【相关文献】
1.HDTV信源解码器的硬件实现 [J], 买春法
2.数字HDTV信源解码器的硬件实现 [J], 王承宁;俞斯乐;李华;国澄明
3.基于ST20TP4的HDTV信源解码器的软硬件实现 [J], 冷高峰;于振生;杜蓓蓓
4.基于ST20TP4的HDTV信源解码器的软硬件实现 [J], 冷高峰;于振生;杜蓓蓓
5.数字HDTV信源解码器的研究与实现 [J], 国狄非;国澄明;张涛;陈珊;俞斯乐因版权原因，仅展示原文概要，查看原文内容请购买。

基于MIPS内核的SoC软硬件协同仿真

基于MIPS内核的SoC软硬件协同仿真

文ｌ 吗ｔ 晦 Ａ
中圈分葺号 Ｐｌ ｝ ｔ ３ｌ Ｔ
基于 ＭＩ Ｓ内核 的 Ｓ Ｃ软硬 件协 同仿真 Ｐ ｏ
王 江 ，刘佩林 ，陈曩琪
（ 上海 交通 大学图像通 信与信息处理研究所 ，上海 ２０ ３ ） ００ ０
ｌ
要 ：针对基于 ＭＩＳ系列处理器 内核的高清 电视解码 ＳＣ Ｐ ｏ ，构建 了一个软硬件协 同仿真环境 。连接 ＭＩＳ处理器 内核 的 Ｖ Ｐ ＭＣ模型和
Ｍ Ｉ ｒ ｃ ｓｏ Ｏ ｄｔｅＲＴ ｍｏ ｅ ｆｔｅＨＤＴＶ ｏ ｔｅｓ ｆｗａｅａ ｄ ｈ ｒ ｗａｅｏ ｏ ｓ ｎ ｈ ｏ ｏ ｓｙ ｃ ｎｂ ｅ ｕ ｅ ， ｉｈＣ ｅ ｄ ｔ ＰＳｐ ｏ ｅｓ ｒＣ ｒ ａ Ｌ ｄ ｌ ｅｎ ｈ ｏ ｈ Ｓ Ｃ， ｏ ｔ ｒ ｎ ａ ｄ ｒ ｆＳ Ｃ ｙ ｃ ｒ ｎ ｕ ｌ ａ ｅｄ ｂ ｇ ｄ ｗｈ ｃ ａ ｌａ ａ ｈ ｎ Ｏ
Ｗ ＡＮＧ ｉｎｇ ＬＩ Ｐ ｉ ｎ ＣＨＥＮ ｎ ｑ Ｊａ ， Ｕ ｅｌ ， ｉ Ｙｉ ｇ ｉ
（ ｓ． ｆ ｍａ ｅ ｍｍｕ ｉａｉｎ＆ Ｉ ｆ ｒ ｔ ｎＰ ｏ ｅ ｓ ｇ Ｓ ａ ｇ ａ Ｊａ ｔ ｎ ｎ ｖ Ｓ ａ ｇ ａ ０ ０ ０ Ｉ ｔｏ ｇ ｎ Ｉ Ｃｏ ｎｃ ｔ ｏ ｎ ｏｍａｉ ｒｃ ｓｉ ， ｈ ｎ ｈ ｉ ｉ ｏ ｇ Ｕ ｉ． ｈ ｈ ｉ ０ ３ ） ｏ ｎ ｏ ， ｎ ２
Ｖ ＭＣ仿真 的重点也就是 Ｓ Ｃ总线入式软 件在 同一 个验证环境下进 Ｔ
行 同步调试 。这样 ，软件工程 师可 以较早地在硬件设计上直 接 调试软件 ，硬件工程 师可 以较 早地得到更加真实 的输入激 励 ，从而有效地缩短 了系统 的设计 时间…。 在 Ｈ Ｖ 解码 Ｓ Ｃ验证仿真 中我们使用 了 ＤＴ ｏ ＭＩＳ内核的 ＶＭＣ Ｖ ｒｏ ｄ ｌ Ｃ ｍｐｌｒ Ｐ （ｅｉ ｇＭｏ ｕｅ ｏ ｉ ） ｌ ｅ 模型

用于H.264编解码的面向HDTV应用的动态可重构多变换VLSI结构

用于H.264编解码的面向HDTV应用的动态可重构多变换VLSI结构

用于H.264编解码的面向HDTV应用的动态可重构多变换VLSI结构洪琪;曹伟;童家榕【期刊名称】《电子学报》【年(卷),期】2011(039)005【摘要】提出了一种新的支持MPEG-4 AVC/H.264标准4×4整数变换的动态可重构结构.首先,针对4×4正反变换分别推导了两个新的二维直接信号流图.进而设计了一个面向HDTV应用的动态可重构多变换结构.该结构无需转置寄存器且计算单元仅需16个加法器(减法器).采用0.18μm CMOS工艺实现了该电路结构.结果表明,最高工作频率可达200MHz,电路规模仅为5140门,最大功耗仅为15.64mW.在100MHz的时钟频率下工作,该电路即可实时处理HDTV 1080P的高质量视频序列.对比现有结构,在HDTV应用中,该结构在面积和功耗方面优势明显.%This paper presents a new dynamic reconfigurable architecture of the 4 × 4 integer transforms for the MPEG-4 AVC/H.264 standard. Two novel 2-D direct signal flow graphs of the 4 × 4 forward and inverse transforms for H.264 are proposed. A dynamic reconfigurable multi-transform architecture without using transpose memory is proposed on the basis of the new SFGs. There are 16 adders (subtractors) in it. Our design is implemented with 0.18um CMOS technology. The optimum clock frequency of the circuit for the multiple transforms is 200MHz which achieves 800Mpixels/s data throughput rate with the area cost of 5140 gates and the power dissipation of 15.64 mW. Under a clock frequency of100 Mhz,the architecture allows the real-time processing of HDTV 1080P. Compared with the existing architectures, our design is more efficient in terms of area and power dissipation for HDTV application.【总页数】5页(P1059-1063)【作者】洪琪;曹伟;童家榕【作者单位】复旦大学专用集成电路与系统国家重点实验室,上海,201203;复旦大学专用集成电路与系统国家重点实验室,上海,201203;复旦大学专用集成电路与系统国家重点实验室,上海,201203【正文语种】中文【中图分类】TP302【相关文献】1.H.264标准中Exp-Golomb编解码器的VLSI设计 [J], 吴斌;郭树旭;王明江;郑凡;陈玫玫2.一种用于H.264编解码的新型高效可重构多变换VLSI结构 [J], 曹伟;洪琪;侯慧;童家榕;来金梅;闵昊;荆明娥3.用于H.264/AVC的D级数据重用整数运动估计VLSI结构 [J], 郑兆青;桑红石;黄卫锋;沈绪榜4.应用于JPEG2000的高性能离散小波变换VLSI结构 [J], 朱珂;华林;鲁则瑜;周晓方;章倩苓;郭正5.一种新的用于H.264/AVC的运动估计VLSI结构 [J], 郑兆青;桑红石;赖晓玲;沈绪榜因版权原因，仅展示原文概要，查看原文内容请购买。

HDTV接收系统中视频解码的研究与实现

HDTV接收系统中视频解码的研究与实现

HDTV接收系统中视频解码的研究与实现
李元九;苏凯雄
【期刊名称】《有线电视技术》
【年(卷),期】2007(14)2
【摘要】本文简要分析了HDTV接收系统中视频解码的特点与实现方法,介绍了一种HDTV视频解码器的硬件结构及其工作过程.重点讨论了该视频解码器的软件系统结构,主要模块的设计与实现.该视频解码器可对符合MPEG-2MP@HL的视频流进行解码并兼容多种视频格式的输出.
【总页数】4页(P69-72)
【作者】李元九;苏凯雄
【作者单位】福州大学电子技术研究所;福州大学电子技术研究所
【正文语种】中文
【中图分类】TN94
【相关文献】
1.HDTV视频解码器中码率缓冲的实现方法 [J], 王少勇;王兆华
2.用于HDTV视频解码器的高性能SDRAM控制器 [J], 赵强;罗嵘;汪蕙;杨华中
3.HDTV视频解码器中系统控制功能的实现 [J], 王少勇;王兆华
4.HDTV视频解码器中系统控制的分析与实现 [J], 王少勇;王金刚
5.科胜讯 HDTV视频解码器获得DCS模拟备份保护认证 [J],
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HDTV的完整音视频解决方案

HDTV的完整音视频解决方案

HDTV的完整音视频解决方案HDTV的完整音视频解决方案上网时间：2006年11月01日收藏不管是受摩尔定律还是消费者需求的推动，当前电视机对性能的要求大幅提升。

具有数据处理量是标准清晰度(SD)电视格式6 倍的1,080像素高清晰度(HD)格式、管理DTV、IPTV 以及视频会议广播、处理杜比AC-3、MPEG以及其它音频格式等，都已迅速成为数字电视(DTV)的必备功能。

除了与音视频与输入信号格式有关的技术要求外，数字电视还涉及几种显示方式：前投、背投、DLP、LCD、等离子以及CRT等。

不管是通过手表内置的1英寸显示器观看电视，还是使用将整个墙面用作显示屏的投影系统，这种显示尺寸和性能的组合都是丰富多样的。

尽管目前销售的每台数字电视从尺寸、形状、大小来说各不相同，销售人员对不同型号的介绍也大不一样，但是数字电视机内部的基本结构却十分相似。

总体说来，DTV可大致分为以下几个主要部分：显示器(与驱动器)、内核媒体引擎、音频解码与处理、视频解码与处理、高频头电路、接口模块和电源等。

图1是高清晰度数字电视(HDTV)在半导体功能层面上的基本结构图。

这些元件大多数都可以从同一家公司获得，从而能在确保兼容性的同时加快设计周期，更快地将产品推向市场。

德州仪器(TI)不仅提供开发HDTV 所需的几乎所有半导体元件，而且还组建了专门的工作小组，以推进音视频与DLP技术的发展，改善用户的电视体验。

TI的TMS320DM644x系列、达芬奇数字媒体处理器和其它内核处理功能，以及丰富的高性能模拟元件具有集成度高、灵活性高及方便易用的特点，可以满足快速发展的DTV市场需求。

充分利用高性能音视频编解码器、图形加速功能、通信与支持服务，对开发满足家庭娱乐体验需求的融合应用至关重要。

图1：典型的数字电视系统可大致分为显示器(与驱动器)、内核媒体引擎、音频解码与处理、视频解码与处理、高频头电路、接口模块和电源等主要部分。

视频解决方案消费者观赏电视节目时最重视的或许是视频体验。

一种基于HDTV信源集成解码芯片的RTOS的设计与实现

一种基于HDTV信源集成解码芯片的RTOS的设计与实现

Ｖｏ１７ ．
Ｎ Ｏ． ３
Ｓｅｐ ｅ ｂ ｒ ０ ｔ ｍ ｅ ，２ ０２
一
种 基 于 Ｈ Ｔ 信 源 集 成 解 码 芯 片 的 Ｒ ＯＳ 的 设 计 与 实 现 ｔ Ｄ Ｖ Ｔ
高 丰， 刘 鹏 ， 姚 庆 栋 ， 李 东 晓
（ 江 大 学 信 息 与 电 子 工程 学 系 ， 浙 江 杭 州 ３ ０ ２ ） 浙 １０ ７
键 技 术 之 一 ， 它 能 屏 蔽 硬 件 实现 的 细 节 ， 为 应 用 程 序 提 供 一 个 统 一 的接 口 ，加 快 软 件 的 开 发 。其 次 ，
Ｒ ＯＳ 是 软 硬 件 协 同 设 计 平 台 的 重 要 组 成 部 分 。在 软 硬 件 协 同 设 计 中 ， 硬 件 是 指 根 据 应 用 设 计 的专 Ｔ Ｊ 用 电路 ； 软 件 是 指 在 指 令 集 处 理 器 中执 行 的程 序 。复 杂 系统 通 常 采 用 Ｒ ＯＳ来 管 理 多个 并 发 执 行 的任 Ｔ 务 。Ｓ ＯＣ 中 的 实 时 操 作 系 统 与 通 常 的嵌 入 式 实 时 操 作 系统 相 比又 有 新 的特 点 ： ・ 可 以采 用 软 硬 件 协 同设 计 的 方 法 提 高 性 能 。可 以将 一 部 分 操 作 系 统 的功 能 由软 件 迁 移 到 硬 件 来
并 针 对解 码 芯片 设 计并 实现 了多任 务 混合 调度 算 法 。为提 高 系 统 的健壮 性 ，Ｉｔ 具有 一个 简 单 的存 储保 护 策略 。 ｏａ还
关键 词 ： 实 时操 作 系统 （ Ｔ Ｒ ＯＳ） 系 统 集 成 芯 片 （ Ｏ ： 软 硬 件 协 同 设 计 ： 实 时 调 度 ： 存 储 保 护 ： Ｓ Ｃ）
维普资讯

基于通用DSP实现HDTV机顶盒的研究与设计

基于通用DSP实现HDTV机顶盒的研究与设计
贾雅琼
【期刊名称】《电子测试》
【年(卷),期】2007(000)011
【摘要】本方案以TI公司的TMS320TMS320C6701 DSP为核心,实现有线接收的数字HDTV机顶盒.通用DSP-TMS320TMS320C6701作为系统核心完成系统控制、解复用、音频解码、视频解码控制等任务.由于DSP软件的兼容性,本方案开发的前端控制、码流输入、解复用、音频解码、音频输出等软件模块可在将来实现的系统中沿用.
【总页数】5页(P31-35)
【作者】贾雅琼
【作者单位】湖南工学院,衡阳,421008
【正文语种】中文
【中图分类】TN94
【相关文献】
1.HDTV机顶盒软件设计实现的探讨 [J], 王兆庆
2.基于DSP的HDTV实时码流合成器实现 [J], 王金础;叶玮;余松煜
3.基于ST解决方案的HDTV机顶盒软件的设计实现 [J], 黄欣;陈珊;俞斯乐
4.基于DSP和ARM的IP交互式机顶盒的设计与实现 [J], 朱振博;戴琼海;丁嵘
5.基于ADSP-TS101S的高速通用DSP板的实现 [J], 王绍清;牛晓丽;韩松
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HDTV编码器测试系统的设计与硬件实现

HDTV编码器测试系统的设计与硬件实现
潘其涛;方向忠;余松煜
【期刊名称】《计算机工程》
【年(卷),期】2002(028)006
【摘要】高清晰度电视(HDTV)编码器测试系统用于HDTV编码器各模块电路的调试与故障诊断,是HDTV编码器研制过程中不可缺少的测试设备.该系统通过向HDTV各模块电路发送测试用的数字视频码流,并接收和分析经过各模块电路处理后的视频码流,从而确定HDTV编码器各单元电路是否正常.该文提出并实现了一个HDTV编码器测试系统,主要介绍了硬件部分的设计与实现.
【总页数】2页(P214-215)
【作者】潘其涛;方向忠;余松煜
【作者单位】上海交通大学图像通信与信息处理研究所,上海,200030;上海交通大学图像通信与信息处理研究所,上海,200030;上海交通大学图像通信与信息处理研究所,上海,200030
【正文语种】中文
【中图分类】TN949.17;TN949.6
【相关文献】
1.便携式演播室级MPEG-2硬件编码器的设计与实现 [J], 熊怡因;王兴东;张林
2.HDTV视频编码器码流合成单元的设计与实现 [J], 王峰;张文军;叶玮
3.HDTV视频编码器系统子图分割并行处理单元的设计与实现 [J], 熊红凯;余松煜;
叶玮
4.以太网数字影像遥测编码器的硬件设计与实现 [J], 施华雷;王宁;刘宇;田增山
5.基于水平条状分割的HDTV视频编码器的设计与实现 [J], 熊红凯;余松煜;叶玮因版权原因，仅展示原文概要，查看原文内容请购买。

基于MIPS内核的HDTV SoC平台音频PCM输出模块的设计

基于MIPS内核的HDTV SoC平台音频PCM输出模块的设
计
刘嘉龑;孙军
【期刊名称】《电视技术》
【年(卷),期】2005(000)005
【摘要】介绍了基于MIPS 4KcTM内核的数字高清晰度电视(HDTV)SoC平台,主要针对5.1声道的情况提出了该平台上系统的音频PCM输出模块的设计方案.并通过仿真与综合,验证了该模块能够达到系统总体设计的要求.
【总页数】3页(P29-30,34)
【作者】刘嘉龑;孙军
【作者单位】上海交通大学,芯片与系统研究中心,上海,200030;上海交通大学,芯片与系统研究中心,上海,200030
【正文语种】中文
【中图分类】TN949.197
【相关文献】
1.基于MIPS内核的SoC软硬件协同仿真 [J], 王江;刘佩林;陈颖琪
2.基于MIPS内核的HDTV-SoC平台总线接口模块 [J], 周波;孙军
3.基于SoC FPGA的MIPS处理器验证平台设计 [J], 张伟;梁蓓;
4.普然通信获得MIPS科技 MIPS32 4KEc内核授权——宽带接入解决方案提供商将MIPS-Based系统级芯片（SoC）集成至xDSL接入设备的设计中 [J],
5.MIPS 4Kc CPU IP内核及其相关SoC的研究与设计探索 [J], 郑联;吴远辉;罗雄兰
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HDTV嵌人数字音频分析软件设计


【 ｂ ｔａｔ Ｂ ｓｄ ｏ Ｓ Ｐ Ｅ ２９ ｓ ｎ ａｄ， ｔｉ ａｅ ｉｔ ｄ ｃｓ ｔｅ ｈｏｙ ｆ ｉ ｔ ａ ｄｏ ｍ ｌｐｅｉｇ ｎ Ａ ｓｒｃ 】 ａｅ ｎ Ｍ Ｔ ９ Ｍ ｔ ｄ ｒｓ ｈｓ ｐｒ ｎ ｏ ｕｅ ｈ ｔｅｒ ｏ ｄｇ ａ ｕｉ ａ ｐ ｒ ｉｌ ｕｔ ｌｘｎ ａｄ ｉ
比特位所代表 的功能如表 １ 所示ｎ１ 。 。
表 １ 辅助 数据
ｖ 声音样值有效 比特位
频信号 的辅 助数据空 间内传输 。这样 不仅解决 了视 频 、
音频 不 同步 的问题 ， 也大 大 节省 了传 输 路线 和装 配 成
本 。但是 ， 对于 电视 台 、 影像公 司 、 电影制作公 司等 传媒
Ｄ 。
【 本文献信息 】 ， 刘越 章文辉．Ｄ Ｖ嵌入 数字音频分析软件设计［． ＨＴ Ｊ 电视技术 ， １ ，６２ ］ ２ ２３ （） ０
嘲 秘援壤
矿 ｉ ｅ 匹ｎ ｉ ，ｆ Ｅ ｏ ０ ， Ｆ
ＨＤＴ Ｖ嵌人数字音频分析软件设计
刘 越， 章文辉
（ 中国传媒 大学 信息工程 学院， 北京 １０ ２ ） ０ ０ ４
【 摘
要 】详 细介绍 了基于 Ｓ ＰＥ ９ 标 准规定 的 Ｈ —Ｄ 数 据流格 式及 数 字音频嵌入 原理 。编程 实现 了Ｈ Ｔ Ｍ Ｔ ２９ Ｄ ＳＩ Ｄ Ｖ嵌入 音频 信号
的解嵌 ， 分析 音频数据包 和音 频控制包 的嵌入格 式 ， 并计算 出音频 幅值 、 采样 频率 、 音频样值 数和嵌入 通道数 。实验证 明 ， 采用
ｄ － ｌ ｐ ｅ ｉ ｇ ｉ ｅａ ｌ ａ ｄ ｏｔ ｒ ｉ ｈ ｒ ａ ｉｅ ｈ ｆｎ ｔ ｎ ｆ ａ ａｙ ｉ ｇ ｈ ２ － ｉ ｉｉ ｌ ｕ ｉ ｏ ｍａ ｏ ｅ ｍｕ ｔ ｌ ｘｎ ｎ ｄ ｔｉ ｉ ， ｎ ａ ｓ ｆ ｗａ ｅ ｗｈ ｃ ｅ ｌ ｓ ｔ ｅ ｕ ｃ ｉ ｏ ｎ ｚｎ ｔ ｅ ４ ｂ ｔ ｇｔ ａ ｄ ｏ ｆ ｒ ｔ ｆ ｒ ＨＤ Ｖ ｉ ｚ ｏ ｌ ｄ ａ Ｔ ｓ ｄ ｓｇ ｅ ，ｉ ｃｕ ｉ ｇ ｓ ｐ ｒ ｔ ｕ ｉ ｄ ｔ ａ ｋ ｔ ａ ｄ ｕ ｉ ｏ ｔｏ ａ ｋ ｔ ｎ ｔ ｅ ａｃ ｌｔ ａ ｄ ｏ ｄ ｔ ，ｆａ ｓ ｑ ｅ ｃ ，ｓ ｍｐ ｅ ｅ ｉ ｎ ｄ ｎ ｌ ｄ ｎ ｅ ａ ａｅ ａ ｄ ｏ ａ ａ ｐ ｃ ｅ ｎ ａ ｄ ｏ ｃ ｎ ｒ ｌ ｐ ｃ ｅ ，ａ ｄ ｈ ｎ ｃ ｌｕ ａ ｅ ｕ ｉ ａ ａ ｌ ｍｅ ｅ ｕ ｎ ｅ ａ ｌ ｎ ｍｂ ｒ ｈ ｎ ｅ ｕ ｅ ｎ Ｏ ｏ ．Ｅ ｐ ｒ ｎ ｓ ｓ ｏ ｈ ｔ ｈ ｄ ｇｔ ｕ ｉ ｎ ｙ ｉ ｏ ｔ ａ ｅ ｉ ｒ ｃｉ ａ ｌ， ａ ｄ ｍｕ ｈ ｈ ａ ｅ ｕ ｅ ，ｃ ａ ｎ ｌ ｎ ｍｂ ｒ ａ ｄ Ｓ ｎ ｘ ｅｉ ｍｅ ｔ ｈ ｗ ｔ ａ ｔ ｅ ｉ ｉ ａ ｄｏ ａ ａ ｓｓ ｆ ｒ ｓ ｐ ａ ｔｃ ｂ ｅ ｎ ｃ ｃ ｅ ｐ ｒ ｌ ａ ｌ ｓ ｗ
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９ ６ ０ ｂ ｙ ｔ ｅ 程序 空间， 一 帧减 少 １ ６ １ ３ ８ ０ ｃ ｙ ｃ ｌ ｅ 运 行 的周 期 数 。 依 据 以上 协 同设 计 分析 可 以发 现 ． 在 减 少硬 件 开 销 的 同 时 ， 对 占用 存储 空 间进 行 有 效控 制 ． 能 够 最 大 限度 上 的 减 少 单位 帧 的 指
面向 Ｈ Ｄ Ｔ Ｖ应用的音频解码软硬件协同设计
陈
【 摘
岩， 董志永 ， 李
丹（ 天津三星电 子有限公司， 天 津市３ ０ ０ ４ ６ ２ ）
要】 Ｈ Ｄ Ｔ Ｖ是在模拟 电视的基础之上 ， 为达到高分辨率 的图像质量性能而发展起来的。 音频解码属于高清晰度 电 视 接收机 的关键部分。 面
专 用指 令 标 准 ， 提 升 并拓 展 整 个指 令 集 的基 本要 求 ， 在 最 大 限 度 上 的优 化 与处 理 整 体 系统 性 能 的 提 升 。通 过 硬 软 件 协 同 的
方式． 优 化 具体 路 径 。 得 出最 终 的评 估 结 果 。
定 系统 解 码 与 音频 解码 后 ，对 系统层 流码 进 行 解 包 并语 义 解
释处理 ， 同 时形 成 对 不 同功 能 部 件 的 管 理 机 制 ， 运 用 软件 解码
的 方 式 完 成 。 在 实现 Ｔ Ｓ流 输 入 完 成 之 后 。 在 解 压程 序 解 包之 后． 给 出音 频 Ａ Ｃ ３视 频 码 流 ， 进 而 通过 总 线 送 到 Ｒ Ｉ Ｓ Ｃ进 行 解 码． 完 成 解码 之 后 通 过 总 线 传 递到 原 有 单 位 进 行 回 放＿ ｌ １ 。
面要 求 则较 低 。
３ 结 论
综上所述 。 在 Ｒ Ｉ Ｓ Ｃ核 基 础 之 上 。 对 ＡＣ ３音 频 加 码 进 行 处 理． 在 充 分 协 调 硬 件 与 软 件 的 设 计 完成 之 后 ， 实现 音 频 解 码 软
进行尾数解量化 ， 最 终 得 到 频 数 系数 的 尾 数 ； ⑧ 在进 行耦 合 声
道 的过 程 中。由 于 实际 频 率 系数 方 面 的差 异 性 ， 应该针对其 中 涉及 到 的 各 项 基 本 要 素 进 行 探 究 ．运 用 滤 波 器 进 行 逆 变换 处
理。 得 出Ｐ ＣＭ 数 值 ， 将 其 送 到 缓 中区播放 。
【 关键词 】 Ｈ Ｄ Ｔ Ｖ； 音频解码 ： 软硬件协 同
【 中图分类号 】 Ｔ Ｎ ９ ４ １ ． ３
【 文献标识码 】 Ａ
【 文章编号 】 １ ０ ０ ６ — ４ ２ ２ ２ （ ２ ０ １ ５ ） １ ０ — ０ ２ ４ ８ — ０ １
刖 舂
ＨＤ Ｔ Ｖ， 即 高 清晰 度 电 视 ， 分析 Ｈ Ｄ Ｔ Ｖ 音 频 解码 软 硬 件 的
得 出频 率 数 当中 的 指数 信 息 ： ② 经 过 比特 指 派 以及 指 派信 息 ，
具 体 实践 的过 程 中， 对音频 ５ ． １ 声道 ， 比特 率 为 ３ ８ ４ ｋ ｂ ｐ ｓ ，
采用率为 ４ ８ ｋ Ｈｚ的 一 帧 所得 ． 对添 加 指 令 减 少控 制 以及 硬 件 的 占 用 门 数 进 行 具 体 分 析 ．得 出 美 增 加 ２ ４ ８ ５ ｇ ａ ｔ ｅ ， 则 减 少
拓 展 的 方 式 将 ＲＩ Ｓ Ｃ 处 理 器 以 及 ＲＴ Ｌ进 行 描 述 ． 流程 ： ①当 Ａ Ｃ ３流入 之 后 ， 经 过
数 据 帧 的 同时 ， 误 码 检 测 以及 数 据 帧 解 格 式 化 过 程 得 以优 化 ．
作 为基 础 核 心 因 素 ． 为全 面提 升 ＡＣ３解 码 以及 ＲＩ Ｓ Ｃ 处 理 器
１ Ａ Ｃ ３ 解 码流 程 分析
ＭＰ Ｅ Ｇ 一 ２ Ｍ Ｐ ＠ＨＬ集 成 解 码 芯 片主 要 完成 系统 解 码 ． 在确
的基 本 性 能 ， 对整个 Ｒ Ｉ Ｓ Ｃ 处理 器指 令 集分 析 ， 增强Ａ Ｃ ３解 码
在 进 行 软 件 评 估 的过 程 中 ． 运用Ｖ ｅ ｒ ｉ ｌ ｏ ｇ 语 言 描 述 虚 拟 机
运行拓展版 本的基本； ｒ － 编． 对 ＡＣ３周 期 的程 序 周 期 数 进 行 明
确。 而在 硬 件 方 面 ， 则运 用 Ｓ Ｙ Ｎ Ｏ Ｐ Ｓ Ｙ Ｓ的 Ｄ ｅ ｓ ｉ ｇ ｎ ｃ ｏ ｍ ｐ ｉ ｌ ｅ ｒ 综 合
任 务 要 求 。 对软 硬 件 进 行 协 同设 计 ， 增 强 指 令 优化 。
２ ． ３ 协 同设 计
面向 Ｈ Ｄ Ｔ Ｖ 的音 频 加 码 Ｒ Ｉ Ｓ Ｃ核 ， 该 核 是 整 个 解 码 芯 片 的 关键 部 件 ． 在 此次设计的过程 中， Ｒ Ｉ Ｓ Ｃ处 理 器将 ＭＩ Ｐ Ｓ Ｒ ３ ０ ０ ０
令 运 行 周 期
２ 音频解码软硬件协 同设计
面 向 ＨＤ Ｔ Ｖ的 音 频 解 码 ，在 处 理 器 的 选 择 方 面 应 该 基 于
软 件 与硬 件 两 个 层 面 进 行 具 体 划 分 ．进 而 对 解 码 算 法 当 中的 各 个部 分 进 行 阐述 与 分 析 ， 计 算量 较 小 ， 对 于 解 码 器 的 性 能 方
Ｒ Ｉ Ｓ Ｃ核 程 序 多任 务 之 间进 行 有 效 切 换 ． 控 制输 入 ／ 输 出控 制 器
数 据 调 度 的 基 本 策略
协 同设 计 ， 主 要 通 过 系统 集 成 芯 片 进 行 最 常 用 部 件 的 设 计 ， 承
担一定的算法任务。在整体解码芯 片当中， ＭＩ Ｐ Ｓ Ｒ ３ ０ ０ ０指 令 集兼容 的 ３ ２位 嵌入 式 Ｒ Ｉ Ｓ Ｃ核承担 着音频 Ａ Ｃ ３解 码 的 基 本
向 音频 解 码 软 硬 件 具 体 协 同 设计 ， 将依据 Ａ Ｃ ３作 为研 究 算 法 ， 进 而 在 充 分 强调 系统 集 成芯 片 Ｒ Ｉ Ｓ Ｃ的 同时 ， 承 担 基 本 的算 法 任 务 以及 算 法标 准 要求 。 研 究 结 果 表 明 ， 音 频 解 码 速度 被 提升 ， 降低 存 储 空 间 压 力 。