片机与存储器接口电路设计
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目录1、课程设计目的 (2)2、课程设计内容和要求2.1、设计内容 (2)2.2、设计要求 (2)3、设计方案 (2)3.1、设计思路 (2)3、1、 1 外部存储器的扩展 (2)3、1、2静态RAM 6264扩展 (3)3、1、3地址空间的分配 (3)3.2、工作原理及硬件框图 (6)3、2、1单片机系统的工作原理 (6)3、2、2、6264芯片引脚和内部结构 (7)3、2、3、74LS373引脚图内部结构原理图和电路连接图 (9)3、2、4、74ls138芯片功能 (10)3.3、硬件电路原理图 (11)3.4、PCB版图设计 (12)4、课程设计总结 (12)5、参考文献 (13)1、设计目的1、1、掌握电子电路的一般设计方法和设计流程;1、2、学习简单电路系统设计,掌握Protel99的使用方法;1、3、掌握单片机、存储器的应用;1、4、学习掌握硬件电路设计的全过程。
2、课程设计内容和要求2、1、设计内容对8051单片机实现外扩16KB RAM,采用两片6264作外扩RAM;2、2、设计要求2、2、1、学习掌握单片机及静态存储器SRAM的工作原理及应用;2、2、2、熟练掌握应用Protel99设计原理图及制作PCB图的过程;2、2、3、整理设计内容,编写设计说明书。
3、设计方案3、1、设计思路3、1、1 、外部存储器的扩展外部数据存储器的扩展方法及时序扩展外部RAM电路原理图读外部数据RAM时序写外部数据RAM时序3、1、2、静态RAM 6264扩展6264是8K×8位的静态随机存储器芯片,它采用CMOS工艺制造,单一+5V供电,额定功耗200mW,典型存取时间200ns。
3、1、3、地址空间的分配地址空间的分配,实际是16位地址线的具体安排与分配,是应用系统统硬件设计中至关重要的一个问题。
它与外部扩展的存储器容量及数量、功能接口芯片部件的数量等等有关,必须综合考虑,合理分配。
在外部扩展多片存储和功能部件接口芯片时,主机通过地址总线发出的地址是用来选择某一个存储单元或某一个功能部件接口芯片(或芯片中的某一个寄存器)的。
要完成这一功能,必须进行两种选择:一是必须选择出指定的芯片(称之为片选);二是必须选择出该芯片的某一个存储单元。
第二种选择由地址总线来完成,现在讨论第一种选择,即选中该芯片。
通常有两种片选的方法:线选法和译码法。
线选法线选法就是将多余的地址总线(即除去存储容量所占用的地址总线外)中的某一根地址线作为选择某一片存储或某一个功能部件接口芯片的片选信号线。
一定会有一些这样的地址线,否则就不存在所谓的“选片”的问题了。
每一块芯片均需占用一根地址线,这种方法适用于存储容量较小,外扩芯片较少的小系统,其优点是不需地址译码器,硬件节省,成本低。
缺点是外扩器件的数量有限,而且地址空间是不连续的。
例如,单片机外扩二块6264RAM,6264只有13根地址线,还有三根是多余的,这三根线就可以用来作为片选使用,将其中的A13接第一片6264的,而A14接第二片6264的,可以分析一下两块芯片的地址。
由于芯片规定,端为0芯片就能被选中,所以第一片芯片的地址可以是A15 A14 A13 A12……A01 1 0 ×………×其中X是接于6264芯片的地址引脚上的值,可以是0也可以是1,因此,这一块芯片的地址就是从1100 0000 0000 0000~1101 1111 1111 1111,也就是C000H~DFFFH这一段空间,而第二块芯片的地址则可以是A15 A14 A13 A12……A01 0 1 ×………×即这一块芯片的地址可以是1010 0000 0000 0000~1011 1111 1111 1111,也就是A000H-BFFFH。
第一块芯片的地址也可以是从C000H-DFFFH:A15 A14 A13 A12……A00 1 0 ×………×如果用0100 0000 0000 0000~0101 1111 1111 1111即4000H-5FFFH来访问第一块6264也是可以的,而第二块6264也可以用2000H-3FFFH来访问,也说是说一个芯片有多个地址与其相对应。
那么如果把第一块芯片的地址这样定:A15 A14 A13 A12……A01 0 0 ×………×如果只有一块芯片,这也是没有问题的,但这里有两块芯片,如果A13为0的同时A14也为0,则必然会在选中第一块芯片时,也选中第二块芯片,这就会造成冲突,也就是说如果这样定地址的话,就人为造成了同时选中两块芯片的情况,这是不允许的。
从上面的分析中可以看出,线选法会使得一块芯片拥有多组地址,这实际上意味着这些地址空间被浪费掉了,不能够使用了。
以上面例子而言,只有3根(A13、A14、A15)地址线可以用于片选,所以只能扩展3片6264芯片,也就是只能够扩展到3*8=24K的RAM空间,采用这种芯片就没有办法扩展更多的RAM了。
译码法由于线选法中一根高位地址线只能选通一个部件,每个部件占用了很多重复的地址空间,从而限制了外部扩展部件的数量。
采用译码法的目的是减少各部件所占用的地址空间,以增加扩展部件的数量。
译码法必须要采用译码芯片,常用的译码芯片有74LS138、74LS139等。
3、2、4、中介绍了74LS138的工作原理。
在上面的例子中,系统扩展了两片6264芯片,共用去地址线13根,还有3根地址线没有用,如果用译码法,就可以把这三根地址线分别接到74LS138的译码端,如将A15接A端,A14接B端,A13接C端,然后用译码器的输出端接6264的片选端,例如用Y0接到第一片6264,而用Y5接到第二片6264。
由于系统中只有一块74LS138,所以把G1接+5V,、则接地以选中该块芯片。
下面分析一下这样这法这两片6264的地址范围。
要选中第一片6264,就是要求Y0为0,查一下表,当Y0是0时,要求A、B、C均为0,因此,可以写出第一片6264的地址范围是:A B CA15 A14 A13 A12……A00 0 0 ×………×即从0000 0000 0000 0000B~0001 1111 1111 1111B,也就是0000H~1FFFFH。
第二片6264的片先端是接的Y5,逆查表格可以看到,要Y5等于0,就是要求A=1、B=0、C=1,同样可以写出第二片的地址范围是:A B CA15 A14 A13 A12……A01 0 1 ×………×即第二片的地址范围是1010 0000 0000 0000~1011 1111 1111 1111,也就是A000H~BFFFH。
由于一块74LS138有8个输出端,这里只用了两个,所以还可以再接6个,因此,采用这种方法可以扩展的地址空间是8K×8=64K,即能够利用全部的64K空间。
如果所用的芯片是2K的,如6116,那么就只需要用到11根地址线,也就是有5根高位的地址线是空余的,这时再用74LS138进行扩展也会出现地址重叠的现象,比如,将A13,A12和A11接到一片74LS138的A,B,C三个输入端,那么第一个输出Y0对应的地址就可以是:A B CA15 A14 A13 A12 A11 A10……A01 1 0 0 0 ×………×即地址范围是1100 0000 0000 0000~1100 0111 1111 1111,也就是C000H~C7FFH。
很容易想到,并非一定要规定A15 A14是1,也可以是0,所以实际上Y0对应的有四段地址,分别是0000 0000 0000 0000~0000 0111 1111 1111(0000H~07FFH)、0100 0000 0000 0000~0100 0111 1111 1111(4000H~47FFH)、8000H~87FFH和C000H~C7FFH。
同样,其余的每一个输出端也会对应4段地址,事实上,由于一片74LS138只有8个输出端,而每一个输出端接的是一片2K的芯片,所以用一片74LS138芯片只能译出2K×8即16K的地址。
在用一片74LS138不能译出所有的地址的情况下,可以使用多块74LS138进行译码,利用该芯片的片选端进行控制,例如在这个系统中可以扩展两块74LS138芯片,把A15(P2.7)接第一块74LS138的G1端,把A14(P2.6)接第二块74LS138的G1端,这样一共就有16个输出端(8×2),作为练习,可以自己写出这16个输出端所对应的地址段。
需要说明的是,如果实际的系统中并不需要扩展很多芯片,那么就没有必要把所有的码都译出来——重叠就重叠吧。
3、2、工作原理及硬件框图3、2、1、单片机系统的工作原理单片机的40个引脚大致可分为4类:电源、时钟、控制和I/O引脚。
⒈电源: ⑴ VCC - 芯片电源,接+5V;⑵ VSS - 接地端;⒉时钟:XTAL1、XTAL2 - 晶体振荡电路反相输入端和输出端。
⒊控制线:控制线共有4根,⑴ ALE/PROG:地址锁存允许/片内EPROM编程脉冲① ALE功能:用来锁存P0口送出的低8位地址② PROG功能:片内有EPROM的芯片,在EPROM编程期间,此引脚输入编程脉冲。
⑵ PSEN:外ROM读选通信号。
⑶ RST/VPD:复位/备用电源。
① RST(Reset)功能:复位信号输入端。
② VPD功能:在Vcc掉电情况下,接备用电源。
⑷ EA/Vpp:内外ROM选择/片内EPROM编程电源。
① EA功能:内外ROM选择端。
② Vpp功能:片内有EPROM的芯片,在EPROM编程期间,施加编程电源Vpp。
⒋ I/O线80C51共有4个8位并行I/O端口:P0、P1、P2、P3口,共32个引脚。
P3口还具有第二功能,用于特殊信号输入输出和控制信号(属控制总线)。
51单片机引脚图及引脚功能3、2、2、6264芯片引脚和内部结构6264是一种8K×8的静态存储器,其内部组成如图(a)所示,主要包括512×128的存储器矩阵、行/列地址译码器以及数据输入输出控制逻辑电路。
地址线13位,其中A12~A3用于行地址译码,A2~A0和A10用于列地址译码。
在存储器读周期,选中单元的8位数据经列I/O控制电路输出;在存储器写周期,外部8位数据经输入数据控制电路和列I/O控制电路,写入到所选中的单元中。
6264有28个引脚,如图(b)所示,采用双列直插式结构,使用单一+5 V电源。
其引脚功能如下:6264的内部结构图及引脚图6264芯片1、6264的特性及引脚信号6264的容量为8KB,是28引脚双列直插式芯片,采用CMOS工艺制造A12~A0(address inputs):地址线,可寻址8KB的存储空间。