数电-第三章_逻辑门电路

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数电习题解答_杨志忠_第三章练习题_部分

教材：数字电子技术基础（“十五”国家级规划教材）杨志忠卫桦林郭顺华编著高等教育出版社2009年7月第2版； 2010年1月北京第2次印刷；第三章集成逻辑门电路练习题P112【题3.1】在图P3.1所示的电路中，发光二极管正常发光的电流范围是8mA ≤I D ≤12mA ，正向压降为2V ，TTL 与非门输出高电平U OH =3V ，输出高电平电流I OH =-300uA ，输出低电平U OL =0.3V ，输出低电平电流I OL =20mA 。

分别求出图P3.1（a ）和（b ）中电阻RL1和RL2的取值范围。

解题思路：选择限流电阻R 的原则是既保证发光二极管正常工作又要保证门的输出电流不超载。

解：（a ）、电路采用输出低电平驱动发光管；此时流过发光管的电流1CC D OL D L V V V I R −−=；根据发光管的工作条件：8mA ≤I D ≤12mA （最大电流小于门的最大输出电流I OL =20mA ），所以可以得到：1225337.5L R Ω≤≤Ω，门电路输出高电平时发光管熄灭电流为零。

（b ）、电路采用输出高电平驱动发光管；此时流过发光管的电流2CC D D OH L V V I I R −=+；根据发光管的工作条件：8mA ≤I D ≤12mA ，所以可以得到：2256.4389.6L R Ω≤≤Ω，同时门电路输出低电平时，门的最大灌入电流要小于I OL =20mA ，由此得到2 4.723520CC OL L OL V V V R I mA−≥==Ω，所以综上所述限流电阻应该为：2256.4389.6L R Ω≤≤Ω。

【3.2】、在图P3.2（a ）~（g ）所示的TTL 门电路中，已知开门电阻R ON =3K Ω，关门电阻R OFF =0.8K 。

试判断哪些门电路能正常工作？哪些门电路不能正常工作？并且写出能正常工作电路的输出逻辑函数表达式。

解题思路：了解各类门电路的逻辑功能，明白TTL 门的开门电阻R ON ≥3K Ω时相当于在输入端得到高电平“1”，关门电阻R OFF ≤0.8K Ω时相当于在输入端得到低电平“0”。

数电第五版(阎石)第三章课后习题及答案

第三章门电路解：两种情况下的电压波形图如图A3.4所示。

【题3.7】试分析图3.7中各电路图的逻辑功能，写出输出的逻辑函数式。

（a ）图P3.7（a ）电路可划分为四个反相器电路和一个三输入端的与非门电路，如图所示。

从输入到输出逐级写出输出的逻辑函数式，'111'1'1'1)(,,,C B A D C C B B A A ''''111')(C B A C B A C B A D Y（b ）图P3.7（b ）电路可划分为五个反相器电路和一个或非门电路，如图所示。

从输入到输出逐级写出输出的逻辑函数式：'111''''()()YA B C A B C ABC（c ）图P3.7（c ）电路可划分为三个与非门电路、两个反相器电路和一个或非门电路，如图所示。

从输入到输出逐级写出输出的逻辑函数式：''')(,)(,)'(,)(G INHH EF G CD F AB E '''''()()'()'()()Y I H AB CD INH AB CD INH（d）图P3.7（d）电路可划分为两个反相器电路和两个传输门电路，如图所示。

从输入到输出逐级写出输出的逻辑函数式：'YBAAB'【题3.8】试画出图3-8（a）（b）两个电路的输出电压波形，输入电压波形如图（c）所示。

输出电压波形如右图所示：【题3.9】在图3-21所示电路中，G 1和G 2是两个OD 输出结构的与非门74HC03，74HC03输出端MOS 管截止电流为导通时允许的最大负载电流为这时对应的输出电压V OL （max ）=0.33V 。

负载门G 3-G 5是3输入端或非门74HC27，每个输入端的高电平输入电流最大值为，低电平输入电流最大值为，试求在、、、、并且满足，的情况下，的取值的允许范围。

数电课后标准答案康华光第五版（完整）

数电课后标准答案康华光第五版（完整）第⼀章数字逻辑习题1．1数字电路与数字信号1.1.2 图形代表的⼆进制数0101101001．1．4⼀周期性数字波形如图题所⽰，试计算：（1）周期；（2）频率；（3）占空⽐例MSB LSB0 1 2 11 12 （ms）解：因为图题所⽰为周期性数字波，所以两个相邻的上升沿之间持续的时间为周期，T=10ms 频率为周期的倒数，f=1/T=1/0.01s=100HZ占空⽐为⾼电平脉冲宽度与周期的百分⽐，q=1ms/10ms*100%=10%1.2数制2 1.2.2将下列⼗进制数转换为⼆进制数，⼋进制数和⼗六进制数（要求转换误差不⼤于4（2）127 （4）2.718解：（2）（127）D=72-1=（10000000）B-1=（1111111）B=（177）O=（7F）H（4）（2.718）D=(10.1011)B=(2.54)O=(2.B)H1.4⼆进制代码1.4.1将下列⼗进制数转换为8421BCD码：（1）43 （3）254.25解：（43）D=（01000011）BCD1.4.3试⽤⼗六进制写书下列字符繁荣ASCⅡ码的表⽰：P28（1）+ （2）@ （3）you (4)43解：⾸先查出每个字符所对应的⼆进制表⽰的ASCⅡ码，然后将⼆进制码转换为⼗六进制数表⽰。

（1）“+”的ASCⅡ码为0101011，则（00101011）B=（2B）H（2）@的ASCⅡ码为1000000,(01000000)B=(40)H(3)you的ASCⅡ码为本1111001,1101111,1110101,对应的⼗六进制数分别为79,6F,75(4)43的ASCⅡ码为0110100,0110011,对应的⼗六紧张数分别为34,331.6逻辑函数及其表⽰⽅法1.6.1在图题1. 6.1中，已知输⼊信号A，B`的波形，画出各门电路输出L的波形。

解: (a)为与⾮， (b)为同或⾮，即异或第⼆章逻辑代数习题解答2.1.1 ⽤真值表证明下列恒等式 (3)A B AB AB ⊕=+（A ⊕B ）=AB+AB 解：真值表如下A B A B ⊕ABAB A B ⊕AB +AB0 0 0 1 0 1 1 0 1 1 0 0 0 0 1 0 1 0 0 0 0 11111由最右边2栏可知，A B ⊕与AB +AB 的真值表完全相同。

数电第三章讲解

TP管和TN管同时导通。在电源VDD和地之间建立
起低阻通道，形成较大的脉冲电流。不仅增加了CMOS电路的功耗，而且也成为CMOS 电路的内部干扰源。
22
3. CMOS反相器的输入特性
由于信号从栅极输入，输入电阻很大，又有一个小的寄生电容，如果输入端没有保护电路，输入端可能被静电感应充电至高压，造成绝缘栅击穿，使器件永久损坏。为避免造成栅极击穿，实际的CMOS集成电路的每一个输入端都设有输入保
第3章集成逻辑门电路
3.1 概述
逻辑门电路(门电路): 用来实现基本逻辑关系的电子电路集成逻辑门电路: 将若干个逻辑门电路集成在一块半导体材料基片上
1
集成逻辑门电路有两种类型器件：
（1）由三极管组成的双极型集成电路
例如：晶体管-晶体管逻辑电路（简称TTL：Transistor-Transistor Logic）
和增强型NMOS驱动管（TN）串联组成
11
TP的开启电压VGS(th)P < 0 TN的开启电压VGS(th)N > 0 电路正常工作的条件： VDD >∣VGS(th)P∣+ VGS(th)N，
且VGS(th)N =∣VGS(th)P∣， TN和TP具有相同的导通电阻
Ron和截止电阻Roff。
12
2．工作原理
当输入为低电平时： TN的VGSN = 0 v < VGS(th)N 管子截止。 TP的∣VGSP ∣= VDD 管子导通，输出为高电平VOH vO =VOH≈VDD
13
当输入为高电平VDD时
TN的VGSN = VDD >VGS(th)N，管子导通。 TP的VGSP = 0 v > VGS(th)P 负载管截止。输出为低电平VOL， vO =VOL≈0 v。

数电第三章门电路

15
§3.4 TTL门电路
数字集成电路：在一块半导体基片上制作出一个完整的逻辑电路所需要的全部元件和连线。使用时接：电源、输入和输出。数字集成电路具有体积小、可靠性高、速度快、而且价格便宜的特点。
TTL型电路：输入和输出端结构都采用了半导体晶体管，称之为: Transistor— Transistor Logic。
输出高电平
UOH (3.4V)
u0(V)
UOH
“1”
输出低电平
u0(V)
UOL
UOL (0.3V)
1
(0.3V)
2 3 ui(V)
1 2 3 ui(V)
阈值UT=1.4V
传输特性曲线
理想的传输特性 28
1、输出高电平UOH、输出低电平UOL UOH2.4V UOL 0.4V 便认为合格。典型值UOH=3.4V UOL 0.3V 。
uA t
uF
截止区： UBE< 死区电压， IB=0 ， IC=ICEO 0 ——C、 E间相当于开关断开。
+ucc
t
4
0.3V
3.2.3MOS管的开关特恒流区：UGS>>Uth ， UDS
性： +VDD
0V ——D、S间相当于开关闭合。
R
uI
Uo
Ui
NMO S
uO
夹断区： UGS< Uth， ID=0 ——D、S间相当于开关断开。
3.3.4 其它门电路
一、其它门电路
其它门电路有与非门、或非门、同或门、异或门等等,比如：
二、门电路的“封锁”和“打开”问题
A B
&
Y
C
当C=1时，Y=AB.1=AB

数字电子技术基础第三章逻辑门电路

ts 的大小是影响三极管速度的最主要因素，要提高三极管的开关速度就要设法缩短ton与toff ，特别是要缩短ts 。
数字电子技术基础第三章逻辑门电路
第一节常见元器件的开关特性
3.MOS管的开关特性
A、MOS管静态开关特性
在数字电路中，MOS管也是作为开关元件使用，一般采用增强型的 MOS管组成开关电路，并由栅源电压 uGS控制MOS管的导通和截止。
时间。
toff = ts +tf 关断时间toff：从输入信号负跃变的瞬间，到iC 下降到 0.1ICmax所经历的时间。
数字电子技术基础第三章逻辑门电路
第一节常见元器件的开关特性
2.三极管的开关特性
B、晶体三极管动态开关特性
ton和toff一般约在几十纳秒（ns=10-9 s）范围。通常都
有toff > ton，而且ts > tf 。
0 .3V 3 .6V 3 .6V
1V 5V
3 .6V
数字电子技术基础第三章逻辑门电路
第三节 TTL和CMOS集成逻辑门电路
1.TTL集成逻辑门电路
3 .6V 3 .6V 3 .6V
2.1V
0 .3V
数字电子技术基础第三章逻辑门电路
第三节 TTL和CMOS集成逻辑门电路
1.TTL集成逻辑门电路
数字电子技术基础第三章逻辑门电路
❖ 2.教学重点：不同元器件的静态开关特性，分立元件门电路和组合门电路，TTL和CMOS集成逻辑门电路基本功能和电气特性。
❖ 3.教学难点：组合逻辑门电路、TTL和CMOS集成逻辑门4.课时安排：第一节常见元器件的开关特性第二节基本逻辑门电路第三节 TTL和CMOS集成逻辑门电路

数电-带答案

第一章逻辑代数基础例题1.与(10000111)BCD 相等的十进制数是87，二进制数是1010111 十六进制数是57，2.AB+CD=0（约束项）求的最简与或表达式。

解：D C A C B A Z +=，见图1-1，得3.若F(A,B,C,D)=∑m(0,1,2,3,4,7,15）的函数可化简为：则可能存在的约束项为（ 3 ）。

见图1-21．逻辑函数式Y A B C D =++（）的反演式为 D C B A + 2. 在下列不同进制的数中，数值最大的数是（ D ）1051A.（） .101010B 2（） 163E C.（） D.（01011001）8421BCD 码 3、用卡诺图化简下式为最简与或式。

D C B A ++ Y(A,B,C,D)= ∑m(0,2,4,5,6,8,9)+ ∑d(10,11,12,13,14,15) 4.已知F ABC CD =+选出下列可以肯定使F=0的情况（ D )A. A=0，BC=1B. B=C=1C. D=0，C=1D. BC=1，D=1 5、是8421BCD 码的是（ B ）。

A 、1010 B C 、1100 D 、11016、欲对全班43个学生以二进制代码编码表示，最少需要二进制码的位数是（ B ）。

A 、5B 、6C 、8D 、437、逻辑函数F(A,B,C) = AB+B C+C A 的最小项标准式为（ D ）。

A 、F(A,B,C)=∑m(0,2,4)B 、F(A,B,C)=∑m(1,5,6,7)C 、F(A,B,C)=∑m (0,2,3,4)D 、F(A,B,C)=∑m(3,4,6,7)Z A BC A B AC D =++Z Z AC AC =+()B C D C D ++1..2..3..4..AC A DA C AB A D A B A B B C++++8、用代数法化简下式为最简与或式。

A+CC B BC C B A BCD A A F ++++=判断题1.若两个函数具有不同的真值表，则两个逻辑函数必然不相等。

数电逻辑门电路

数电逻辑门电路逻辑门电路是数字电路中常见的一种电路结构，用于处理不同的逻辑运算和控制信号。

逻辑门电路通常由不同类型的逻辑门组成，如与门、或门、非门、异或门等。

在这篇文章中，我们将介绍几种常见的逻辑门电路以及它们的应用。

1. 与门电路与门电路是最基本的逻辑门之一，其功能是将两个输入信号进行逻辑与运算，输出结果为如果两个输入信号同时为高电平时输出高电平，否则输出低电平。

与门电路通常用于逻辑运算和控制信号的处理，比如电脑中的逻辑电路、开关控制等。

2. 或门电路或门电路是另一种常见的逻辑门，其功能是将两个输入信号进行逻辑或运算，输出结果为如果任一输入信号为高电平时输出高电平，否则输出低电平。

或门电路也广泛应用于逻辑运算和控制信号处理中，例如电脑中的逻辑电路、开关控制等。

3. 非门电路非门电路是一种单输入单输出的逻辑门，其功能是将输入信号取反输出，即如果输入信号为高电平则输出低电平，如果输入信号为低电平则输出高电平。

非门电路通常用于信号反转、逻辑反相等应用。

4. 异或门电路异或门电路是一种常见的逻辑门，其功能是将两个输入信号进行逻辑异或运算，输出结果为如果两个输入信号不相同则输出高电平，否则输出低电平。

异或门电路在数字电路设计中经常被使用，例如数据的误码检测、加法器电路等。

以上是几种常见的逻辑门电路，下面我们将介绍一个简单的逻辑门电路示例：4位全加器电路。

4位全加器电路是由4个异或门、3个与门和1个或门组成的逻辑电路，用于实现4位二进制数的加法运算。

该电路的原理是将两个4位二进制数相加，得到和输出以及进位输出。

当输入信号为A3-A0、B3-B0时，输出信号为S3-S0代表和值，C代表进位位。

在4位全加器电路中，每个异或门接收两个输入信号A和B，输出一个异或运算结果；每个与门接收三个输入信号A、B和C_in，输出一个与运算结果；一个或门接收四个输入信号S0-S3，输出一个或运算结果。

将这些逻辑门按照接线图正确连接，就可以实现全加器电路的功能。

数电课件ch031逻辑门电路

TP1 A B
TN1 TP1 TN2 TP2
L
TP2
L
00 01
截止导通截止导通 1 截止导通导通截止 0
TN1
TN2
10
导通截止截止导通 0
11
导通截止导通截止 0
N输入的或非门的电路的结构? 输入端增加有什么问题?
或非门
A ≥1
B
L A B
3. 异或门电路
A B
=A⊙B
3、学会门电路逻辑功能分析方法。 4、掌握逻辑门的主要参数及在应用中的接口问题。
3.1 MOS逻辑门
3.1.1 数字集成电路简介 3.1.2 逻辑门的一般特性 3.1.3 MOS开关及其等效电路 3.1.4 CMOS反相器 3.1.5 CMOS逻辑门电路 3.1.6 CMOS漏极开路门和三态输出门电路 3.1.7 CMOS传输门 3.1.8 CMOS逻辑门电路的技术参数
L A B A B
3.1.6 CMOS漏极开路（OD）门和三态输出门电路
1.CMOS漏极开路门
（1）CMOS漏极开路门的提出 A
输出短接，在一定情况下会产 B 生低阻通路，大电流有可能导
+VDD
+VDD
A
线
与
B
1
0
致器件的损毁，并且无法确定
TN1 TN2
输出是高电平还是低电平。
（2）漏极开路门的结构与逻辑符号
74系列
74LS系列
74AS系列
74ALS
3.射极耦合逻辑门（ECL）
3.1.2 逻辑门电路的一般特性
1. 输入和输出的高、低电平
1 vO
vI 1
驱动门 G1

数电-第三章逻辑门电路

典型时序逻辑电路
了解和掌握常见时序逻辑电路的原理和应用，如寄存器、计数器、顺序脉冲发生器等。
可编程逻辑器件应用
1 2
可编程逻辑器件简介
了解可编程逻辑器件的基本概念和分类，如PAL、 GAL、CPLD、FPGA等。
可编程逻辑器件编程
学习使用相应的开发工具和编程语言，对可编程逻辑器件进行编程和配置，实现特定的逻辑功能。
典型组合逻辑电路
了解和掌握常见组合逻辑电路的原理和应用，如编码器、译码器、
数据选择器、比较器等。
时序逻辑电路分析与设计
时序逻辑电路分析
分析时序逻辑电路的工作原理，包括触发器的状态转换、时钟信号的作用等，进而理解电路的功能。
时序逻辑电路设计
根据实际需求，设计实现特定功能的时序逻辑电路。包括确定输入、输出变量，选择适当的触发器类型，画出状态转换图或时序图等步骤。
数电-第三章逻辑门电路
• 逻辑门电路基本概念 • 基本逻辑门电路 • 复合逻辑门电路 • 逻辑门电路应用 • 逻辑门电路实验与仿真 • 逻辑门电路总结与展望
目录
Part
01
逻辑门电路基本概念
逻辑门定义与分类
逻辑门定义
逻辑门是数字电路中的基本单元，用于实现基本的逻辑运算功能，如与、或、非等。
逻辑符号为带有小圆圈的与门符号。
或非门电路
01
02
03
或非门逻辑功能
实现输入信号的逻辑或操作，并取反输出结果。
或非门符号
逻辑符号为带有小圆圈的或门符号。
或非门真值表
输入全为0时，输出为1；输入有1时，输出为0。
异或门电路
异或门逻辑功能
实现输入信号的异或操作，即输入信号相同时输出为0，不同时输出为1。

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3.1 MOS逻辑门电路 ②、工作原理
VA、VB中只要有一个为低电平，T2 和T4中就总有一个导通是截止，而T1和T3 中总有一个导通，所以VY一定为高电 n个输入端的与非门需要n个 v =1 O=0 NMOS管串联和n个PMOS管并平。只有当VA和 vA=0 =1 联。导通VB同时为高电平时， VY才为低电平。 • D、CMOS逻辑门电路 • 1、与非门电路断开 ①、电路组成
3.1 MOS逻辑门电路
• C、COMS反相器 MOS管有NMOS管和PMOS管两种。当NMOS 管和PMOS管成对出现在电路中，且二者在工作中互补，称为CMOS管(意为互补)。MOS管有增强型和耗尽型两种。在数字电路中，多采用增强型。为了电路能正常工作,要求电源电压VDD大于两只MOS管的开启电压的绝对值之和。即VDD﹥VTN+ ︳VTP ︳
3.1 MOS逻辑门电路
• 1、工作原理当vi处于逻辑0时 vGSN=0V，TN截止； VDD
vGSP=vi－ＶDD=－VDD
TP导通，vO=VDD
vI
TP
TN
vO
导通
截止
3.1 MOS逻辑门电路
• 当vi处于逻辑1时 vGSN=vi ﹥VTN，TN导通
vGSP=vi－VDD=0V
TP截止，vo=0V
IOH
P
IIH VOH
VIL
VDD VOH Rp R p (max) nI OH mI IH
m个
n是并联OD门的数目， m是负载门电路高电平输入电流的数目。
VIL
n个
VIL
3.1 MOS逻辑门电路
VDD IOL VIH
RL IIL VOL
m′是负载门电路低电平输入电流的数目。在负载门为CMOS门电路的情况下， m和m′相等。
3.1 MOS逻辑门电路
• 2、噪声容限噪声容限表示门电路的抗干扰能力。通常将最大噪声幅度称为噪声容限。电路的噪声容限愈大，其抗干扰能力愈强。输入高电平的噪声容限：
VNH=VOH(min) －VIH(min) 输入低电平的噪声容限:
VNL=VIL（max）－VOL（max）噪声容限VNH和VNL的数值越大，抗干扰能力越强。
3.1 MOS逻辑门电路
• 6、扇入数与扇出数 I、扇入数门电路的扇入数取决于它的输入端的个数。一个四输入的与非门其扇入数Ni=4。 II、扇出数门电路的扇出数是指其在正常工作情况下，所能带同类门电路的最大数目。 i、拉电流工作情况此时驱动门输出高电平，负载电流从驱动门流向外电路。 IOH（驱动门）
第三章逻辑门电路
本章内容要求：
1、了解逻辑门电路的一般特性。
2、了解MOS管和BJT管的开关特性。 3、了解CMOS和TTL门电路的组成和工作原理。
4、掌握典型CMOS和TTL门的逻辑功能、特性、主要参数和使用方法。
3.1 MOS逻辑门电路
• A、逻辑电路的一般特性逻辑器件的数据手册一般提供门电路的电压传输特性、输入和输出高、低电压、噪声容限、传输延迟时间和功耗等技术参数。 1、输入和输出的高、低电平数字电路中的高、低电压常用高、低电平描述。在正逻辑体制中，用逻辑1和0分别表示高、低电平。不同系列的集成电路，输入与输出的对应电压范围是不同的。
5 0.3 mA 50 1 0.094mA
①u i =1V时，三极管导通，基极电流：
u i u BE 1 0.7 iB mA 0.03mA Rb 10
uo=uCE=VCC-iCRc=5-0.03×50×1=3.5V 此时，BJT处于放大状态
D接正电源
截止
导通
3.1 MOS逻辑门电路
• ②、结论：当输入为低电平时，MOS管截止，相当于开关‚断开‛，输出高电平，等效为开关断开。当输入为高电平时，MOS管工作在可变电阻区，相当于开关‚闭合‛，输出为低电平，等效为开关闭合。 2、MOS管的开关特性在MOS管的开关电路的输入端，加一个脉冲波，由于MOS管中栅极与衬底电容、漏极与衬底间电容、栅极与漏极电容以及导通电阻等的存在，使其在导通和闭合两种状态之间转换时受到电容充放电过程的影响，输出波形产生延时。
VDD
vI
TP
TN
vO
截止导通
• 综上所述：当vi为低电平时vo为高电平，vi为高电平时vo为低电平，电路实现了非逻辑运算，是一个非门。
2、传输特性包括电压和电流传输特性。把输入电压为 CMOS反相器 1/2VDD称为转在使用时应尽折电压或阈值量避免长期工电压。此时电作在BC段。流最大。
N OH IIH （负载门）
3.1 MOS逻辑门电路
• ii、灌电流工作情况此时驱动门输出低电平，负载电流流入驱动门。
N OL IOL（驱动门） IIL （负载门）
扇出数NO为二者中的较小者。
3.1 MOS逻辑门电路
• B、MOS开关及其等效电路 • Vgs﹤VT → Rds 106 () → I 10-6 (A) 0 1、MOS管的开关作用 •Vgs VT → Rds 10 () ①、NMOS的开关作用 << RL →vds 0
3.1 MOS逻辑门电路
1、PT=CPDV2DD f（瞬时导通功耗）式中：CPD—功耗电容；VDD—供电电源；f—输出信号的转换频率。原因：由于电路输出状态转换的瞬间，其等效电阻比较小，使有较大的电流从电源经CMOS电路流入地。 2、PL=CLV2DD f（平均功耗）式中CL—负载电容。原因：由于CMOS管的负载通常是电容性，当输出由高电平到低电平，或者由低电平到高电平转换时，会对电容进行充、放电，此时会增加损耗。
TP导通TN截止 TPTN同时导通
3.1 MOS逻辑门电路
TN导通TP截止
阈值电压VT
3.1 MOS逻辑门电路
• 3、工作速度 CMOS反相器在电容负载情况下，它的开通时间与关闭时间是相等的，主要是由于电路的互补对称决定的。 VDD
vI TN
TP
C
vO
当vi=0V时，TN截止，TP导通，由VDD通过TP向负载电容充电，由于CMOS反相器中，两管gm 值大，其导通电阻小，充电回路的时间常数小。CMOS反相器的平均传输延迟时间约为 10ns。
3.1 MOS逻辑门电路
• 当C=1（+5V），C’=0时，vi在0~3V范围内， TN导通，vi在2~5V的范围内TP导通，所以在 0~5V范围内TN和TP至少有一个导通，即传输门导通，vo=vi。
3.2 TTL逻辑门电路
• A、BJT的开关特性 • 1、BJT的开关作用
C
基极
集电极 C B E
3.1 MOS逻辑门电路
• 有时也用平均传输延迟时间tpd表示一个门电路的延 t pHL t pLH 迟时间。 t pd 4、功耗 2 功耗是指门电路工作时自身消耗的功率。它分为：静态功耗和动态功耗。静态功耗：指当电路的输出没有状态转换时的功耗。（CMOS电路的静态功耗非常低，在很多低功耗的场合采用CMOS集成电路。）动态功耗：指当电路在输出发生状态转换时的功耗。它由两个部分组成： 1、PT=CPDV2DDf
3.1 MOS逻辑门电路
• 74HC系列CMOS逻辑电路：工作电压：5V时，输入电压：3.5～5.0V对应高电平逻辑1， 0～1.5V对应低电平逻辑0。输出端带CMOS负载时，输出电压：4.9～5V对应高电平逻辑1 0～0.1V对应低电平逻辑0 输出端带TTL负载时，输出电压：3.84～5V对应高电平逻辑1 0～0.33V对应低电平逻辑0
1
A B C D
Y
Y ( AB) (CD)
0
产生一个很大的电流
3.1 MOS逻辑门电路
• 所谓漏极开路指：CMOS门输出电路只有NMOS 管，并且它的漏极是开路的。
A B Y
OD输出与非门逻辑符号与逻辑表达式
Y AB
VDD RL
A 为了实现线与的逻辑功能， Y Y1 Y2 ( AB ) (CD)B 可将多个门电路输出管的 ( AB CD) 漏极和电源VDD之间，加 C 一公共的上拉电阻。 D
3.1 MOS逻辑门电路
注意：当CMOS传输门用于模拟电路时，TN和TP的衬底分别接－5V和+5V，输入信号的变化范围为－5V~+5V。当CMOS传输门用于数字电路时，TN和TP的衬底分别接0V和+5V，输入信号的变化范围为0~+5V。 2、工作原理：
当C=0，C‘=1（+5V）时，输入信号vi的取值在0~+5V范围内， TN和TP同时截止，输入和输出之间呈高阻态，传输门断开。
断开
Y A+B
3.1 MOS逻辑门电路
• 3、异或门电路电路组成工作原理请同学们自行分析。
Y AB
或非门
与非门
3.1 MOS逻辑门电路
• E、CMOS漏极开路门和三态输出门电路 1、CMOS漏极开路门电路（OD门）在工程实践中，需要将两个门的输出端并联来实现与逻辑的功能称为线与。普通与非门输出不能直接在一起来实现线与！
3.1 MOS逻辑门电路
• 3、传输延迟时间传输延迟时间是表征门电路开关速度的参数，它说明门电路在输入脉冲波形的作用下，其输出波形相对于输入波形延迟了多长时间。
将输入电压波形上升沿的中点与输出波形下降沿的中点之间的延迟时间定义为输出由高电压到低电平的延迟时间，用tpHL 表示。将输入电压波形下降沿的中点与输出波形上升沿的中点之间的延迟时间，定义为输出由低电平到高电平的延迟时间，用 tpLH表示。
(VDD VOL ) / Rp m I IL I OL (max)