高速突发模式误码测试仪的FPGA实现方案

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t c in i o uc e e to sc nd t d;m or o er urn rorbisde e ton,t e r c ie u tfle he p e b ea e i ie nd ge se r t t ts e v ,d ig e r t t ci h e ev rm s it rt r am l nd d lm t ra t rorbis sa i—
pr c i a l . a tc lva ue
Ke o d y w r s: b s — o om m u c ton BER e t r; l c xta t Ro ke l GTP r ns eve ur tm de c nia i s; t s e co k e r c ; c t O ta c i r

种 基 于 F GA 实现 的 高速 突发 模 式 误 码 测 试 仪 设 计 方 案 , 介 绍 该 方 案 的 总 体 设 计 过 程 , 及 F GA 中主 要 功 能 逻 P 并 以 P
辑模 块 的 工 作 原理 和控 制 系统 的 设 计 。 该 测 试 仪 应 用 于 1 2 . 5 GHzGP ON 系统 突发 式 光 接 收 模 块 的误 码 测 试 中 , 有 具
S n Le u u  ̄ n,Hu C h i i u ,Ma C a ho
( ho lofI f m a i Sc o n or ton Eng n e i g,W u n U ni r iy ofTe hnoog i e rn ha ve st c l y,W u n 63 70,Chi ) ha 00 na Ab tac :Beng dif r ntfom e r lc ntnu ld t te m sr t i fe e r g ne a o i a — a a s r a BER e t r t e e ev r o r tm o t s e , h r c ie f bu s — de BER e t r i e uie o e t a t t s e s r q r d t x r c
的 作 用 是 , 确 地判 断 被 测 的 oI 突 发 接 收 模 块 的完 成 准 T
引 言
无 源 光 网络 P ON 以 其 独 特 的 优 势 在 网络 中 已经 规 模 化 地 应 用 。 由 于 GP ) 系 统 在 现 有 P (N ON 系 统 中带 宽 利
幅值 恢 复 响 应 时 间 和 其 可 靠 性 。
tc o y f yoa . I h spa e i nl orpa l d n t i p r,a de i e ho o sgn m t d f rbur tm o e BER e t r b s d o FPGA s p o wa d. T hew h e s r c ur f s— d t s e a e n i utf r r ol t u t e o t e i s i r uc d ,a d t o cf c i o l si he d sgn i ntod e n hel gi un ton m du e n FPGA nd t y t m o r o a a e pr s nt d. The ts q pme s a he s s e c ntolpr gr m r e e e e te ui nti a le o b s — o ptc r c i e n .2 G H z GPON y t m ,a he e pe i e a e uls s ow ha t ha o ror a e a d pp id t ur tm de o i e ev ri 1 5 s se nd t x rm nt lr s t h t ti s g od pe f m nc n
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速 突 发 模 式 误 码 测 试 仪 的 F GA 实 现 方 案 P
孙 磊 君 , 次 惠 , 超 胡 马
( 汉理T大学 信息工程学院 , 汉 607) 武 武 3 0 0
摘 要 :突发 模 式 误 码 测 试 仪 与 一 般 连 续误 码 测试 仪 不 同 , 接 收 端 在 误 码 比对 前 要 实现 在 十 几 位 内 , 具 有 相 位 跳 变特 其 对 点 的 信 号进 行 时钟 提 取 和 数 据 恢 复 , 且 在误 码 比对 时 须 滤 除 前 导 码 和 定 界 符 , 对 有 效 数 据 进 行 误 码 统 计 。 本 文 提 出 并 仅
较 好 的性 能 和 实 际 意 义 。
关 键 词 :突 发 模 式 ;误 码 测 试 仪 ;时 钟 相 位 对 齐 ;高 速 串 行 收 发 器 中 图分 类号 : TN2 文 献 标 识 码 :A
Hi - p d Bu s - o e BER Te t s d o gh s ee r tm d s erBa e n FPGA
coc nd r c e t c ur t l r m h nc m i t t am ha a t rz d by ph s a i in w ihi z n bisa e y fo t e i o ng da a s e c r c e ie a e v rato t n ado e t e o e e r r bt e