74系列芯片引脚图

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类别 电路简称 四位比较器 74LS85
A3 B3
数据输入 A2 B2 A1 B1
真值表 A0 B0
级联输入
输出
A>B A<B A=B A>B A<B A=B
A3>B3 A3<B3 A3=B3 A3=B3 A3=B3 A3=B3 A3=B3 A3=B3 A3=B3 A3=B3 A3=B3 A3=B3 A3=B3
GND 8
7744LLSS17124
16 Vcc 15 1CLR 14 2CLR 13 2CK 12 2K 11 2J 10 2PR 9 2Q
(a) JK 触发器 74112 引脚图
Y0 1
Y1 2
Y2 3 Y3 4 Y4 5 Y5 6 Y6 7 GND 8
7474LLSS7442
16 Vcc
15 A0 14 A1
13 A2 12 A3 11 Y9 10 Y8 9 Y7
图 3.2 74LS42 引脚图
74LS04
B1
C2
LT 3 BI/RBO 4
RBI 5 D6 A7
GND 8
747L4LSS7448
16 Vcc 15 f 14 g
13 a 12 b 11 c 10 d 9e
图 3.3 74LS48 引脚图
常用 74 系列 TTL 集成电路
真值表
时钟 CP J K
X
XX
X
XX

00

10

01

11
输出 清零(Q=0) 置 1(Q=1) 保持(Q=Qn)
Q=1 Q=0 翻转(Q=/Q)
电路引脚图
类别
电路简 称
正沿触发 双 D 触发

74LS74
预置 SD 1 0 1 1 1
清零 RD
0 1 1 1 1
真值表
时钟 D
CP
X
X
X
X

1

0
D2
择器
0
000
D5
0
1 01
D6
0
1 10
D7
0
1 11
类别
电路简称
符号说明
电路引脚图
二位 全 加 74LS82 器
NC 空脚 A2 A1 被加数 B2 B1 加数 S2 S1 全加和 C1 进位入 C0 进位出
四位 全 加 74LS83 器
A4A3 A2A1 被加数 B4B3 B2B1 加数 S4S3 S2S1 全加和 C1 进位入 C0 进位出
类别
电路简称
非门 74LS04
与门
74LS08
逻辑表达式
电路引脚图
74LS11
或门
74LS32
与非门
74LS00
与非门
74LS10
类别
正沿 触发 4D 触 发器
电路简称 74LS175
清零 RD
真值表
时钟 D
CP
输出
电路引脚图
类别
4 位二进制 同步计数器 (正沿触发)
0
Х
Х
清零(Q=0)
1

1
Q=1
类别
电路简称
双 2-4 译 74LS139 码器
真值表
门 控 输入
G
BA
1
XX
0
00
0
01
0
10
0
11
输出 Y3 Y2 Y1 Y0 1111 1110 1101 1011 0111
电路引脚图
类 电路简称 别 3 | 8 译码 器
74LS138
真值表
门控 G2A+G2B
输入 CBA
G1 X1 0X 10 10 10 10 10 10 10 10
1G 1
B2
1C3 3 1C2 4 1C1 5 1C0 6 1Y 7 GND 8
7744LLSS71543
16 Vcc 15 2G 14 A 13 2C3 12 2C2 11 2C1 10 2C0 9 2Y
图 3.5 74LS153 引脚图
D3 1
D2 2
D1 3 D0 4 Y5 W6 G7 GND 8
引脚和使用方法同 74LS161
类别
电路简称
真值表
输入
输出
RD CP A B
QA~QB
8 位串入并出
X XX
74LS164 0
移位寄存器
0 XX
1
↑ 11
1
↑ 0X
1
X0
清零 保持 右移,移入 1 左移,移入 0
电路引脚图
类别 电路简称 真值表
电路引脚图
8-3 编 74LS148 码器
级 联 输入 入
74LS00 2 输入端四与非门
74LS04 六反相器
74LS08 2 输入端四与门
74LS11 3 输入端 3 与门
74LS161 四位二进制同步计数器
74LS148 8-3 编码器
74LS151 8 选 1 数据选择器
74LS139 双 2-4 译码器
74LS138 3-8 译码器
74LS74 正沿触发双 D 触发器
0
X
输出
电路引脚图
清零(Q=0) 置 1(Q=1) 保持(Q=Qn)
类别
电路简称
逻辑表达式
电路引脚图
与非门 74LS20 Y=
或非门
74LS02
74LS27 Y=
异或门
74LS86
Y=A⊕B
与或非门
74LS51
D3 8 OE 9 CLOCK 10 Vcc 11 VREF+ 12 GND 13 D1 14
ADC 0809
28 IN2
27 IN1 26 IN0 25 ADDA
24 ADDB 23 ADDC 22 ALE 21 D7 20 D6 19 D5 18 D4 17 D0 16 VREF15 D2
ADC0809 数转换器
图 3-3 集成块管脚排列图 图 2-1 集成块引脚排列图
图 7-1 集成块引脚排列图
1G 1
1A 2
1B 3 1Y0 4 1Y1 5 1Y2 6 1Y3 7 GND 8
7744LLSS71349
16 Vcc 15 2G 14 2A 13 2B 12 2Y0 11 2Y1 10 2Y2 9 2Y3
图 4.1 74LS148 引脚图
RD 1 CP 2
A3 B4 C 5 7744LLSS17614 D6 EP 7 GND 8
16 Vcc 15 RCO 14 QA 13 QB 12 QC 11 QD 10 ET 9 LD
图 7.3 集成计数器 74161 引脚图
1CK 1 1K 2 1J 3
1PR 4 1Q 5 1Q 6 2Q 7
001
10
0xxxxxxx
000
10
11111111
111
01
真值表
选通 G
选择 BA
输出 Y
双四选
0
1
xx
一数据 74LS153
0
00
Y=D0
选择器
Y=D1
0
01
Y=D2
0
10
Y=D3
0
11
电路引脚图
选通 G
选择 CBA
输出 Y(W=Y)
0
1
x xx
D0
八选一
0
0 00
D1
0
0 01
数据选
74151
7744LLSS71541
16 Vcc 15 D4 14 D5 13 D6 12 D7 11 A 10 B 9C
图 4.5 74LS151 引脚图
41
52
63 74 EI 5 A2 6 A1 7
GND 8
7744LLSS71448
16 Vcc 15 EO 14 GS
13 3 12 2 11 1 10 0 9 A1
XXX XXX 000 001 010 011 100 101 110 111
电路引脚图
输出 Y7Y6Y5Y4Y3Y2Y1Y0
11111111 11111111 11111110 11111101 11111011 11110111 11101111 11011111 10111111 01111111
1

0
Q=0
1
0
X
保持(Q=Qn)
电路简 称
清零 RD 预置 LD
使能 EP ET
真值表
预置数输入 A 时钟 CP
BCD
输出 QA QB QC QD
0 74LS161
1
1
1
1
X
X
XX

0
XX
X
1
0X
X
1
X0

1
11
XXXX ABCD XXXX XXXX XXXX
0000 ABCD
保持 保持 计数
74163(同步清零) 74160(异步清零) 74162(同步清零)
EI
76543210
输出
级联出
A2 A1 A0
EO GS
1 0 0 0 0 0 0 0 0
类别
电路简称
xxxxxxxx
111
11
11111110
111
10
1111110x
110
10
111110xx
101
10
11110xxx
100
10
1110xxxx