湖北经济学院数字电子技术基础简明教程复习

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湖北经济学院2012年
数字电子技术简明教程期末考试解读
授课老师:王金庭
复习整理:卢未来
考试题型:一填空题(10)每题2分共20分
二选择题(10)每题2分共20分
三是非题(5)每题2分共10分
四应用题(1)一题共10分
五应用题(1)一题共10分
六组合逻辑电路设计(1)一题共15分
七时序逻辑电路设计(1)一题共15分
1、
认识各种进制数:
二八进制转换表
1位八进制数0 1 2 3 4 5 6 7
3位二进制数000 001 010 011 100 101 110 111
二进制与十六进制转换表
1位十六进制数0 1 2 3 4 5 6 7
4位二进制数0000 0001 0010 0011 0100 0101 0110 0111
1位十六进制数8 9 A B C D E F
4位二进制数1000 1001 1010 1011 1100 1101 1110 1111
十进制转换成八进制
十进制转换为十六进制
二进制数与八进制数间的转换
例:(302.54)8 ( )2
解:
3 0 2 . 5
4 八进制数
011 000 010.101 100 二进制数
答:(302.54)8 = (11000010.1011)2
二进制数与十六进制数间的转换
例:(1111111000111.100101011)2 ( )16
解:
0001 1111 1100 0111.1001 0101 1000
1 F C 7 . 9 5 8
答:(1111111000111.100101011)2 = (1FC7.958)16
例:(3C.A6)16 ( )2
解:
3 C . A 6 十六进制数
0011 1100.1010 0110 二进制数
答:(3C.A6)16 = (111100.1010011)2
八进制转换为十六进制可以先把八进制转换为二进制,再将二进制转换为十六进制,由于这样类型转换使用较少,故不举例题。

(1)代入规则;(2)反演规则;(3)对偶规则
---最简与或式:乘积项的个数最少,每个乘积项中相乘变量个数也最少的与或表达式,称为最贱与或表达式。

化简为最简与非与非表达式方法:对最简与或式两次取反即可。

化简为最简或与表达式方法:对最简与或表达式求反函数,再取反即可。

化简为最简或非或非表达式方法:对最简或表达式两次取反即可。

化简为最简与或非表达式方法:在最简或非或非表达式取反去掉大反号下面的小反号;或者
对最简或与表达式求反函数,再取反即可。

在数字电路中,用1表示高电平,用0表示低电平,称为正逻辑赋值,简称正逻辑;用0表示高电平,用1表示低电平,称为负逻辑赋值,简称负逻辑。

CMOS三态门
===
当使能有效,可输出高低电平;当,使能无效,呈高阻态。

EN EN Y Z 0,Y=A1
TTL三态输出与非门
当使能有效,可输出高低电平;当,使能无效,呈高阻态。

===
0,Y=AB1
EN EN Y Z
主要特点:
①输出MOS管的漏极是开路的,工作时必须外接电源V’DD和电阻RD(上拉电阻),实现的逻辑功能是Y=A·B。

②可以实现线与功能,即可以把几个OD门的输出端连接起来实现与运算。

③可以用来实现逻辑电平变换。

④带负载能力强。

输出为高电平时带拉电流负载能力IOH决定于外接电源V’DD和电阻RD;输出为低电平时带灌电流负载能力IOL由输出级MOS管的容量决定,比较大。

注:这两种类型的电路与CMOS门电路中的漏极开路门和三态门是相对应的,逻辑符号也相同。

组合电路的基本设计方法
一、设计方法
根据要求,设计出适合需要的组合逻辑电路应该遵循的基本步骤,可以大致归纳如下:
1、进行逻辑抽象
①分析设计要求,确定输入、输出信号及它们之间的因果关系。

②设定变量,即用英文字母表示有关输入、输出信号,表示输入信号者称为输入变量,有时也简称为变量,表示输出信号者称为输出变量,有时也称为输出函数或简称函数。

③状态赋值,即用0和1表示信号的有关状态。

④列真值表。

根据因果关系,把变量的各种取值和相应的函数值,以表格形式一一列出,而变量取值顺序则常按二进制数递增排列,也可按循环码排列。

2、进行化简
①输入变量比较少时,可以用卡诺图化简。

②输入变量比较多用卡诺图化简不方便时,可以用公式法化简。

3、画逻辑图
①变换最简与或表达式,求出所需要的最简式。

②根据最简式画出逻辑图。

二设计举例
2、基本步骤:
⑴确定应该选用的数据选择器
k:函数的变量个数4选1数据选择器74LS153
n:选择器地址码位数8选1数据
选择器74LS151
⑵写逻辑表达式
逻辑函数的标准与或式
数据选择器输出信号表达式⑶求选择器输入变量的表达式对照比较确定个输入变量
⑷画连线图
触发器类型
功能 特性方程 基本的RS 触发器

0、置1、保持 10n n Q S RQ RS +⎧=+⎪⎨=⎪⎩ 同步RS 触发器
置0、置1、保持 1CP=10n n Q S RQ RS +⎧=+⎪ ⎨=⎪⎩期间有效 同步D 触发器
置0、置1 1CP=1n Q D += 期间有效 边沿D 触发器
置0、置1 1CP=1n Q D += 下降(或上升)沿时刻有效 边沿JK 触发器 置0、置1、保持、翻
转 1+CP=1n n n Q JQ KQ += 下降(或上升)沿时刻有效
T 触发器
保持、翻转 1CP=1n n Q T Q +=⊕ 下降(或上升)沿时刻有效 T '触发器
翻转 1CP=1n n Q Q += 下降(或上升)沿时刻有效
基本RS触发器的特性表
R S n Q1n Q+功能
0 0 0 不用不允许0 0 1
0 1 0 0 置0
0 1 1
1 0 0 1 置1 1 0 1
1 1 0 0 保持1 1 1 1
基本RS触发器逻辑电路图(a)和逻辑符号(b)
基本RS 触发器的特性表 R S n Q 1n Q 功能
0 0 0
0 保持 0 0 1
1 0 1 0
1 置1 0 1 1
1 0 0
0 置0 1 0 1
1 1 0
不用 不允许 1 1 1
同步RS 触发器逻辑电路图与逻辑符号
Q G1 R & & S Q G3 R & & S G2 G4 CP Q Q R S R
S CP C1。