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DSP原理与应用2011-第五章TMS320F28335片(精)

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DSP第5章-F28335-概述

DSP第5章-F28335-概述
内存总线： a.程序读总线，22位地址线，32位数据线 b.数据读总线，32位地址线，32位数据线 c.数据写总线，32位地址线，32位数据线 可寻址4G字的数据存储空间、4M字的程序存储空间。
外设总线： 用于外设互联，复用多种总线。
5.3.3 外设
1. ePWM:6个，可单独控制各个引脚，功能更强大 2.eCAP:6个 3.eQEP:2个，测速更加方便 4.ADC:12位,16路,80ns转换时间 5.Watchdog Timer:1个 6.McBSP:2个，用于连接高速外设，如音频处理模块 7.SPI:1个，连接具有SPI借口的外设
得益于F28335浮点运算单元，从而简化软件开发，缩 短开发周期，降低开发成本。
5.1 F28335的性能
高性能静态CMOS技术：主频150MHZ，指令周期6.67ns; 低功
耗设计，1.9V/1.8V内核电压，3.3VI/O引脚电压;Flash编 程电压为3.3V
高性能32位CPU：IEEE-754单精度浮点运算单元（FPU） ；
3个32位CPU定时器:定时器0、1、2。T0、T1为一般定时器 ，T0连接至PIE，T1连接至中断INT13，T2用作DSP/BIOS的
5.1 F28335的性能
串行端口外设：2个eCAN2.0B； 3个SCI（UART）；2个 McBSP；1个SPI； 1个I2C总线接口。
16通道12位模数转换模块：转换时间80ns,2X8通道复用输入 接口；2个采样保持电路；单/连续通道转换；内部或外部参考电 压
▪32位定点CPU架构，支持16位和32位指令操作。前者减 少存储，提高代码密度。后者加快指令执行时间。 ▪32位IEEE-754单精度FPU，具有高效C/C++引擎，可使 用高级语言编程。 ▪32X32位MAC64位处理能力。 ▪快速中断响应。 ▪“原子指令”读写简化机制。执行更快，代码更少。

TMS320F28335教程

TMS320F28335教程

2个增强型的eCAN2.0B接口模块
DSP技术应用
2个多通道缓冲串口（MBSP） 1个12C总线接口 12位模数转换模块
80ns转换时间
2X8通道复用输入接口
两个采样保持电路
单/连续通道转换
高达88个可配置通用目的I/O引脚
先进的仿真调试功能
DSP技术应用
硬件支持适时仿真功能
DSP技术应用
(5) 军事——如保密通信、雷达处理、声纳处理、
导航、导弹制导等； (6) 仪器仪表——如频谱分析、函数发生、锁相环 、地震处理等； (7) 自动控制——如引擎控制、声控、自动驾驶、 机器人控制、磁盘控制等； (8) 医疗——如助听、超声设备、诊断工具、病人 监护等；
(9) 家用电器——如高保真音响、音乐合成、音调 控制、玩具与游戏、数字电话/视等。
C28x
TM
GPIO 16/32-bit
EMIF SPI
88
32x32-bit
Multiplier
通讯接口 32-bit Timers (3) Each McBSP configurable as SPI Real CAN 2.0b with 32 mailboxes Time 2C at 400 Kbps JTAG I 开发套件 SEED-DEC28335+SEED-XDSusb2.0 Code Composer Studio™ IDE V3.3 DSP技术应用 Software libraries
Sectored
A(18-0) 22 32 32 32
32-bit Auxiliary
Flash
RAM
ROM
D(15-0)
32x32 bit Multiplier

TMS320F28335教程

TMS320F28335教程
• 以达到0.05mW/MIPs的最低
功耗性能比而具有最长的电池 寿命。
• 最佳的代码密度 • 兼容C54x™ DSP软件
DSP技术应用
Broadband Infrastructure DSP
TI C64x™ DSP 核心: 世界上具有最高性能的 DSPs
• 工作频率将达到1.1GHz • 最好的DSP编译器, 便于
DMA Interrupt Management
C28xTM 32-bit DSC
32x32-bit Multiplier
32-bit Timers (3)
RealTime JTAG
RM W
Atomi c
ALU 32-bit
Floatin g-Point Unit
2 QEP 12-bit ADC
得益于F28335浮点运算单元，从 而简化
软件开发，缩短开发周期。降低开发成本。
DSP技术应用
采用高性能的静态CMOS技术 主频达150MHZ（6.67ns） 低功耗设计，1.9V内核电压，3.3V I/O电压 Flash编程电压为3.3V 支持JTAG边界扫描接口 高性能32位CPU 16*16位和32*32位的乘法累加操作 16*16位的双乘法累加器 哈佛总线结构
Flash RAM
▪ Configurable 16- or 32-bit EMIF 控制外设
Memory Bus
TMS320F28335
Boot ROM
12 PWM (6 HRPWM)
6 CAP
▪ PWM outputs interfaces for three
3-phase motors
DSP技术应用
TMS320F28335概述

TMS320F28335中文资料资料讲解

TMS320F28335中文资料资料讲解

T M S320F28335中文资料TMS320F28335中文资料TMS320F28335采用176引脚LQFP四边形封装，其功能结构参见参考文献。

其主要性能如下：高性能的静态CMOS技术，指令周期为6．67 ns，主频达150 MHz；高性能的32位CPU，单精度浮点运算单元(FPU)，采用哈佛流水线结构，能够快速执行中断响应，并具有统一的内存管理模式，可用C／C++语言实现复杂的数学算法；6通道的DMA控制器；片上256 Kxl6的Flash存储器，34 Kxl6的SARAM存储器．1 Kx16 OTPROM和8 Kxl6的Boot ROM。

其中Flash，OTPROM，16 Kxl6的SARAM均受密码保护；控制时钟系统具有片上振荡器，看门狗模块，支持动态PLL调节，内部可编程锁相环，通过软件设置相应寄存器的值改变CPU的输入时钟频率；8个外部中断，相对TMS320F281X系列的DSP，无专门的中断引脚。

GPI00~GPI063连接到该中断。

GPI00一GPI031连接到XINTl，XINT2及XNMI外部中断，GPl032~GPI063连接到XINT3一XINT7外部中断；支持58个外设中断的外设中断扩展控制器(PIE)，管理片上外设和外部引脚引起的中断请求；增强型的外设模块：18个PWM输出，包含6个高分辨率脉宽调制模块(HRPWM)、6个事件捕获输入，2通道的正交调制模块(QEP)；3个32位的定时器，定时器0和定时器1用作一般的定时器，定时器0接到PIE模块，定时器1接到中断INTl3；定时器2用于DSP／BIOS的片上实时系统，连接到中断INTl4，如果系统不使用DSP／BIOS，定时器2可用于一般定时器；串行外设为2通道CAN模块、3通道SCI模块、2个McBSP(多通道缓冲串行接口)模块、1个SPI模块、1个I2C主从兼容的串行总线接口模块；12位的A／D转换器具有16个转换通道、2个采样保持器、内外部参考电压，转换速度为80 ns，同时支持多通道转换；88个可编程的复用GPIO引脚；低功耗模式；1．9 V内核，3．3 V I／O供电；符合IEEEll49．1标准的片内扫描仿真接口(JTAG)；TMS320F28335的存储器映射需注意以下几点：片上外设寄存器块0~3只能用于数据存储区，用户不能在该存储区内写入程序。

TMS320F28335的EPWM参考手册中文-很有用.

TMS320F28335的EPWM参考手册中文-很有用.

DSP原理与应用The Technology & Applications of DSP北京交通大学电气工程学院郝瑞祥haorx@本页已使用福昕阅读器进行编辑。

福昕软件（Ｃ）２００５－２００９，版权所有，仅供试用。

§7.1F28335的PWM控制●每个ePWM模块都支持下列特性:●精确的16位时间定时器，可以进行周期和频率控制。

●两个PWM输出(EPWMxA and EPWMxB) 可以用于下面的控制●–两个独立的PWM输出进行单边控制●–两个独立的PWM输出进行双边对称控制●–一个独立的PWM输出进行双边非对称控制●与其它ePWM模块有关的可编程超前和滞后相控。

●在一个循环基础上的硬件锁定（同步）相位关系。

●独立的上升沿和下降沿死区延时控制●可编程控制故障区（trip zone）用于故障时的周期循环控制（trip）和单次（one-shot）控制.●一个控制条件可以使PWM输出强制为高，低，或高阻逻辑电平.●所有事件都可以触发CPU中断，启动ADC开始转换。

●可编程事件有效降低了在中断时CPU的负担。

●PWM高频载波信号对于脉冲变压器门极驱动非常有用。

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福昕软件（Ｃ）２００５－２００９，版权所有，仅供试用。

多个ePWM模块结构框图ePWM模块的子模块和信号连接模块相关信号说明如下：●PWM 输出信号(EPWMxA and EPWMxB) (x=1…6)●通过IO引脚输出PWM信号.●Trip-zone 信号(TZ1 to TZ6).这些输入信号警告ePWM模块有外部故障发生。

设备的每个模块都可以配置成使用或者忽略任何故障区信号（Trip-zone）。

这些信号可以设置为通用IO外设的异步输入。

●基于时间的同步输入信号(EPWMxSYNCI)和输出(EPWMxSYNCO)信号.同步信号雏菊花形将ePWM模块连接在一起。

每个模块可以配置成使用或忽略其同步输入信号。

DSP原理与应用2011-第五章 TMS320F28335片内外设_ad转换SCI

DSP原理与应用2011-第五章 TMS320F28335片内外设_ad转换SCI
教学目标：
掌握TMS320F28335内核结构，例如A/D转换、串行通信接口、 串行 外设接口。
重点：
TMS320F28335内部A/DC的正确使用，串行通信接口应用。
难点：
TMS320F28335的ADC寄存器操作和串行通信寄存器操作。
教学内容分两部分
§5.1：TMS320F28335内模拟/数字转换 §5.2 ：TMS320F28335系列串行通信接口SCI和Modbus协议介绍
7
§5.1 .2 ADC有关的寄存器
控制寄存器
通道顺序选 择寄存器
结 果 寄 存 器
DSP原理与应用
2012年9月3日
8
ADC有关的寄存器（序）
控制寄存器 状态寄存器
参考电压选择寄存器 偏移电压调整寄存器
DSP原理与应用
2012年9月3日
9
§5.1.3 ADC 操作模式
根据采样模式划分，包括顺序采样和同步采样 1) 顺序采样模式（Sequential Sampling Mode）
DSP原理与应用
2012年9月3日
10
2) 同步采样模式（Simultaneous Sampling Mode）
DSP原理与应用
2012年9月3日
11
根据转换模式划分，包括： 级联模式转换和和双序列模式转换 1） 级联模式转换
DSP原理与应用
2012年9月3日
12
2） 双序列模式转换
DSP原理与应用
DSP原理与应用
4
Sequencer can be operated as two independent 8-state sequencers or as one large 16-state sequencer (i.e., two cascaded 8-state sequencers).

TMS320F28335核心板：Core28335原理图


VDD VDD VDD VDD VDD VDD VDD VDD VDD VDD VDD VDD VDD ADCINA0 ADCINA1 ADCINA2 ADCINA3 ADCINA4 ADCINA5 ADCINA6 ADCINA7 ADCINB0 ADCINB1 ADCINB2 ADCINB3 ADCINB4 ADCINB5 ADCINB6 ADCINB7 ADCLO REFIN 42 41 40 39 38 37 36 35 46 47 48 49 50 51 52 53 43 54 55 56 57 31 59 32 58 34 33 45 44 95 94 91 90 89 88 75 74 73 72 69 68 67 66 65 64 5 6 7 10 11 12 13 16 17 18 19 20 21 24 25 26 27 28 62 63 76 77 78 79 85 86 87
U4C 8 XCS7
R100 0R
C6 2.2uF
C8 2.2uF
R5 1.9VA 22K 3.3VA 3.3VA
WR 11 RD 28 CS6L 26 /RST 12 14
பைடு நூலகம்
ISSI61LV6416
CS0
4
J1 1 3 5 7 9 11 13 15 17 19 21 23 25 27 29 31 33 35 37 39 41 43 45 47 49 51 53 55 PWM1A 57 PWM2A 59 PWM3A 61 PWM4A PWM5A 63 PWM6A 65 TZ1 67 TZ3/SCITXB 69 CANTXB/TZ5 71 73 75 GND 77 79 GND VCC A09 A11 A13 A15 A18 A17 A07 A05 A03 A01 D14 D12 D10 D08 D06 D04 D02 D00 RD XCLKOUT XCS0 /RST 1 3 5 7 9 11 13 15 17 19 21 23 25 27 29 31 33 35 37 39 41 43 45 47 49 51 53 55 57 59 61 63 65 67 69 71 73 75 77 79 2X40 VCC Y1 30M C80 20P 1.9V C1 104 C2 104 C3 104 C4 104 C5 104 C7 104 C10 104 C11 104 C19 104 C20 104 C21 104 C22 104 C23 104 C24 104 C25 104 C26 104 C29 104 B 2 4 6 8 10 12 14 16 18 20 22 24 26 28 30 32 34 36 38 40 42 44 46 48 50 52 54 56 58 60 62 64 66 68 70 72 74 76 78 80 2 4 6 8 10 12 14 16 18 20 22 24 26 28 30 32 34 36 38 40 42 44 46 48 50 52 54 56 58 60 62 64 66 68 70 72 74 76 78 80 +5V GND VCC A08 A10 A12 A14 A16 A19 A06 A04 A02 A00 D15 D13 D11 D09 D07 D05 D03 D01 WR RDY XCS7 R/W J2 GND VCC TXC MFSRB MFRSA SPI STEA SPI SOMIA QEP1I QEP1B CAP6 TCK EMU0 TMS TDO SCLA CAP4 CAP2 MFSXA MDRA CANTXA REFIN ADCINB6 ADCINB4 ADCINB2 ADCINB0 ADCLO ADCINA1 ADCINA3 ADCINA5 ADCINA7 VCC GND 1 3 5 7 9 11 13 15 17 19 21 23 25 27 29 31 33 35 37 39 41 43 45 47 49 51 53 55 57 59 61 63 65 67 69 71 73 75 77 79 1 3 5 7 9 11 13 15 17 19 21 23 25 27 29 31 33 35 37 39 41 43 45 47 49 51 53 55 57 59 61 63 65 67 69 71 73 75 77 79 2X40 2 4 6 8 10 12 14 16 18 20 22 24 26 28 30 32 34 36 38 40 42 44 46 48 50 52 54 56 58 60 62 64 66 68 70 72 74 76 78 80 2 4 6 8 10 12 14 16 18 20 22 24 26 28 30 32 34 36 38 40 42 44 46 48 50 52 54 56 58 60 62 64 66 68 70 72 74 76 78 80 GND VCC RXC MCLKRB MCLKRA SPI CLKA SPI SIMOA PWM1B QEP1S QEP1A CAP5 EMU1 /RST TRST TDI SDAA CAP3 CAP1 MCLKXA MDXA CANRXA REFIN ADCINB7 ADCINB5 ADCINB3 ADCINB1 GNDF ADCINA0 ADCINA2 ADCINA4 ADCINA6 VCC GND PWM1A R1 1K 74HC04 U2D R2 1K 74HC04 U2F 13 74HC04 12 74HC04 9 8 11 74HC04 U2E 10 R8 510R RED 3 U2B 4 5 U2C 6 R6 510R RED C D4 D3

第五章 通用输入输出端口-TMS320F28335 DSP原理、开发及应用-符晓

… 0xFF：采样周期=510×TSYSCLKOUT
0
QUALPRD0
GPIO39-32 GPIO7-0
C2833x GPIO 控制寄存器
寄存器 GPACTRL GPAQSEL1 GPAQSEL2 GPAMUX1 GPAMUX2 GPADIR GPAPUD GPBCTRL GPBQSEL1 GPBQSEL2 GPBMUX1 GPBMUX2 GPBDIR GPBPUD GPCMUX1 GPCMUX2 GPCDIR GPCPUD
输入限定
GPIO Port C 方向寄存器 (GPCDIR) [GPIO 64 到 87]
GPIO Port C
F2833x GPIO管脚示意图
GPxSET GPxCLEAR GPxTOGGLE
I/O DIR Bit 0 = Input 1 = Output
GPxDIR
GPxDAT Out
I/O DAT Bit (R/W) In
C2833x GPIO 数据寄存器
寄存器 GPADAT GPASET GPACLEAR GPA到GGLE GPBDAT GPBSET GPBCLEAR GPB到GGLE GPCDAT GPCSET GPCCLEAR GPC到GGLE
描述 GPIO A Data 寄存器 [GPIO 0 – 31] GPIO A Data 置位寄存器[GPIO 0 – 31] GPIO A Data 清除寄存器[GPIO 0 – 31] GPIO A Data 翻转寄存器[GPIO 0 – 31] GPIO B Data 寄存器 [GPIO 32 – 63] GPIO B Data 置位寄存器[GPIO 32 – 63] GPIO B Data 清除寄存器[GPIO 32 – 63] GPIO B Data 翻转寄存器[GPIO 32 – 63] GPIO C Data 寄存器 [GPIO 64 – 87] GPIO C Data 置位寄存器[GPIO 64 – 87] GPIO C Data 清除寄存器[GPIO 64 – 87] GPIO C Data 翻转寄存器[GPIO 64 – 87]

TMS320F28335中文资料(难得的资料)

标志寄存器由硬件来清零。
EALLOW; // This is needed to write to EALLOW protected registers
PieVectTable.XINT2 = &ISRExint; //告诉中断入口地址
EDIS; // This is needed to disable write to EALLOW protected registers
F28335 是带浮点运算的，动态范围更大。 F2833x 的执行速度，比相同时钟频率的 F28xx 系列定点芯片，快 50%。处理数学运算性能提
升 2.45 倍，控制算法性能提升 1.57 倍，DSP 性能提升 1.38 倍。总体性能提升近 2 倍。
TMS320F28335 的 ADC
TMS320F28335 上有 16 通道、12 位的模数转换器 ADC。他可以被配置为两个独立的 8 通道输 入模式，也可以通过配置 AdcRegs.ADCTRL1.bit.SEQ_CASC=1，将其设置为一个 16 通道的级 联输入模式。输入的方式可以通过配置 AdcRegs.ADCTRL1.bit.ACQ_PS=1，将其设置为顺序
{
EALLOW; // Before setting PLLCR turn off missing clock detect logic
SysCtrlRegs.PLLSTS.bit.MCLKOFF = 1; SysCtrlRegs.PLLCR.bit.DIV = val; EDIS;
// Optional: Wait for PLL to lock. // During this time the CPU will switch to OSCCLK/2 until // the PLL is staPU will

DSP原理与应用2011-第六章 TMS320F28335片内外设_CAN,SPI

DSP原理与应用The Technology & Applications of DSPs 第六讲TMS320F28335片内外设---CAN,SPI北京交通大学电气工程学院夏明超郝瑞祥万庆祝mchxia@haorx@qzhwan@TMS320F28335---CAN,SPI 第六讲片内外设,教学目标：掌握TMS320F28335芯片现场总线CAN通信接口，SPI串行外设接口通信相关知识；教学重点:掌握TMS320F28335芯片常用串行通信接口的特点和应用.教学难点:现场总线CAN通信编程及应用.教学内容:第一节:TMS320F28335系列SPI通信接口第二节: TMS320F28335系列CAN总线通信接口6.1.1 TMS320F2833x SPI§6S30833系列S通信SPI模块的主要特点：◆四个外部引脚SPISOMI: SPI slave-output/master-input pinSPISIMO: SPI slave-input/master-output pinSPISTE: SPI slave transmit-enable pinSPISTE:SPI slave transmit enable pinSPICLK: SPI serial-clock pin◆两个可编程模式: 主(master)和从(slave)◆125种可编程波特率设置.◆数据长度１至１６位．◆四种时钟模式◆接收和发送可同时操作◆１２个SPI模块控制寄存器◆增强特性１６级发送／接收ＦＩＦＯ；延时传输控制.SPI 模块C PU 接口SPI 模块内部结构框图§6.1.2 典型SPI主/从通信连接模式一) (MASTER)()主模式()在该模式下(MASTER/SLAVE = 1), SPI模块通过SPICLK引脚提供整个串行通信网络的时钟. 数据通过SPISOMI引脚接收. SPIBRR寄存器决定网络上发送和接收的波特率。

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DSP 原理与应用The Technology & Applications of DSPs第五章: TMS320F28335片内外设北京交通大学电气工程学院夏明超郝瑞祥万庆祝***************.cn**************.cn**************.cn:TMS320F28335第五讲: TMS320F28335片内外设教学目标：掌握TMS320F28335内核结构，例如A/D转换、串行通信接口、串行外设接口。

外设接重点：TMS320F28335A/DCS308335内部/C 的正确使用，串行通信接口应用。

难点：TMS320F28335的ADC 寄存器操作和串行通信寄存器操作。

教学内容分两部分51§5.1：TMS320F28335内模拟/数字转换§5.2 ：TMS320F28335系列串行通信接口SCI 和Modbus 协议介绍DSP 原理与应用2DSP原理与应用3 ADC 有关引脚§5.1 TMS320F28335内模拟/数字转换§5.1 .1Features and functions of ADC module：◆core with built-in dual sample-and-hold◆Simultaneous sampling or sequential sampling modesp g q p g ◆Analog input: ◆Fast conversion time runs at ADC clock orFast conversion time runs at , ADC clock, or 6.25 MSPSmultiplexed inputs◆, multiplexed inputs◆capability provides up to 16 " t i " i i l i E h i "autoconversions" in a single session. Each conversioncan be to select any 1 of 16 input channels.DSP 原理与应用4Sequencer can be operated as two independent 8-state ◆Sequencer can be operated as two independent 8-state sequencers or as one large 16-state sequencer (i.e., two cascaded 8-state sequencerstwo cascaded 8state sequencers.◆(individually addressable to store conversion values store conversion valuesA/DC digital value:DSP 原理与应用2012年9月3日5◆for the start-of-conversion sequence–S/W -software immediate start–ePWM 1-6–GPIO XINT2◆allows interrupt request on every end-of-sequence (EOS or every other EOSy q ( y◆Sequencer can operate in mode, allowing multiple "time-sequenced triggers" to synchronize p q gg yconversions.Sample-and-hold (S/Hacquisition time window has ◆Sample and hold (S/H acquisition time window has separateA/DC模块框图（Block diagram of A/DC Module）§5.1. 2ADC 有关的寄存器控制寄存器通道顺序选择寄存器结果寄存器ADC有关的寄存器（序）控制寄存器状态寄存器参考电压选择寄存器偏移电压调整寄存器§5.1.3 ADC操作模式1 顺序采样模式（Sequential Sampling Mode）根据采样模式划分，包括顺序采样和同步采样2同步采样模式（Simultaneous Sampling Mode）DSP 原理与应用2012年9月3日11根据转换模式划分，包括：级联模式转换和和双序列模式转换1）级联模式转换DSP 原理与应用2012年9月3日122）双序列模式转换DSP 原理与应用2012年9月3日13 单序列模式和级联模式对比DSP 原理与应用2012年9月3日14§5.1.4 ADC电压参考默为使用内部电压参考也以使用外部电压参考允许值为●默认为使用内部电压参考，也可以使用外部电压参考，允许值为2.048V ，1.5V 和1.024V 。

通过寄存器选择参考源如果选择内部参考源●ADCREFSEL 寄存器选择参考源，如果选择内部参考源，ADCREFIN 引脚可以连接选择的参考源、悬空或接地。

如果使用外部2.048V 的参考源，推荐使用工业级REF3020AIDBZ 芯片。

DSP 原理与应用2012年9月3日15§5.1.5 ADC模块时钟ADC 模块有多个时钟定标模式，与其有关的信号即寄存器有外部时钟源XCLKIN ，ADCTRL3寄存器ADCLKPS[3-0], ADCTRL1寄存器CPS 位等。

§5.1.6 ADC运行模式1）非中断自动顺序模式（Uninterrupted Autosequenced Mode）如果ADCTRL1寄存器的CONT_RUN位设为1, ADC工作在连续运行模式。

假设期望SEQ1中7个通道，如ADCINA2,ADCINA3重复两次，ADCINA6, ADCINA7, ADCINB4顺序采样，则MAC_CONV1应设为6，ADCCHSELSEQn 寄存器应按下图配置存器应按下图配置。

有信号位这些通道将按照一旦有SOC 信号，SOC 触发被装入SEQ_CNTR位，这些通道将按照ADCCHSEQn 中预先配置的转换顺序进行转换。

SEQ_CNTR位每转换一次自动减一，一旦SEQ CNTR 减到零，将从新开始下一轮转换（CONT RN=1）。

动减_减到零将从新开始下轮转换_2）顺序启/停模式（Sequencer Start/Stop Mode）如果ADCTRL1寄存器的CONT_RUN位设为0, 则ADC 工作在顺序启/停模式。

假设期望事件一启动I1,I2,I3转换，事件二启动V1,V2,V3转换，而且两个触发则MAX CONV1事件之间时间间隔为25uS 。

则MAX_CONV1应设置为2，ADCCHSELSEQn 配置如下：一旦复位和初始化寄存器，SEQ1将等待第一个触发事件的到来，然后开始CONV00(I1, CON01(I2,CONV02(I3 转换，本次转换完成后，SEQ1在当前状态等待下一个触发事件的到来，然后再开始CONV03(V1,CON04(V2, CONV05(V3。

两次转换中MAX_CONV1值都自动装入SEQ_CNTR，如果两次转换的通道数不一致，则应在下次转换开始之前的适当时刻修改MAX_CONV1的值。

可以通过ADCTRL2中的RST_SEQn来复位序列到预启动状态。

517ADC §5.1.7 ADC采样校准ADC cal(子程序在芯片出厂时已经固化在OPT 存储器中。

BOOT _(子程序片厂固化存储中ROM 自动调用该子程序，初始化ADCREFSEL 和ADCOFFTRIM 寄存器。

在正常操作时，该过程不需要用户操作而自动完成。

如果在开发阶段，BOOT ROM被CCS 旁路，则ADCREFSEL 和ADCOFFTRIM 寄存器必须在应用程序中初始化。

如果该寄存器初始化失败或不正确，将降低精度。

由于TI 存储器被安全保护因此ADC l(TI 保留的OTP 存储器被安全保护，因此ADC_cal(子程序必须在安全存储区内调用或者在安全模块被解锁后的非安全存储区调用。

如果系统被复位或者ADC 模块被ADC 控制寄存器ADCTRL1中的BIT14(RESET复位，则该校准子程序必须从新执行。

5.1.8 ADC上电次序§电次序ADC 模块复位时，进入关闭状态。

如果要使用ADC 给其上电，需要根据如下步骤进行：(1 如果使用外部参考信号，可用寄存器ADCREFSEL 的第15-14位选择外部参考模式。

在带隙上电之前必须配置该模式，以避免内部参考电路驱动外部参考源。

（2）通过设置控制寄存器ADCTRL3的位7-5(ADCBGRFDN[1:0],ADCPWDN 上电参考，带隙和模拟电路。

模块全部上电后在开始第次（3）在ADC 模块全部上电后，在开始第一次ADC 转换之前需要增加至少5mS 的延时。

ADC数值在结果寄存器中的存放！！数值在结果寄存器中的存放§5.2 串行通信接口SCI 和Modbus 协议介绍§5.2.1 F28335芯片的SCI 模块主要特点Features ）●有三组模块SCI 模块：SCIA 、SCIB 和SCIC ；●Two external pins:SCITXD SCI i i SCITXD: SCI transmit-output pin；SCIRXD: SCI receive-input pin；Both pins can be used as GPIO if not used for SCI；●Baud rate programmable to 64K different rates●Data-word format1 start bit；Data-word length programmable from 1 to 8 bitsOptional even/odd/no parity bit1 or2 stop bits●Four error-detection flags: parity, overrun(超时, framing, and break detection；T k lti d idl li d ●Two wake-up multiprocessor modes: idle-line and address bit；Half or full duplex opera tion ●Half-or full-duplex operation；●Double-buffered receive and transmit functions；T itt d i ti b●Transmitter and receiver operations can be accomplished through interrupt-driven or polled algorithms with status flags algorithms with status flags；●Sepa rate enable bits for transmitter and receiver interrupts (except BRKDT, Break Detectp (p , ；●NRZ (non-return-to-zero，非归零 format；说明：NRZ 是不归零编码的英文缩写，是一种数据编码本身含步息读借形式，它本身不包含同步时钟信息，对它的读写必须借助读写时钟。