基于VHDL的HDB3译码器的设计与实现
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第４期弓云峰：基于Ｖｍ）Ｌ的ｍ冯译码器的设计与实现４７
别定义Ｏ，＋１，一ｌ为００，０１，１１，使仿真结果更容易观察，所以结果就分别以Ｏ，ｌ，３代替ｏ，＋ｌ，一ｌ，如图５所示。
由于在插Ｂ模块中使用寄存器来解决由现在时间的状态决定过去事件状态的问题。
所以在输出中会有延迟的出现。
因为用到两对４位的寄存器ｓ０、ｓ１，然后再输出到双位的Ｂ，再进行变换双极性后，从“Ｏ唧ｕＹ，＇输出，所以就会有５个的脉冲时钟延迟。
图５编码后如Ｂ３的波形圈６寄寿器申的波形
４结论
采用ＶＨＤＬ语言在Ｍａｘ＋ｐｌｕｓⅡ仿真软件中实现ＨＤ岛的编码方法，大大节省了电路版图。
编程时可选择加密，可以把该电路和它的解码电路及其它辅助电路集成在同一块矸Ｃ刖ＣＰＬＤ芯片中，减少了外接元件，提高了集成度，而且有很大的编程灵活性，使芯片内部犹如一个黑匣子，提高了电路的稳定性及保密性。
此外，在计算机上进行仿真与调试。
可克服硬件组装之后再进行调试的弊端。
设计人员将问题的解决放在硬件组装之前，这样既可以简化设计过程，又可以减少设计风险及成本，缩短设计周期。
基于上述情况，本文提出了基于ⅥＤＬ的ＨＤ岛编译码设计方案。
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基于VHDL的HDB3译码器的设计与实现
作者：弓云峰， GONG Yun-feng
作者单位：茂名学院,计算机与电子信息学院,广东,茂名,525000
刊名：
茂名学院学报
英文刊名：JOURNAL OF MAOMING COLLEGE
年，卷(期)：2009,19(4)
参考文献(6条)
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引用本文格式：弓云峰.GONG Yun-feng基于VHDL的HDB3译码器的设计与实现[期刊论文]-茂名学院学报 2009(4)。
