quartus_II_教程

Q u a r t u s I I软件的使用方法1、创建工程运行quartus II软件，如下图：建立工程，File New Project Wizad，既弹出“工程设置”对话框，如下图：单击此对话框最上一栏右侧的“...”按钮，在d盘中建一个工程文件夹，取名为test。

单击“打开”按钮，在第二行和第三行中填写为“half_adder”。

按Next按钮，出现添加工程文件的对话框，如下图：这里我们先不管它，直接按next进行下一步，选择FPGA器件的型号，如下图：在Family下拉框中，我们选择Cyclone V系列FPGA，选择此系列的具体芯片5CSEMA5F31C6。

执行next出现选择其它EDA工具setting对话框如下图，选择ModelSim_Altera为默认的Simulation 工具，语言为Verilog HDL.执行next出现选择其它EDA工具对话框，我们用Quartus II的集成环境进行开发，因此这里不作任何改动，按next进入工程的信息总概对话框，按Finish按钮即建立一个项目。

2、建立顶层文件。

（1）执行File New，弹出新建文件对话框，如下图：选择“Verilog HDL File”按OK即建立一个空的verilog 文件，按下图写入half_adder代码，我们把它另存为（File Save as）,接受默认的文件名，以使该文件添加到工程中去。

如下图：（2）设置。

在建立工程时我们选定了芯片型号，也可以在这一步设定，在菜单Assignments Device，弹出对话框，如下图：（3）编译。

按主工具栏上的编译按钮即开始编译，Message窗口会显示一些编译信息，最后编译成功弹出提示，如下图：3、仿真对工程编译通过后，必须对其功能和时序性质进行仿真测试，以了解设计结果是否满足原设计要求。

具体步骤如下：1功能仿真选择菜单processing -->start --> start test bench template writertestbench 文件创建完成打开testbench文件编写testbench文件见红色方框，编辑完后，保存。

Altera的Quartus II可编程逻辑软件属于第四代PLD开发平台。该平台支持一个工作组环境下的设计要求，其中包括支持基于Internet的协作设计。Quartus平台与Cadence、ExemplarLogic、 MentorGraphics、Synopsys和Synplicity等EDA供应商的开发工具相兼容。改进了软件的LogicLock模块设计功能，增添 了FastFit编译选项，推进了网络编辑性能，而且提升了调试能力。
PORT (CLK ,D : IN STD_LOGIC ;
Q : OUT STD_LOGIC );
END ;
ARCHITECTURE bhv of DFF3 IS
SIGNAL Q1 : STD_LOGIC ;
BEGIN
PROCESS (CLK,D)
BEGIN
IF clk= '1'
then Q1 <= d ;
end if ;
end process ;
Q <= Q1 ;
END ;
智库中国
2012年12月4日
注: 以上内容为个人所做，仅为eda爱好者学习探讨之用，任何未经允许不得刊印出版。
一 新建工程
选择文件 新建工程
利用工程导航 创建工程
选择工程的存储文件夹、工程名以及工程的顶层文件
询问是否建立这个不存在的文件夹
选择试验箱的开发FPGA型号
出现最终选择的综述
单击确定
二操作主界面
选择工程的构建方式（原理图或者VHDL）
这里选择VHDL（硬件描述语言）进行构建
出现VHDL的编辑界面
输入一段VHDL语言这里以锁存器为例
最后编译一下，使所有设置编译进*.sof文件中

Quartus 【1 】Ⅱ入门教程（一个Verilog 程序的编译和功效仿真）Quartus Ⅱ是Altera 公司推出的专业EDA 对象,支撑道理图输入.硬件描写说话的输入等多种输入方法.硬件描写说话的输入方法是应用相似高等程序的设计办法来设计出数字体系.接下来我们对这种智能的EDA 对象进行初步的进修.使大家今后的数字体系设计加倍轻易上手.第一步：打开软件●快捷对象栏：供给设置（setting ）,编译（compile ）等快捷方法,便应用户应用,用户也可以在菜单栏的下拉菜单找到响应的选项.● 菜单栏：软件所有功效的掌握选项都可以在其下拉菜单中找到.●信息栏：编译或者分解全部进程的具体信息显示窗口,包含编译经由过程信息和报错信息.第二步：新建工程（file>new Project Wizard ）快捷对象栏信息栏菜单栏所建工程的保管路径工作区资本治理窗口义务治理窗口1工程名称：2添加已有文件（没有已有文件的直接跳过next ）工程名称顶层模块名（芯片级设计为实体名）,请求与工程名称雷同假如有已经消失的文件就在该进程中添加,软件将直接将用户所添加的文件添加到工程中.3选择芯片型号（我们选择MAX3000A 系列下的EPM3256AQC208-10芯片） (注：假如不下载到开辟板长进行测试,这一步可以不必设置)4选择仿真,分解对象（第一次试验全体应用quartus 做,三项都选None,然后next ）所选的芯片的系列型号快速搜刮所需的芯片选择芯片5工程树立完成（点finish）选择第三方分解对象,假如应用Quartus内部分解对象则选择none选择第三方仿真对象,假如应用Quartus内部仿真对象则选择none选择时序剖析仪工程树立完成,该窗口显示所树立工程所有的芯片,其他第三方EDA对象选择情形,以及模块名等等信息.第三步：添加文件（file>new>VHDL file）,新建完成之后要先保管.我们选择Verilog HDL File设计文件格局既选择Verilog文本输入情势第四步：编写程序以实现一个与门和或门为例,Verilog描写源文件如下：module test(a,b,out1,out2);input a,b;Output out1,out2;assignout1=a&b;assign out2=a | b;endmodule然后保管源文件;第五步：检讨语法（点击对象栏的这个按钮（start Analysis & synthesis））点击肯定完成语法检讨第六步：（锁定引脚,点击对象栏的（pin planner））(注：假如不下载到开辟板长进行测试,引脚可以不必分派)该窗口显示了语法检讨后的具体信息,包含所应用的io口资本的若干等内容,响应的英文名大家可以本身查阅语法检讨成功,没有error级别以上的错误各个端口的输入输出顶层某块的输入输出口与物理的芯片端口想对应双击location 为您的输入输出设置装备摆设引脚.第七步：整体编译（对象栏的按钮（start Complilation））该窗口给出分解子女码的资本应用情形既芯片型号等等信息.选择为应用端口选项卡第八步：功效仿真（直接应用quratus进行功效仿真）1将仿真类型设置为功效仿真（Assignments>setting>Simulator Settings>下拉>Function）2树立一个波形文件：（new>Vector Waveform File）Functional暗示功效仿真,既不包含时序信息,timinng暗示时序仿真.参加线及存放器的延时信息然后导入引脚（双击Name 下面空白区域>Node Finder>list>点击）：添加波形文件作为旌旗灯号输出文件,以便不雅察旌旗灯号的输出情形双击弹出右边的对话框点击如下图添加旌旗灯号点击产生端口列表接下来设置鼓励旌旗灯号（单击>选择>Timing>Multipliedby 1）设置仿真的开端及停止时光设置输入旌旗灯号我们自界说的输入旌旗灯号设置b旌旗灯号源的时刻类同设置a旌旗灯号源,最后一步改为Multiplied by2然后要师长教师成仿真须要的网表（对象栏processing>Generate FunctionalSimulation Netlist）接下来开端仿真（仿真前要将波形文件保管,点击对象栏开端仿真）：由a,b 两个旌旗灯号经由我们设计的模块产生的成不雅察波形,刚好相符我们的逻辑.功效仿真经由过程.第九步：下载（点击（Programmer）,再点击Hardware Setup设置装备摆设下载电缆,单击弹出窗口的“Add Hardware”按钮,选择并口下载ByteBlasterMV or ByteBlasterMVⅡ,单击“Close”按钮完成设置.CPLD器件生成的下载文件后缀名为.pof,点击下图所示方框,选中下载文件,然后直接点击start按钮开端下载）完！下载是该选项必须打勾下载进度条点击该按钮开端下载。

配置项目设置
根据设计需求，配置项目设置，如选择目标器件、设 置编译选项等。
设计版本控制
初始化版本控制
在Quartus II中初始化版本控制系 统（如Git），以便跟踪和管理设 计文件的历史版本。
提交更改
在完成设计修改后，提交更改到 版本控制系统，记录更改内容和 提交者信息。
查看版本历史
通过版本控制系统查看设计文件 的历史版本，以便进行回滚或比 较不同版本之间的差异。
集成开发平台Quartus II操作基础 课件
• Quartus II软件安装与配置 • 设计输入与编译 • 引脚分配与布局 • 时序仿真与调试 • 硬件编程与配置 • 项目管理与版本控制
01
Quartus II软件安装与配置
安装步骤
下载Quartus II安装程序
访问Altera官网，根据操作系统选择对应的版本下载。
输标02入题
在Quartus II中，可以通过“Program Device”菜单 选择USB Blaster编程方式，并设置相应的参数，如 编程文件、编程方式、编程地址等。
01
03
在进行USB Blaster编程时，需要注意芯片的安全操 作电压和电流范围，以及编程数据的校验和错误处理
。
04
USB Blaster编程通常需要使用Altera提供的USB Blaster驱动程序，以便将FPGA芯片与计算机连接起 来。
FPGA配置模式选择
Quartus II提供了多种FPGA配置模式， 如快速配置、全局配置和分布式配置等 。
在Quartus II中，可以根据实际需求选 择合适的配置模式，并设置相应的参数 ，如配置方式、配置地址等。
分布式配置适用于将多个配置文件分布 在FPGA的不同区域的情况，以实现灵活 的硬件设计。