DSP与PCI总线接口设计研究
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2 T 30 60 的 H I MS 2C 2 1 P 口与 P I00的接 口设 计 C2 4
T 30 6 0 MS 2 C 2 1的 H I P I0 0的连接如 图 1 P 与 C24 所示 。
A [10 D 3 :]
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… 5二 H D 1 : A[
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l T 3 0 6 0 主机接 口简 介 MS 2 C 2 1
l1 H I的接 口信号 _ P P I0 0通过 T 3 0 6 0 C24 MS 2 C 2 1的主 机口 H I P 可直接访 问 DS P的存储 空间,主机 口 H I的接 口信号如图 1中所示 : P 其 中 I 1 :1 - 50是一个数据 / I D[ 地址 复用的双 向总线 ,传送 的 数据包括控制寄存器 的设置值 、 初始化 的访 问地址 以及真正
1 i 的 内容 一 致 。 6bt
后 的结 果送 到P 机 ,以供进 一步的信号分析 、信号显示 、 c 存储 ; 同时 ,P 机 需要将控制命 令发送给DS C P。P I总线 C 的数据和地址线 宽3 位 ,数据线可扩 展为6 位 ,时钟高达 2 4 3 M /6 。且与C U 关,与时钟频率 也无 关,因此 3 6M P无 可 以应用于各种平 台,支持多处理器和并发操作 。P I0 0 C2 4 是n公 司设计 的专 门用来实现C50 / 6 0 系列DS 和P I 0 0C 0 0 P c 总线进 行接 口的专用 芯片 ,可 以通 过8 或1 位HP 接 口与 位 6 I C4 C x P 5 x/ 6 DS 实现无缝连接 。 故本文采用P I0 0 C 2 4 实现Ds P 与P I C 总线 问 的连接 ,从而 完成DS 与P P C间 的高速数 据传 输。
DS 与P I P C 总线接 口设计研 究
陈 霞
摘 要 :利 mP I 控 制 器P I0 0 现 7DS 与P 1 线 的 连接 , 对T 30 60 的主 机 接 1 以及 它与 P I0 0 C桥 C24实 P C总 MS 2C 2 1 2 : C2 4 的接 1 计 2设
进行 了详述 ,深入研 究了利
Dr e m i开发P I i r do vS C 设备驱动程序的方法。
关键词 :P I00 MS2C 2 1 C 24 ;T 30 60 ;数据通信 ;设备驱动 ;WDM 中图分类号:T 3 4 P 3 文献标识码 :A
0 引言
在基于DS 的舰船故障信号采集与处理 中, P 需要将处理
操作 。 在写存取时,由/ T O E的上 升沿初始化 H I的写 HS R B P
丽
图 1 MS 2C 2 1的 H I 口与 P I0 0连接 图 T 3060 P接 C 24
P I0 0 C 2 4 的数据 总线HA 1:] MS 2 C 2 1H I D[50与T 30 6 0 P 口 的数 据总线H  ̄HD1 相连 ,用 于主机和D P 输数据 。 D0 5 S传 P I0 0 片的H I C24芯 P 口的H N L 和HC L 引脚 分别与DS C T 1 Nr 0 P Hc L 和Hc L 引脚相连 ,以实现 其对H I NT l Nr 0 P 寄存 器的访 问 。具 体HP 寄 存 器 的 选择 和访 问模 式 的确 定 由DS 的 I P
操作 。 6 HS R B 的下降沿同时锁存输入 IP 在/ T O E - I的控制信 I 号 :H t L、H /W 和 HC L[:】 I WI R# NT 1 。 0 a HS R B 的上升沿锁存 输入的 H [:1 在/ T O E BE 1 以及写 0 操作 中的输入数据 。 1 H I的控制寄存器 . 2 P HI P 通过 3个寄存器完成主机与 DS P的通信 : P 数据 HI 寄 存器( P D 、H I地址 寄器( H I) P HHA) HP 和 I控 制 寄存 器
Mircmp tr p l a o s o 2 , o1,0 8 coo ue A pi t n 1 4N . 2 0 ci V . 1
文章编号 :10 -5X(0 81-0 00 0 777 2 0 )00 4 —2
技 术交 流
微 型 电脑 应 用
20 年 第 2 08 4卷 第 l 期 1
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的数据 ;H N L 1 l C T [: 控制 当前访 问的是 H I的哪一个寄存 O P 器 ;H HWI 号作用是区分第 1 第 2个 h l Or L信 个/ a d的传
地址寄存器( I R) tP HPA 和 t I写地址寄存器( I W) HPA 。HPD I 用于存放主机 从存 储空间读 取的数据 ,或 是主机要 向 DS s P 存储空间中写入的数据 。 I 用于存放当前主机访 问 DS s HPA P 存储空间的地址,HPC寄存 器字长 3 i I 2bt ,但高 1bt 6i和低 1 i对应 同一个物理存储区 ,因此高 1 i和低 1 i的 6bt 6bt 6bt 内容一致 。写 H I PC时 ,必须保证写入数据 的高 1 i和低 6bt