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数字电路与逻辑设计习题及复习资料

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数字电路和逻辑设计基础(含答案)

数字电路和逻辑设计基础(含答案)

数字逻辑习题1.仅用NOR门来构造下面函数的逻辑网络：H=(XY)’Z’
2.仅用NAND门来构造下面的函数的逻辑网络：D=（A+B）B’
3.求出由下面逻辑网络产生的函数G的最简单形式
4.卡诺图化简：G（A，B，C，D）=Σm（2,3,4,7,8,14,15）
5. 卡诺图化简：G（A，B，C，D）=Σm（0,1,3,4,6,7,12,13,14）
6.卡诺图化简：G（A，B，C，D）=Σm（0,4,5,6，7,8,13,14,15）
7．卡诺图化简：G（A，B，C，D）=Σm（1,2,3,4,6,7,9,12,13）
8.采用一个组合电路来控制一个十进制的七段显示，此电路有4个输入，并提供用压缩十进制数表示的4位代码（0（d）=0000,……8(d)=1000,9(d)=1001）。

7个输出用来定义哪段激活，以显示给定的十进制数
（1）写出这个电路的真值表
（2）用sop形式表示真值表
（3）用pos形式表示真值表
（4）写出各段化简的表达式
7.时序电路分析
补充：。

数字电路及逻辑设计复习题

数字电路及逻辑设计复习题

B
&
&
FB
&
≥1
F
C
&
C
&
（C）
（D）
17. 维持阻塞Ｄ触发器电路中，当ＣＰ脉冲升沿过后，输入信号Ｄ改变，则其输出状态 ______。
(Ａ) 不变； (Ｂ) 不定； (Ｃ) 随Ｄ而变
18. 要实现图中各 TTL 门电路输出端所示的逻辑关系,各电路的接法正确的有 ______________。
A B 悬空
)2。
16. 用与非门实现逻辑函数 Z=AB+AC 时，逻辑表达式应写成__________。
真值表
C 00001111 D1 0 0 1 1 0 0 1 1 D2 0 1 0 1 0 1 0 1 F1 F2 17. 填写如图 TTL 电路的真值表。
D1
&
&
F2
D2
EN F1
C
18. 用代数法可把逻辑函数 Z = AB + ABD + AC + BCD 化简为___________。
相异点
模拟多路转换器
数字多路转换器
11. 凡是使电流IL流入反相器的负载，叫做________，使IL从反相器流出的负载，叫做 ________。
数字电路与逻辑设计
第 6 页 共 24 页
数字电路与逻辑设计复习题（共 137 题）
12. 基本ＲＳ、同步ＲＳ、主从ＪＫ和维持阻塞Ｄ四种不同结构的触发器中，可以作计 数器和移位寄存器的有____________________。
| U REF | _____； (2)计数器的位长Ｎ_____。
(Ａ)无关 (Ｂ)成正比 (Ｃ)成反比 (Ｄ)有关，但无确定的比例关系。 5. 某译码电路需要有四种不同的输出状态，那么输入信号至少应有______个。

(完整版)数字电路与逻辑设计试题与答案,推荐文档

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数字电路与逻辑设计(1)班级 学号 姓名 成绩一．单项选择题（每题1分，共10分）1．表示任意两位无符号十进制数需要（ ）二进制数。

A ．6B ．7C ．8D ．9 2．余3码10001000对应的2421码为（ ）。

A ．01010101 B.10000101 C.10111011 D.111010113．补码1．1000的真值是（ ）。

A ． +1.0111 B. -1.0111 C. -0.1001 D. -0. 10004．标准或-与式是由（ ）构成的逻辑表达式。

A ．与项相或 B. 最小项相或 C. 最大项相与 D.或项相与5.根据反演规则，()()E DE C C A F ++⋅+=的反函数为（ ）。

A. E )]E D (C C [A F ⋅++=B. E)E D (C C A F ⋅++=C. E )E D C C A (F ⋅++= D. E)(D A F ⋅++=E C C 6．下列四种类型的逻辑门中，可以用（ ）实现三种基本运算。

A. 与门B. 或门C. 非门D. 与非门7． 将D 触发器改造成T 触发器，图1所示电路中的虚线框内应是（ ）。

图1A. 或非门B. 与非门C. 异或门D. 同或门8．实现两个四位二进制数相乘的组合电路，应有（ ）个输出函数。

A ． 8 B. 9 C. 10 D. 11 9．要使JK 触发器在时钟作用下的次态与现态相反，JK 端取值应为（ ）。

A ．JK=00 B. JK=01 C. JK=10 D. JK=11 10．设计一个四位二进制码的奇偶位发生器（假定采用偶检验码），需要（ ）个异或门。

A ．2 B. 3 C. 4 D. 5二．判断题（判断各题正误，正确的在括号内记“∨”,错误的在括号内记“×”,并在划线处改正。

每题2分，共10分）1．原码和补码均可实现将减法运算转化为加法运算。

（ ）2．逻辑函数7),M(1,3,4,6,C)B,F(A,∏=则m(0,2,5)C)B,(A,F ∑=。

数字电路与逻辑设计习题_4第四章组合逻辑电路剖析

数字电路与逻辑设计习题_4第四章组合逻辑电路剖析

数字电路与逻辑设计习题_4第四章组合逻辑电路剖析第四章组合逻辑电路一、选择题1．下列表达式中不存在竞争冒险的有。

A.Y=B +A BB.Y=A B+B CC.Y =A B C +ABD.Y =(A+B )A D 2．若在编码器中有50个编码对象，则要求输出二进制代码位数为位。

A.5B.6C.10D.503.一个16选一的数据选择器，其地址输入（选择控制输入）端有个。

A.1B.2C.4D.16 4.下列各函数等式中无冒险现象的函数式有。

A.B A AC C B F ++= B.B A BC C A F ++=C.B A B A BC C A F +++=D.C A B A BC B A AC C B F +++++=E.B A B A AC C B F +++= 5．函数C B AB C A F ++=，当变量的取值为时，将出现冒险现象。

A.B=C=1B.B =C=0C.A =1，C=0D.A =0，B=0 6．四选一数据选择器的数据输出Y 与数据输入X i 和地址码A i 之间的逻辑表达式为Y = 。

A.3X A A X A A X A A X A A 01201101001+++B.001X A AC.101X A AD.3X A A 017.一个8选一数据选择器的数据输入端有个。

A.1 B.2 C.3 D.4 E.8 8．在下列逻辑电路中，不是组合逻辑电路的有。

A.译码器B.编码器C.全加器 D.寄存器9．八路数据分配器，其地址输入端有个。

A.1B.2C.3D.4E.8 10．组合逻辑电路消除竞争冒险的方法有。

A. 修改逻辑设计B.在输出端接入滤波电容C.后级加缓冲电路D.屏蔽输入信号的尖峰干扰 11．101键盘的编码器输出位二进制代码。

A.2B.6C.7D.812．用三线-八线译码器74LS 138实现原码输出的8路数据分配器，应。

A.A ST =1，B ST =D ，C ST =0 B. A ST =1，B ST =D ，C ST =D C.A ST =1，BST =0，CST =D D.A ST =D ，BST =0，CST =013．以下电路中，加以适当辅助门电路，适于实现单输出组合逻辑电路。

数字电路与逻辑设计习题及参考答案 精品

数字电路与逻辑设计习题及参考答案 精品

数字电路与逻辑设计习题及参考答案一、选择题1. 以下表达式中符合逻辑运算法则的是 D 。

A.C ·C=C 2B.1+1=10C.0<1D.A+1=12. 一位十六进制数可以用 C 位二进制数来表示。

A . １B . ２C . ４D . 163. 当逻辑函数有n 个变量时，共有 D 个变量取值组合？A. nB. 2nC. n 2D. 2n4. 逻辑函数的表示方法中具有唯一性的是 A 。

A .真值表 B.表达式 C.逻辑图 D.状态图5. 在一个8位的存储单元中，能够存储的最大无符号整数是 D 。

A .（256）10B .（127）10C .（128）10D .（255）106.逻辑函数F=B A A ⊕⊕)( = A 。

A.BB.AC.B A ⊕D. B A ⊕7．求一个逻辑函数F 的对偶式，不可将F 中的 B 。

A .“·”换成“+”，“+”换成“·”B.原变量换成反变量，反变量换成原变量C.变量不变D.常数中“0”换成“1”，“1”换成“0”8．A+BC= C 。

A .A+B B.A+C C.（A+B ）（A+C ） D.B+C9．在何种输入情况下，“与非”运算的结果是逻辑0。

DA ．全部输入是0 B.任一输入是0 C.仅一输入是0 D.全部输入是110．在何种输入情况下，“或非”运算的结果是逻辑1。

AA ．全部输入是0 B.全部输入是1 C.任一输入为0，其他输入为1 D.任一输入为111．十进制数25用8421BCD 码表示为 B 。

A .10 101B .0010 0101C .100101D .1010112．不与十进制数（53.5）10等值的数或代码为 C 。

A .(0101 0011.0101)8421BCDB .(35.8)16C .(110101.11)2D .(65.4)813．以下参数不是矩形脉冲信号的参数 D 。

A.周期B.占空比C.脉宽D.扫描期14．与八进制数(47.3)8等值的数为： BA. (100111.0101)2B.(27.6)16C.(27.3 )16D. (100111.101)215. 常用的BCD码有 D 。

数字逻辑及电路复习题及答案

数字逻辑及电路复习题及答案

"数字逻辑与电路"复习题第一章数字逻辑根底〔数制与编码〕一、选择题1．以下代码中为无权码的为 CD。

A. 8421BCD码B. 5421BCD码C.余三码D.格雷码2．以下代码中为恒权码的为 AB 。

A.8421BCD码B. 5421BCD码C. 余三码D. 格雷码3．一位十六进制数可以用 C 位二进制数来表示。

A. １B. ２C. ４D. 164．十进制数25用8421BCD码表示为 B 。

A. 10 101B. 0010 0101C. 100101D. 101015．在一个8位的存储单元中，能够存储的最大无符号整数是 CD 。

A.〔256〕10B.〔127〕10C.〔FF〕16D.〔255〕10 6．与十进制数〔53.5〕10等值的数或代码为 ABCD 。

A.(01010011.0101)8421BCDB.(35.8)16C.(110101.1)2D.(65.4)87．与八进制数(47.3)8等值的数为：A B 。

A.(100111.011)2B.(27.6)16C.(27.3 )16D. (100111.11)28.常用的BC D码有C D 。

A.奇偶校验码B.格雷码C.8421码D.余三码二、判断题〔正确打√，错误的打×〕1. 方波的占空比为0.5。

〔√〕2. 8421码1001比0001大。

〔×〕3. 数字电路中用"1〞和"0〞分别表示两种状态,二者无大小之分。

〔√〕4．格雷码具有任何相邻码只有一位码元不同的特性。

〔√〕5．八进制数〔17〕8比十进制数〔17〕10小。

〔√〕6．当传送十进制数5时，在8421奇校验码的校验位上值应为1。

〔√〕7．十进制数〔9〕10比十六进制数〔9〕16小。

〔×〕8．当8421奇校验码在传送十进制数〔8〕10时，在校验位上出现了1时，说明在传送过程中出现了错误。

〔√〕三、填空题1.数字信号的特点是在时间上和幅值上都是断续变化的，其高电平和低电平常用 1和 0来表示。

数字电路与逻辑设计复习题

数字电路与逻辑设计复习题

22. (8A)H=(
)10
23. 数制转换及表示：(BCD 码为 8421BCD 码)
（１） （１１１０００１）2＝（ （２） （３５.１２５）10＝（
）10＝（
）16
）2＝（
）BCD
24. 用代数法可把逻辑函数 Z = AB + ABD + AC + BCD 化简为
_________________________。
A B 悬空
&
F = AB
A B
（A）
& F = AB
Aபைடு நூலகம்B
悬空
（B）
≥1 F = A+B
（C）
A B
≥1 F = A+B
A B
≥1 F = A+B
100Ω
5.1KΩ
（D）
（E）
数字电路与逻辑设计
第 2 页 共 15 页
数字电路与逻辑设计复习题
19. 已知某组合电路的卡诺图如图所示,则此组合电路为_____。
25. 要把逻辑函数 Z = A BC DE 用与或非门来实现，应写成__________________。
26. 由ｎ个Ｄ触发器构成的环形计数器，其有效计数状态共有_____个。 三、作图题 (注:请按题目要求绘出波形图或电路图等)
1. 如图（a）所示，电路是由 T’触发器构成的计数电路，试画出与图（ｂ）时钟脉冲
输出
P1
P2
10
11
00
00
输入 ABC 100 101 110 111
输出 P1 P2 11 01 00 01
3. 已知Ａ、Ｂ、Ｃ、Ｄ的波形，如图所示。请画出逻辑函数Ｆ的波形。已知：

数字电路与逻辑设计复习

数字电路与逻辑设计复习
(4)给定F的或与表达式求F的标准与非-与非表达式: 由F的或与表达式→卡诺图→得到F的与或表达式→两次求反→ F的标准或非-或非表达式
第二章 逻辑函数及其简化 公式法化简
① F=(A⊕B)(B⊕C) ●A+B+A+C
解: F=[(A⊕B)(B⊕C) +A+B] ●(A+C) =[(AB+AB)(BC+BC)+A+B) ●(A+C)
第二章 逻辑函数及其简化 1 若A、B、C、D、E为某逻辑函数输入变量，函数的最大项表达式 所包含的最大项的个数不可能是： A 32 B 15 C 31 D 632 2 以下表达式中符合逻辑运算规则的是： A. C●C=C2 B. 1+1=10 C. 0﹤1 D. A+1=1 3 符合逻辑运算规则的是: A. 1×1=1 B. 1+1=10 C. 1+1=1 D. 1+1=2 4 逻辑函数F=AB+CD+BC的反函数F是:_____;对偶函数F﹡是:____; 5 逻辑代数的三个重要规则是:_________,__________,_________ 当逻辑函数有n个变量时,共有____种变量取值组合。 6 异或与同或在逻辑上正好相反，互为反函数，对吗？ 7 逻辑变量的取值，1比0大，对吗？ 8 F=A⊕B⊕C=A⊙B⊙C,对吗? 答案：1. D 2. D 3. C 4. ___ 5. ____ ____ 6. √ 7. × 8. √
第一章 绪论 1．数制的转换 (1)任意进制→十进制(按位权展开相加) (2)十进制→任意进制(除R取余,乘R取整) (3) 二进制--八进制--十六进制(中介法) (4)精度要求(1/Ri＜精度要求值) 2．常用的BCD码 有权码(8421码、2421码、5121码、631-1码) 无权码(余3码，移存码、余3循环码)。

数字电路与逻辑设计总复习题

数字电路与逻辑设计总复习题

(2)若F(A,B,C)= ∏M( 3, 5, 6, 7) , 则F(A,B,C)=∑m(?)。 解: ∵ F(A,B,C)= ∏M( 3, 5, 6, 7) , 则 F(A,B,C)= ∑ m( 0 , 1 , 2 , 4 ) F(A,B,C)= ∑m( 3, 5, 6, 7)
(5)试写出下列各函数表达式F的F和F′的最小项表 达式。 (1) F ABCD ACD BC D (2) F AB A B BC
=∏(0,1,3)
(3)F(A,B,C)=1⊕A⊕BC=∑m(?)
解: F(A,B,C)= A ⊕ BC
= A· + A · BC BC =A (B + C ) +ABC = A B +A C +ABC
F(A,B,C)= ∑( 0, 1, 2 ,7 )
八、若F1(A,B,C)=∑m(0, 1, 2, 3) ， F2(A,B,C)=∏M(0, 1, 2, 3) , 则F1⊕ F2=（ ? ）。 解:
= A (B C + B) + B + C =A( B +C ) + B + C =A+ B + C + B + C =A+ 1 = 1
解: F=A B( C + D )+B C+A B+A C+B C+B C D =A B C+A B D+B+A B+A C +B C D =A C+A D + B + A +A C +C D =C + D +B +A +C D
ABCD=0001 F=0⊕0⊕0⊕0=0 ABCD=0010 F=0⊕0⊕1⊕1=0

数字电路与逻辑设计期末复习试题3套(大学期末复习资料).docx

数字电路与逻辑设计期末复习试题3套(大学期末复习资料).docx

试题一一、填空题。

(每空1分，共30分)。

1、(11001.01)2 =( )8=( )|6=( )102、十进制整数转换成二进制时采用 ______ 法；十进制小数转换成二进制时采用 _______ 法。

3、由三种最基本的逻辑关系有导出的几种常用的逻辑运算 ________ 、4、逻辑函数有四种表示方法，它们分别是 _______ 、_____ 、____ 和 _______ O5、消除竞争冒险的方法有 _____ 、______ 、_____ 等。

6、按逻辑功能分类，触发器可分为 _______ 、_______ 、________________ 等四种类型。

7、从结构上看，吋序逻辑电路的基本单元是 ___________ 。

8、J K触发器特征方程为____________ o9、A/D转换的一般步骤为：取样、 _______ 、_______ 、编码。

10、___________________________________________________ 一个EPROM有18条地址输入线，其内部存储单元有_____________ 个。

11、_____________________________ D/A转换器的主要参数有、和o12、__________________________________________________ 就逐次逼近型和双积分型两种A/D转换器而言，____________________ 的抗干扰能力强， _______ 的转换速度快。

二、选择题。

(每题1分，共15分)1、以下说法正确的是()：(A)数字信号在大小上不连续，时间上连续，模拟信号则反之；(B)数字信号在大小上连续，时间上不连续，模拟信号则反之；(C)数字信号在大小和时间上均连续，模拟信号则反之；(D)数字信号在大小和吋间上均不连续，模拟信号则反之；2、A+BC=()。

(A)A+B (B) A+C (C) (A+B) (A+C) (D) B+C3、具有“有1出0、全0出1”功能的逻辑门是()。

数字电路逻辑设计复习题

数字电路逻辑设计复习题

数字电路逻辑设计A复习题一、单选题（每小题2分，共计20分。

）1.一个比特时间是1ms,串行传输8个比特所需要的时间是（）。

A.1msB.16msC.8ms答案：C知识点：第一章难度：1解析：串行传输比特只能一个比特一个比特的传输，传输8个比特则需要8倍的比特时间，即8ms2.写出下图的比特序列是（）。

CLKAA.010*********B.001100110011C.000011110000答案：B知识点：第一章难度：2解析：一个比特持续一个时钟周期，因此波形A的每一个高低电平均持续了两个时钟周期，比特序列即为：001100113.当与门的输入是什么状态时与门的输出是高电平（）。

A.任意一个输入是高电平B.全部输入都是高电平C.没有输入是高电平答案：B知识点：第二章难度：2解析：与门的逻辑功能：输入全部是高电平时输出才是高电平。

4.由5级触发器构成的二进制计数器，能计数的最大模是（）。

A.16B.32C.10答案：B知识点：第六章难度：3解析：若有n级触发器，则可计数的最大模是2n，当n=5时，则可计数的最大模是25=32。

5.JK触发器状态置1时J、K输入端状态是（）。

A.J=1，K=1B.J=0，K=1C.J=1，K=0答案：C知识点：第五章难度：1解析：JK触发器的动作特点：当J=1，K=0时，JK触发器置1。

二、填空题（每空2分，共计20分。

）1.数制转换(1100111)2=( )10=( )8答案：(1100111)2=( 103 )10=( 147 )8知识点：第一章难度：2解析：二进制数转换成十进制数：把非零位的权相加，本题中1100111=1+2+4+32+64=103。

2.数字电路可分为两大类：组合逻辑电路和（）。

答案：时序逻辑电路知识点：第四章有关的时序逻辑电路。

3.描述一种逻辑功能的方法有逻辑表达式、（）和（）等。

答案：逻辑电路图和卡诺图、输入输出波形知识点：第三章难度：2解析：描述一种逻辑功能的方法有：真值表，逻辑表达式，逻辑电路图，逻辑功能描述，卡诺图，输入输出波形等，可以用不同的方法描述同一种逻辑功能。

数字电路与数字逻辑(高起专)

数字电路与数字逻辑(高起专)

离线考核《数字电路与数字逻辑（高起专）》满分100分一、解答题（每小题10分，共30分。

）1、利用卡诺图法化简：)11,10()14,13,9,8,7,6,5,2,1,0(),,,(d m D C B A L 。

答：F=C B A BC A C AB ABC =m 3d 3+m 5d 5+m 6d 6+m 7d 7则d 3 d 5 d 6 d 7为1，其他为0，画图略。

2、用译码器74138和适当的逻辑门实现函数C B A F 。

答：F = Y 3 Y 4Y 5 Y 73、分析此组合逻辑电路的逻辑功能：答：)(BC A BD A D B D C D C B A 或Y Y Y Y F 7421•••B A F 异或操作二、画图题（每小题10分，共30分。

）1、 下降沿触发的主从RS 触发器输入信号波形如下图所示，请画出输出端Q 、的对应波形。

（设触发器初态为0）答：2、 上升沿触发的维持-阻塞D触发器输入信号波形如下图所示，请画出输出端Q、的对应波形。

（设触发器初态为0）答：3、如题下图所示的电路和波形，试画出Q端的波形。

设触发器的初始状态为Q=0。

答：三、分析题（共10分）1、分析如下时序电路，写出驱动方程、输出方程、状态方程、列出状态转换表、画出状态转换图。

答：分析=D3=D2D= +1Z====+DZ10 0 0 1 0 0 1 00 0 1 0 0 1 0 00 1 0 1 1 0 1 01 0 1 1 0 1 1 10 1 1 0 1 1 0 01 1 0 0 1 0 0 11 0 0 0 0 0 0 11 1 1 1 1 1 1 1四、设计题（每题15分，共30分。

）F ，1、设计一个带控制端的组合逻辑电路，控制端X=0时，实现F=A+B，控制端X=1时，实现AB请用74LS138 和必要的门电路实现。

答：（1）、真值表X A B F0 0 0 00 0 1 10 1 0 10 1 1 11 0 0 11 0 1 11 1 0 11 1 1 0（2）、代数式：，，，F，m51(，4)632（3）、画电路图：2、画出符合以下关系的010序列检测器的状态转换图，X为序列输入，Z为检测输出。

数字电路与逻辑设计考核试卷

数字电路与逻辑设计考核试卷
C.编码器
D.触发器
12.以下哪些是数字电路设计中常用的设计原则？( )
A.最小化原则
B.最优化原则
C.模块化原则
D.可测试性原则
13.以下哪些部件可以实现数字信号的放大和驱动？( )
A.逻辑门
B.触发器
C.译码器
D.驱动器
14.以下哪些是常见的数字电路测试方法？( )
A.静态测试
B.动态测试
C.功能测试
A. RS触发器
B.加法器
C. D触发器
D. JK触发器
2.以下哪些逻辑门可以实现“逻辑非”功能？( )
A.非门
B.或非门
C.与非门
D.异或门
3.以下哪些编码方式属于二进制编码？( )
A. BCD码
B.格雷码
C.汉明码
D. 8421码
4.以下哪些是组合逻辑电路的例子？( )
A.译码器
B.计数器
C.多路选择器
4.二进制编码中，8421码是一种______编码方式。
5.在时序逻辑电路中，触发器在______的作用下改变状态。
6.数字电路设计中，为了减少“竞争-冒险”现象，可以采取增加______或使用______等方法。
7.在数字电路中，______用于实现数据的串行到并行转换，而______用于实现数据的并行到串行转换。
A.时钟信号
B.同步复位
C.异步复位
D.双沿触发
（结束）
三、填空题（本题共10小题，每小题2分，共20分，请将正确答案填到题目空白处）
1.在数字电路中，基本逻辑门包括与门、或门、非门和______门。
2.一个触发器能够存储一个二进制位，通常称为一个______。
3.在组合逻辑电路中，输出仅仅取决于输入信号的______和______。

数字电路和逻辑设计基础(含答案)(精编文档).doc

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数字逻辑习题
1.仅用NOR门来构造下面函数的逻辑网络：H=(XY)’Z’
2.仅用NAND门来构造下面的函数的逻辑网络：D=（A+B）B’
3.求出由下面逻辑网络产生的函数G的最简单形式
4.卡诺图化简：G（A，B，C，D）=Σm（2,3,4,7,8,14,15）
5. 卡诺图化简：G（A，B，C，D）=Σm（0,1,3,4,6,7,12,13,14）
6.卡诺图化简：G（A，B，C，D）=Σm（0,4,5,6，7,8,13,14,15）
7．卡诺图化简：G（A，B，C，D）=Σm（1,2,3,4,6,7,9,12,13）
8.采用一个组合电路来控制一个十进制的七段显示，此电路有4个输入，并提供用压缩十进制数表示的4位代码（0（d）=0000,……8(d)=1000,9(d)=1001）。

7个输出用来定义哪段激活，以显示给定的十进制数
（1）写出这个电路的真值表
（2）用sop形式表示真值表
（3）用pos形式表示真值表（4）写出各段化简的表达式
7.时序电路分析
Q
Q
SET
CLR
D
X
Clock
Y
补充：
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《数字电路与逻辑设计》综合练习题及解答

《数字电路与逻辑设计》综合练习题及解答

《数字电路与逻辑设计》综合练习题及解答第一部分习题一、填空1.将十进制数转换成等值的二进制数、十六进制数。

(51.62510 = ( 2= ( 162.(199710= ( 余3BCD = ( 8421BCD3.(BF.516= ( 24.一位二进制数只有2个数,四位二进制数有个数;为计64个数,需要位二进制数。

5.二进制数(1101.10112的等值八进制数是( 8。

6.二进制数(1101.1012的等值十进制数是( 10。

7.欲对100个对象进行二进制编码,则至少需要( 位二进制数。

8.二进制数为000000~111111能代表( 个十进制整数。

9.为将信息码10110010配成奇校验码,其配奇位的逻辑值为 ;为将信息码01101101配成偶校验码,其配偶位的逻辑值为。

10.格雷码的特点是。

11.n 变量函数的每一个最小项有个相领项。

12.当j i ≠时,同一逻辑函数的两个最小项j i m m ⋅=( 。

13.n 变量的逻辑函数,i m 为最小项,则有∑-=120n i i m =( 。

14.逻辑函数D C B A F ++=的反函数F = ( 。

15.逻辑函数(C B A F +=的对偶函数F '是 ( 。

16.多变量同或运算时, =0,则i x =0的个数必须为( 。

17.逻辑函数AB C B A F ⊕⊕=1,,(的最小项表达式为,,(C B A F =( 。

18. 逻辑函数14,12,0(10,8,4,3,2,1(,,,(∑∑Φ+=m D C B A F 的最简与或式为F =( 。

19.逻辑函数((,,(C B A C B A C B A F ++++=的最简与或式为( 。

20.巳知函数的对偶式BC D C B A D C B A F ++=',,,(,则它的原函数F =( 。

* * * * *21.正逻辑约定是( 、( 。

22.双极型三极管由截止状态过渡到饱和状态所需的过渡时间称为时间,它由时间和时间两部分组成,可用等式描述。

数字电路与逻辑设计习题及参考答案全套

数字电路与逻辑设计习题及参考答案全套

数字电路与逻辑设计习题及参考答案一、选择题1. 以下表达式中符合逻辑运算法则的是 D 。

A.C ·C=C 2B.1+1=10C.0<1D.A+1=12. 一位十六进制数可以用 C 位二进制数来表示。

A . １B . ２C . ４D . 163. 当逻辑函数有n 个变量时，共有 D 个变量取值组合？A. nB. 2nC. n 2D. 2n4. 逻辑函数的表示方法中具有唯一性的是 A 。

A .真值表 B.表达式 C.逻辑图 D.状态图5. 在一个8位的存储单元中，能够存储的最大无符号整数是 D 。

A .（256）10B .（127）10C .（128）10D .（255）106.逻辑函数F=B A A ⊕⊕)( = A 。

A.BB.AC.B A ⊕D. B A ⊕7．求一个逻辑函数F 的对偶式，不可将F 中的 B 。

A .“·”换成“+”，“+”换成“·”B.原变量换成反变量，反变量换成原变量C.变量不变D.常数中“0”换成“1”，“1”换成“0”8．A+BC= C 。

A .A+B B.A+C C.（A+B ）（A+C ） D.B+C9．在何种输入情况下，“与非”运算的结果是逻辑0。

DA ．全部输入是0 B.任一输入是0 C.仅一输入是0 D.全部输入是110．在何种输入情况下，“或非”运算的结果是逻辑1。

AA ．全部输入是0 B.全部输入是1 C.任一输入为0，其他输入为1 D.任一输入为111．十进制数25用8421BCD 码表示为 B 。

A .10 101B .0010 0101C .100101D .1010112．不与十进制数（53.5）10等值的数或代码为 C 。

A .(0101 0011.0101)8421BCDB .(35.8)16C .(110101.11)2D .(65.4)813．以下参数不是矩形脉冲信号的参数 D 。

A.周期B.占空比C.脉宽D.扫描期14．与八进制数(47.3)8等值的数为： BA. (100111.0101)2B.(27.6)16C.(27.3 )16D. (100111.101)215. 常用的BCD码有 D 。

数字电路与逻辑设计复习资料(含规范标准答案)

数字电路与逻辑设计复习资料(含规范标准答案)

数字电路与逻辑设计复习资料一、单项选择题1. 十进制数53转换成八进制数应为（ B ）。

A. 64 B.65 C. 66 D. 1101012.将十进制数(18)10 转换成八进制数是（B ）。

A. 20 B.22 C. 21 D. 233. 十进制数53转换成八进制数应为（ D ）。

A. 62 B.63 C. 64 D. 654. 当逻辑函数有n 个变量时，共有（ D ）种取值组合。

A. n B. 2n C. 2n D. 2n5. 为了避免干扰，MOS 与门的多余输入端不能（ A ）处理。

A. 悬空 B. 接低电平 C. 与有用输入端并接 D. 以上都不正确6. 以下电路中可以实现“线与”功能的有（ C ）。

A. TTL 与非门B. TTL 或非门C. OC 门D. TTL 异或门 7. 用6264型RAM 构成一个328K ⨯位的存储器，需要（ D ）根地址线。

A. 12 B. 13 C. 14 D. 158. 同步时序电路和异步时序电路比较，其差异在于后者（ B ）。

A. 没有触发器 B. 没有统一的时钟脉冲控制 C. 没有稳定状态 D. 输出只与内部状态有关9. 用6264型RAM 构成3232K ⨯位的存储器，需要（ D ）片进行扩展。

A. 4 B.8 C. 14 D.16 10. 逻辑函数()F A A B =⊕⊕ =（ D ）。

A. A B eB. AC. A B ⊕D. B 11. 函数F ABC ABCD =+的反函数为（ C ）。

A. ()()F A B C A B C D =+++++ B. ()()F ABC ABCD =C. ()()F A B C A B C D =+++++D. F A B C A B C D =++++++ 12.在图1所示的T T L 电路中，输出应为（ B ）。

A . F ＝0 B. F ＝1 C. F ＝A D. F ＝A图113. 将F ABC A CD CD =++展开成最小项表达式应为（ A ）。

数字电路与逻辑设计复习题

数字电路与逻辑设计复习题

数字电路与逻辑设计复习题一、填空题1．将十进制数转换成等值的二进制数、八进制数、十六进制数。

(23.375)10=( )2=( )8=( )162．十进制数74的余3BCD码是。

3．逻辑函数BCCDBA+++))((的对偶式和反演式（用反演规则）分别为：对偶式：；反演式：；4．若采用奇较验方式，信息码为1000101的校验码为。

5．若采用偶较验方式，信息码1101101校验位为。

6．钟控RS触发器的特征方程是，约束条件是。

7．同步RS触发器的特性方程为Q n+1=_______ _____；约束方程为。

8．四位同步二进制加法计数器的初始状态为Q3Q2Q1Q0=1101,经过3个CP时钟脉冲作用后，它的状态为Q3Q2Q1Q0= 。

9．触发器有个稳态，存储8位二进制信息要个触发器。

10．四位同步二进制减法计数器的初始状态为Q3Q2Q1Q0=1101,经过5个CP时钟脉冲作用后，它的状态为Q3Q2Q1Q0= 。

11．OC门称为门，多个OC门输出端并联到一起可实现功能12．三态门的三种可能的输出状态是、、。

13．具有16位地址码可同时存取8位数据的RAM集成片，其存储容量为。

14．具有13位地址码可同时存取8位数据的RAM集成片HM6264，其存储容量为。

15．常用的脉冲单元电路有、、和。

16．（2008）10=（）余3BCD。

17．若(,,)(0,1,3,5,7)mF A B C=∑，则：*(,,)F A B C=，(,,)F A B C=。

18数字电路按照是否有记忆功能通常可分为和两类。

19．74LS00是 类型的门电路，CC4069是 类型的门电路。

（选择填TTL 或CMOS ）20．一数据选择器，A1A0为地址信号，D 1=1，D 2=1,D 0=D 3=C;当A1A0=01时，F= ;当A1A0=10时，输出F= 。

21．共阳接法的发光二极管数码显示器，应采用 电平驱动的七段显示译码器。

二.单项选择题1．属于组合逻辑电路的是（ ）。

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数字电路与逻辑设计模拟题一、 选择题1、（36.7）10 的8421BCD 码为。

（） A 、（0110110.101）8421BCD B 、（0011110.1110）8421BCD C 、（00110110.0111）8421BCD D 、（110110.111）8421BCD2、与（6B.2）16相对应的二进制数为（） A 、（1101011.001）2 B 、（01101010.01）2 C （11101011.01）2 D 、（01100111.01）23、在BCD 码中，属于有权码的编码是（）A 、余3码B 、循环码C 、格雷码D 、8421码 4、如图1-1所示门电路，按正逻辑体制，电路实现的逻辑式F=（）5、如果1-2所示的波形图，其表示的逻辑关系是（）6、下列器件中，属于组合电路的有（）A 、计数器和全加器B 、寄存器和比较器C 、全加器和比较器D 、计数器和寄存器7、异或门F=A ⊕B 两输入端A 、B 中，A=0，则输出端F 为（） A 、A ⊕B B 、B C 、B D 、08、已知4个组合电路的输出F1～F4的函数式非别为：F 1=AB+A C ，F 2=AB+A CD+BC ，F 3=A B +B C ，F 4=（A+B ）·（A +C ），则不会产生竞争冒险的电路是( ) A 、电路1 B 、电路2 C 、电路3 D 、电路4 9、边沿触发JK 触发器的特征方程是（） A 、θ1+n =J nθ+k nθ B 、θ1+n =J nθ+k nθ C 、θ1+n =J nθ+k n θ D 、θ1+n =J nθ+K nθ10、用n 个出发器件构成计数器，可得到的最大计数长度为（ ） A 、n B 、2n C 、n 2D 、2n11、（011001010010.00010110）8421BCD 所对应的十进制数为（） A 、（652.16）10 B 、（1618.13）10C 、（652.13）10D 、（1618.06）1012、八进制数（321）8对应的二进制数为（） A 、（011010001）2 B 、（110011）2 C 、（10110111）2 D 、（1101011）213、与（19）10相对应的余3BCD 码是（） A 、（00101100）余3BCD B 、（01001100）余3BCDC 、（00110101）余3BCD D 、（01011010）余3BCD 14、如图1-3所示门电路，按正逻辑体制，电路实现的逻辑关系F=（） A 、C B A ⋅⋅ B 、C B A ⋅⋅ C 、A+B+C D 、C B A ++图1-315、如图1-4所示的波形图表示的逻辑关系是（） A 、F=B A ⋅ B 、F=A+B C 、F=B A ⋅ D 、F=B A +16、已知逻辑函数的卡诺图如图1-5所示能实现这一函数功能的电路是（）17、组合逻辑电路的特点是（）A 、含有存储元件B 、输出、输入间有反馈通路C 、电路输出与以前状态有关D 、全部由门电路构成18、函数F=C B AB C A ⋅++，当变量取值为（），不会出现冒险现象。

A 、B=C=1 B 、B=C=0 C 、A=1，C=0 D 、A=B=0 19、由与非门组成的基本RS 触发器的特性方程是（）A 、⎪⎩⎪⎨⎧=++=+100001S R R S n n θθB 、⎩⎨⎧=++=+100001S R R S n n θθC 、⎩⎨⎧=++=+100001S R R S n n θθD 、⎪⎩⎪⎨⎧=++=+100001S R R S n n θθ20、4个触发器构成8421BCD码计数器，共有（）个无效状态。

A、6B、8C、10D、不定二、填空题1、（67）10所对应的二进制数为和十六进制数为。

2、逻辑函数F=AB+A B的对偶函数Fˊ=3、在数字逻辑电路中，三极管主要工作在两种稳定状态。

4、如图2-1所示电路能实现的逻辑关系是F= 。

5、CMOS传输门组成的电路如图2-2所示，当C=0时，U0= ，当C=1时，U0= 。

6、四选一数据选择器，AB为地址信号，I0=I3=1，I1=C，I2=C，当AB=00时，输出F= ；当AB=10时，输出F= 。

7、3线―8线译码器如图2-3所示，他所实现函数F= 。

8、时序逻辑电路一般由和两分组成。

9、半导体存储器，根据用户对存储器进行操作分为和两大类。

10、十进制数（56）10转换为二进制数为和十六进制数为11、逻辑函数F=A·（B+C）·1的反函数F=12、由于二极管具有特性，因此可作为开关元件使用。

13、由oc门构成的电路如图2-4所示，F的表达式为14、如图2-5所示电路中，F 的表达式为15、八选一数据选择器电路如图2-6所示，他所实现函数F=16、3线-8线译码器电路如图2-7所示，它所实现函数 F 1= ；F 2= 。

17、JK 触发器，要使n n θθ=+1，则输入J=K= ；或J= ，K=18、 型时序电路的输出不仅与电路内部的状态有关，且与外输入有关。

型时序电路的输出仅与电路内部的状态有关。

19、RAM 由若干基本存储电路组成，每个基本存储电路可存放 。

三、分析化简题 1、化简函数（1）Y 1=（B A B A +·C+C B A ）·（AD+BC ）（代数法化简）（2）Y2=AB+B D +BCD+A B C （卡诺图化简） （3）Y 3（A 、B 、C 、D ）=)14,12,4,2,1(∑m +∑)10,9,8,7,6,5(φ（∑m 为函数Y 的最小项和，∑φ为任意项和）（卡诺图化简） 2、电路如图3-1所示，分析电路逻辑功能。

3、分析图3-2所示电路的逻辑功能，写出电路的驱动方程，状态方程和输出方程，画出电路的状态转换图和时序图。

4、图3-3所示电路由555定时器构成，它是什么电路？已知定时电阻R=11 K Ω，要求输出脉冲宽度t w =1秒，试计算定时电容C 的数值？5、图3-4电路中74LS290已接成异步十进制计数器，θ0为最低位，θ3为最高位，设计数器输出高电平为 3.5v ，低电平为0v 。

当θ3θ2θ1θ0=0101时，求输出电压U 0的值？6、化简函数（1）Y 1=BD B A D C A B A +++⋅ （代数法化简） （2）Y 2=CD D A C A ++ （卡诺图化简） （3）Y 3（A 、B 、C 、D ）=∑∑+）、、、、、（）、、、、（15141312111097531φm （∑m 为函数Y3的最小项和，∑φ为任意项和）（卡诺图化简） 7、电路如图3-5所示，分析电路逻辑功能。

（本题8分）8、分析图3-6所示电路的逻辑功能，写出电路的驱动方程，状态方程和输出方程，画出电路的状态转换图，并说明该电路能否自启动。

9、由555定时器构成的多谐振动器如图3-7所示，已知R 1=1K Ω，R2=8.2K Ω，C=0.1μF 。

试求脉冲宽度T 1，振荡频率f 和占空比q 。

10、图3-8所示电路是倒T 形电阻网络D/A 转换器，已知R=10K Ω，U REF =10V 。

试求：（1）U 0输出范围；（2）当D 3D 2D 1D 0=0110时，U 0=？四、设计题1、用如下器件实现函数Y=A ⊕B ⊕C ，画出逻辑图（或阵列结构图）。

（1）与非门；（2）3线―8线译码器（74LS138）和与非门； （3）八选一数据选择器（74LS151）； （4）ROM 的阵列结构图。

2、试用置零法将4位同步二进制计数器74LS161接成十三进制计数器，并画出状态转换图，可以附加必要的门电路。

3、用如下器件实现函数Y=（A ⊕B ）∙C+C B A ⋅⊕画出逻辑图（或阵列结构图）。

（1）与非门； （2）3线-8线译码器（74LS138）和与非门； （3）八选一数据选择器（74LS151）； （4）ROM 的阵列结构图。

4．试用置零法将4位同步二进制计数器74LS161接成八进制计数器，并画出状态转换图，可以附加必要的门电路。

数字电路与逻辑设计模拟参考答案一、1、C2、A3、D4、B5、C6、C7、B8、B9、C 10、D 11、A 12、A 13、B 14、C 15、D 16、D 17、D 18、B 19、C 20、A 二、1、（1000011）2 ，（43）162、（A+B ）·（B A +）3、饱和及截止4、A C B C ⋅+⋅5、U i1，U i26、1，C7、m 1+m 3+m 4+m 5+m 68、1 9、组合逻辑电路，存储电路 10、只读存储器，随机读写存储器 11、（111000）2，（38）16 12、C B A ⋅+ 13、单向导电14、F=A ⊕B 15、F=B A +=B A 16、C B C A B A ++ 或 B A C A C B ++18、1，nθ nθ 19、米利，17、m 1+m 2+m 3+m 7，m 3+m 5+m 6+m 7摩尔20、一位二值代码三、1、（1）Y 1=ACD+ABC （2）Y 2 =AB+B D +A CD（3）Y3=B D +C D +A C D2、（1）写出逻辑函数式F=ABC C ABC B ABC A ⋅+⋅+⋅=）（C B A ABC ++=ABC+C B A ++=ABC+A B C （2（3）由真值表可知当ABC=000或111时 F=1，否则F=0 所以该电路为“一致电路” 3、（1）驱动方程⎪⎩⎪⎨⎧==1010K J nθ ⎩⎨⎧==1101K J n θ （2）状态方程⎪⎩⎪⎨⎧==++nn n n on n 1011110θθθθθθ （3）输出方程 Z=n1θ（4）状态转换图 Zθ1θ01（5）时序图此电路是一个同步三进制加法计数器电路可自启动。

4、构成单稳态触发器 ∵t w =1.1RC ∴C=R 1.11=310101.11⨯⨯=0.083⨯10-3F=83F μ 5、I Z =（15.33θ+25.32θ+45.31θ+85.30θ） U 0=―R F I Z =―2（15.33θ+25.32θ+45.31θ+85.30θ） 当θ3θ2θ1θ0=0101时 U 0=―（25.3+85.3）⨯2=―（3.5+0.875）=―4.375V 6、（1）Y 1=BD B A D C A B A ⋅++⋅=D C A B A +=A+D C A B +=A+B （2）Y 2=D C A +（3）Y 3=D7、（1）写出输出函数表达式））（（）（B A B A B A AB AB B AB A AB B AB A F ++=+=+⋅=⋅⋅=1 =B A B A +=BA ⊕B A AB F ⋅==2（2）列真值表（3）由真值表可知，F 1和AB 是异或关系，相当于两个一位二进制数相加所得的本位和数；F 2是A 和B 的逻辑与，相当于两数相加的进位数，所以该电路是由两个一位二进制数相加的加法电路，又称为半加器。