电子科技大学年数字电路试题

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让每个人平等地提升自我

1 电子科技大学

2004年攻读工程硕士专业学位研究生入学试题

考试科目：数字电路

注意事项：

所有答案必须写在答题纸上，否则答案无效。

一、单项选择题（20分，每小题2分）

1．（25.1）10的二进制数是（）。

A. 10011.0001 B. 11001.0001 C. 10011.1000 D. 10011.1000

2．11101的补码是（）。

A. 00011 B. 00010 C. 10011 D. 10010

3．正逻辑的“或”门在负逻辑中是（）门。

A. 或门 B. 与门 C. 或非门 D. 与非门

4．若输入变量A，B全为1时，输出F=0，则其输出与输入的关系是( )。

A. 异或 B. 同或 C．与非 D. 或非

5．已知F=BDABC，选出下列（）可以肯定使F=0的情况：

A. A=0,BC=1 B. B=1,C=1 C. C=1,D=0 D. BC=1,D=1

6．n变量的最小项应有（）个。

A. n B. 2n C．n2 D. 2n

7．逻辑函数)(CABAF的对偶函数'F是（）。

A.)('CABAF B. )('CABAF C. )('CABAF D. )('CABAF

8．时序逻辑电路中一定包含( )。

A. 触发器 B. 组合逻辑电路 C. 移位寄存器 D. 存储器

9．如右图所示逻辑电路的逻辑关系是（）。

A. ABBAF B. ))((BABAF

C. BAABF D.))((BABAF

10．))((CABAF＋＋，当B=0，且（）时，电路存在竞争-冒险。

A. 0A B. 1A C. 0C D.1C

二、化简（10分，每小题5分）

1. 用公式法化简下列逻辑函数为F积之和式。

CABCBBCAACF＋

2. 用卡若图法化简)15,11,7,5,3,1()13,9,6,4,0(),,,dmDCBAF（为最简与或式。

图一百度文库

让每个人平等地提升自我

2 三、某门的两个输入变量A、B的状态波形如下图所示。•试画出与门输出变量Y1的状态波形；或非门输出变量Y2的状态波形；异或门输出变量Y3的状态波形；BAY4的输出波形。（12分）

四、设X是两位二进制数，请设计一逻辑电路使其输出Y满足12XY。（10分）

五、试分析图中电路的逻辑功能。写出输出Z1，Z2，Z3的表达式。四选一数据选择器74LS153和3线 8线译码器74LS138的逻辑功能分别见下式。74LS318选通时，S1 = 1 , S2 = S3 = 0。（15分）

SDAADAADAADAAY•)(301201101001

012701210120,,,AAAYAAAYAAAY

六、(1)同步RS触发器的CP、R、S端状态波形如下左图所示。试画出Q端的状态波形。设初始状态Q＝0。（2）主从T触发器的T、CP端的电压波形如下右图所示，试画出Q端的状态波形。设初始状态Q＝0。

（10分）

七、试分析下列电路为几进制计数器。 (10分)

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3 八、设计一个能自动启动的3位环形计数器，它的有效循环状态为110101011110。要求画出状态转换图、写出驱动方程、画出逻辑电路图。（13分）

数字电子技术试题库及答案

精品文档

. 数字电子技术期末试题库

一、选择题：

A组：

1.如果采用偶校验方式，下列接收端收到的校验码中，（ A ）是不正确的

A、00100 B、10100 C、11011 D、11110

２、某一逻辑函数真值表确定后，下面描述该函数功能的方法中，具有唯一性的是（ B ）

A、逻辑函数的最简与或式 B、逻辑函数的最小项之和

C、逻辑函数的最简或与式 D、逻辑函数的最大项之和

３、在下列逻辑电路中，不是组合逻辑电路的是（ D ）

A、译码器 B、编码器 C、全加器 D、寄存器

４、下列触发器中没有约束条件的是（ D ）

A、基本RS触发器 B、主从RS触发器

C、同步RS触发器 D、边沿D触发器

５、555定时器不可以组成 D 。

A.多谐振荡器 B.单稳态触发器 C.施密特触发器 D.JK触发器

６、编码器（A ）优先编码功能，因而（ C ）多个输入端同时为１。

A、有 B、无 C、允许 D、不允许

７、（ D ）触发器可以构成移位寄存器。

A、基本RS触发器 B、主从RS触发器

C、同步RS触发器 D、边沿D触发器

８、速度最快的A/D转换器是（ A ）电路

A、并行比较型 B、串行比较型

C、并－串行比较型 D、逐次比较型

9、某触发器的状态转换图如图所示，该触发器应是( C )

A. J-K触发器

B. R-S触发器

C. D触发器

D. T触发器

10.（电子专业作）对于VHDL以下几种说法错误的是（A ）

A VHDL程序中是区分大小写的。

B 一个完整的VHDL程序总是由库说明部分、实体和结构体等三部分构成

C VHDL程序中的实体部分是对元件和外部电路之间的接口进行的描述，可以看成是定义元件的引脚

杭州电子科技大学数字电路期末考试试卷及答案

数字逻辑电路 3卷答案第 1 页共 5 页 8. 如图所示电路，若输入CP脉冲的频率为100KHZ，则输出Q的频率为_____D_____。

A． 500KHz B．200KHz

C． 100KHz D．50KHz

13.给36个字符编码，至少需要____6______位二进制数。

19.T触发器的特性方程是___nnQTQ1_____,当T=1时,特性方程为___nnQQ1_____,这时触发器可以用来作___2分频器_____。

20．构造一个十进制的异步加法计数器，需要多少个 __4____触发器。计数器的进位Cy的频率与计数器时钟脉冲CP的频率之间的关系是____1﹕10_________。

21．（本题满分6分）用卡诺图化简下列逻辑函数

)15,14,13,12,10,9,8,2,1,0(),,,(mDCBAF

解：画出逻辑函数F的卡诺图。得到

DBDACBCAABF

22．（本题满分8分）电路如图所示，D触发器是正边沿触发器，图中给出了时钟CP及输入K的波形。

（1）试写出电路次态输出1nQ逻辑表达式。（2）画出QQ,的波形。

00 1 1 1

11 1 1 1 1

10 1 1 1 CP Q

Q D

CP K D Q

Q =1

Q Q K CP 数字逻辑电路 3卷答案第 2 页共 5 页解：nnQKDQ1

23．（本题满分10分）分析图示逻辑电路，求出F的逻辑函数表达式，化简后用最少的与非门实现之，并画出逻辑电路图。

解:

CBACBAABCCBACBAABCCBCBCACBBCACBCBCACBCBACBCBCACBCBAF)()())(())(()])((][))(([

《数字电路》期末模拟试题及答案-2[1]

《数字电子电路》期末试题A 第 1 页共5页 1 数字电子电路模拟试题-2

题号一二三四总分

得分

一、填空题（共30分）

1. 三极管有NPN和PNP两种类型，当它工作在放大状态时，发射结＿＿＿＿，集电结＿＿＿＿＿＿；NPN型三极管的基区是＿＿＿＿＿＿型半导体，集电区和发射区是＿＿＿＿＿＿型半导体。

2. 把高电压作为逻辑1，低电平作为逻辑0的赋值方法称作＿＿＿＿＿＿＿逻辑赋值。一种电路若在正逻辑赋值时为与非门，则在负逻辑赋值时为＿＿＿＿＿＿＿＿。

3. 四位二进制编码器有＿＿＿＿个输入端；＿＿＿＿个输出端。

4. 将十进制数287转换成二进制数是＿＿＿＿＿＿＿＿；十六进制数是＿＿＿＿＿＿＿。

5. 根据触发器功能的不同，可将触发器分成四种，分别是＿＿＿＿触发器、＿＿＿＿触发器、＿＿＿＿触发器和＿＿＿＿触发器。

6. 下图所示电路中，Y1 ＝＿＿＿＿＿＿；

7. Y2 ＝＿＿＿＿＿＿；Y3 ＝＿＿＿＿＿＿。

二、选择题(共 20分)

1. 当晶体三极管＿＿＿＿时处于饱和状态。

A. 发射结和集电结均处于反向偏置

B. 发射结正向偏置，集电结反向偏置

C. 发射结和集电结均处于正向偏置得分评卷人

得分评卷人

B Y1

Y3 《数字电子电路》期末试题A 第 2 页共5页 2 2. 在下列三个逻辑函数表达式中，＿＿＿＿是最小项表达式。

A．BABA)B,A(Y B. CBCBABCA)C,B,A(Y

C. CABABCBCACBA)D,C,B,A(Y

3．用8421码表示的十进制数45，可以写成＿＿＿＿＿＿＿＿＿＿

A．45 B. [101101]BCD C. [01000101]BCD D. [101101]2

数字电子技术基础试题及答案

一、填空题：（每空3分，共15分）

1．逻辑函数有四种表示方法，它们分别是（）、（）、（）和（）。

2．将2004个“1”异或起来得到的结果是（）。

3．由555定时器构成的三种电路中，（）和（）是脉冲的整形电路。

4．TTL器件输入脚悬空相当于输入（）电平。

5．基本逻辑运算有: （）、（）和（）运算。

6．采用四位比较器对两个四位数比较时，先比较（）位。

7．触发器按动作特点可分为基本型、（）、（）和边沿型；

8．如果要把一宽脉冲变换为窄脉冲应采用（）触发器

9．目前我们所学的双极型集成电路和单极型集成电路的典型电路分别是（）电路和（）电路。

10．施密特触发器有（）个稳定状态.，多谐振荡器有（）个稳定状态。

11．数字系统按组成方式可分为、两种；

12．两二进制数相加时，不考虑低位的进位信号是（）加器。

13．不仅考虑两个____________相加，而且还考虑来自__________相加的运算电路，称为全加器。

14．时序逻辑电路的输出不仅和_________有关，而且还与_____________有关。

15．计数器按CP脉冲的输入方式可分为___________和___________。

16．触发器根据逻辑功能的不同，可分为___________、___________、___________、___________、___________等。

17．根据不同需要，在集成计数器芯片的基础上，通过采用___________、___________、___________等方法可以实现任意进制的技术器。

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