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超融合解决方案V3.0 超融合解决方案目录第1章、前言 51.1IT时代的变革 (5)1.2白皮书总览 (7)第2章、超融合技术架构 (8)1.1超融合架构概述 (8)1.1.1超融合架构的定义 (8)1.2超融合架构组成模块 (8)1.2.1.1系统总体架构 (8)1.2.1.2aSV计算虚拟化平台 (9)1.2.1.2.1概述 (9)1.2.1.2.2aSV技术原理 (10)1.2.1.2.2.1 aSV的Hypervisor架构 (12)1.2.1.2.2.2 Hypervisor虚拟化实现 (16)1.2.1.2.3aSV的技术特性 (24)1.2.1.2.3.1 内存NUMA技术 (24)1.2.1.2.3.2 SR-IOV (25)1.2.1.2.3.3 Faik-raid (27)1.2.1.2.3.4 虚拟机生命周期管理 (28)1.2.1.2.3.5 虚拟交换机 (29)1.2.1.2.3.6 动态资源调度 (29)1.2.1.2.4aSV的特色技术 (30)1.2.1.2.4.1 快虚 (30)1.2.1.2.4.2 虚拟机热迁移 (31)1.2.1.2.4.3 虚拟磁盘加密 (32)1.2.1.2.4.4 虚拟机的HA (33)1.2.1.2.4.5 多USB映射 (34)1.2.1.3aSAN存储虚拟化 (35)1.2.1.3.1存储虚拟化概述 (35)1.2.1.3.1.1 虚拟后对存储带来的挑战 (35)1.2.1.3.1.2 分布式存储技术的发展 (36)1.2.1.3.1.3 aSAN概述 (36)1.2.1.3.2aSAN技术原理 (37)1.2.1.3.2.1 主机管理 (37)1.2.1.3.2.2 文件副本 (37)1.2.1.3.2.3 磁盘管理 (39)1.2.1.3.2.4 SSD读缓存原理 (41)1.2.1.3.2.5 SSD写缓存原理 (47)1.2.1.3.2.6 磁盘故障处理机制 (51)1.2.1.3.3aSAN功能特性 (63)1.2.1.3.3.1 存储精简配置 (63)1.2.1.3.3.2 aSAN私网链路聚合 (64)1.2.1.3.3.3 数据一致性检查 (65)1.2.1.4aNet网络虚拟化 (65)1.2.1.4.1网络虚拟化概述 (65)1.2.1.4.2aNET网络虚拟化技术原理 (66)1.2.1.4.2.1 SDN (66)1.2.1.4.2.2 NFV (67)1.2.1.4.2.3 aNet底层的实现 (68)1.2.1.4.3功能特性 (73)1.2.1.4.3.1 aSW分布式虚拟交换机 (73)1.2.1.4.3.2 aRouter (73)1.2.1.4.3.3 vAF (74)1.2.1.4.3.4 vAD (74)1.2.1.4.4aNet的特色技术 (75)1.2.1.4.4.1 网络探测功能 (75)1.2.1.4.4.2 全网流量可视 (75)1.2.1.4.4.3 所画即所得业务逻辑拓扑 (76)1.2.2超融合架构产品介绍 (76)1.2.2.1产品概述 (76)1.2.2.2产品定位 (77)第3章、超融合架构带来的核心价值 (78)1.1可靠性： (78)1.2安全性 (78)1.3灵活弹性 (78)1.4易操作性 (78)第4章、超融合架构最佳实践 (80)1.1 IT时代的变革20 世纪 90 年代，随着 Windows 的广泛使用及 Linux 服务器操作系统的出现奠定了 x86服务器的行业标准地位，然而 x86 服务器部署的增长带来了新的 IT 基础架构和运作难题，包括：基础架构利用率低、物理基础架构成本日益攀升、IT 管理成本不断提高以及对关键应用故障和灾难保护不足等问题。
存储分类存储分类 (1)1.存储分类简介 (2)2.存储解决方案分类 (2)2.1.DAS（直接式存储） (2)2.2.NAS（网络接入存储） (3)2.3.SAN（存储区域网络） (4)3.存储方案比较 (5)3.1.NAS、SAN与传统存储系统（DAS）的比较 (5)3.2.NAS与SAN得比较 (6)1.存储分类简介目前磁盘存储市场上的存储主要有以下几种分类。
图一存储分类●存储分类根据服务器类型分为：封闭系统的存储和开放系统的存储，封闭系统主要指大型机，AS400等服务器，开放系统指基于包括Windows、UNIX、Linux等操作系统的服务器；●开放系统的存储分为：内置存储和外挂存储；●外挂存储根据连接的方式分为：直连式存储（Direct-Attached Storage，简称DAS）和网络化存储（Fabric-Attached Storage，简称FAS）；●网络化存储根据传输协议又分为：网络接入存储（Network-AttachedStorage，简称NAS）和存储区域网络（Storage Area Network，简称SAN）；2.存储解决方案分类绝大部分用户采用的是开放系统，其外挂存储占有目前磁盘存储市场的70%以上。
当前市场上主流的存储解决方案主要为：直连式存储（DAS）、网络接入存储（NAS）、存储区域网络（SAN）。
2.1.DAS（直接式存储）DAS（Direct Attached Storage，直接附属存储），也可称为SAS （Server-Attached Storage，服务器附加存储）。
DAS被定义为直接连接在各种服务器或客户端扩展接口下的数据存储设备，它依赖于服务器，其本身是硬件的堆叠，不带有任何存储操作系统。
在这种方式中，存储设备是通过电缆（通常是SCSI接口电缆）直接到服务器的，I/O（输入/输入）请求直接发送到存储设备。
DAS适用于以下几种环境：●服务器在地理分布上很分散，通过SAN（存储区域网络）或NAS（网络直接存储）在它们之间进行互连非常困难；●存储系统必须被直接连接到应用服务器；●包括许多数据库应用和应用服务器在内的应用，它们需要直接连接到存储器上。
了解电脑内存的类型和容量随着科技的发展，电脑已经成为了我们生活中不可或缺的重要工具。
而在电脑的硬件配置中，内存是一项至关重要的性能指标。
了解电脑内存的类型和容量对于选择适合自己需求的电脑至关重要。
本文将详细介绍电脑内存的各种类型以及容量。
一、内存类型1. DRAM（Dynamic Random Access Memory，动态随机存取存储器）DRAM是目前使用最广泛的内存类型。
它是一种易失性存储器，需要不断刷新以保持数据的完整性。
DRAM的访问速度相对较慢，但成本较低，容量较大，通常用于个人电脑和服务器。
2. SRAM（Static Random Access Memory，静态随机存取存储器）SRAM是一种高速、易失性存储器。
相比DRAM，SRAM的访问速度更快，但造价更高，容量较小。
它广泛应用于高性能计算机和缓存系统。
3. SDRAM（Synchronous Dynamic Random Access Memory，同步动态随机存取存储器）SDRAM是一种同步访问的DRAM，它的访问速度比传统的DRAM 更快。
SDRAM主要分为DDR、DDR2、DDR3和DDR4等不同的代数。
DDR4是目前市场上使用最广泛的内存类型，它的访问速度、传输带宽和能效都得到了显著的提升。
二、内存容量1. GB（Gigabyte，千兆字节）内存容量通常以GB为单位进行表示。
在选择电脑内存时，需要考虑个人使用需求和预算。
对于一般办公和上网需求，4GB或8GB的内存已经足够。
而对于高性能游戏或者专业设计软件的需求，16GB或32GB的内存可能更为适合。
2. ECC（Error-Correcting Code，纠错码）ECC内存是一种能够自动检测和纠正内存错误的高可靠性内存。
它广泛应用于服务器和工作站等对数据完整性要求较高的领域。
相比普通内存，ECC内存的价格较高，对于一般用户来说并不常见。
三、内存扩展1. DIMM（Dual In-Line Memory Module，双列直插内存模块）DIMM是目前主流的内存扩展形式之一。
热数据需要在内存中存储和处理，因此适合用缓存或内存数据库（如Redis 或SAP Hana）。
AWS提供了ElastiCache服务，可生成托管的Redis或Memcached环境。
NoSQL数据库是面向高速但小规模记录（例如，用户会话信息或物联网数据）的理想选择。
NoSQL数据库对于内容管理也很有用，可以存储数据目录。
01结构化数据存储结构化数据存储已经存在了几十年，是人们最熟悉的数据存储技术。
大多数事务型数据库（如Oracle、MySQL、SQL Server和PostgreSQL）都是行式数据库，因为要处理来自软件应用程序的频繁数据写入。
企业经常将事务型数据库同时用于报表，在这种情况下，需要频繁读取数据，但数据写入频率要低得多。
随着数据读取的需求越来越强，有更多的创新进入了结构化数据存储的查询领域，比如列式文件格式的创新，它有助于提高数据读取性能，满足分析需求。
基于行的格式将数据以行的形式存储在文件中。
基于行的写入方式是将数据写入磁盘的最快方式，但它不一定能最快地读取，因为你必须跳过很多不相关的数据。
基于列的格式将所有的列值一起存储在文件中。
这样会带来更好的压缩效果，因为相同的数据类型现在被归为一组。
通常，它还能提供更好的读取性能，因为你可以跳过不需要的列。
我们来看结构化数据存储的常见选择。
例如，你需要从订单表中查询某个月的销售总数，但该表有50列。
在基于行的架构中，查询时会扫描整个表的50个列，但在列式架构中，查询时只会扫描订单销售列，因而提高了数据查询性能。
我们再来详细介绍关系型数据库，重点介绍事务数据和数据仓库处理数据分析的需求。
（1）关系型数据库RDBMS比较适合在线事务处理（OLTP）应用。
流行的关系型数据库有Oracle、MSSQL、MariaDB、PostgreSQL等。
其中一些传统数据库已经存在了几十年。
许多应用，包括电子商务、银行业务和酒店预订，都是由关系型数据库支持的。
磁盘阵列服务器及存储解决方案服务器及存储解决方案目录前言 ..................................................................... (3)第一章需求分析 ..................................................................... (4)(一)、系统现状 ..................................................................... . (4)(二)、需求分析 ..................................................................... . (4)(三)、方案设计原则 ..................................................................... .. (4)(四)、方案概述 ..................................................................... ........................................ 5 第二章存储解决方案 ..................................................................... .. (7)(一)、采用UIT SV1600磁盘阵列的理由 (7)内置阵列卡技术和外置独立磁盘阵列技术比较 (7)UIT SV1600磁盘阵列系统 ..................................................................... .................... 9 第三章售后服务承诺 ..................................................................... (29)前言随着计算机信息管理系统的广泛应用，给人民的生产和生活带来了极大的方便。
详谈高端内存和低端内存一、高端内存和低端内存的划分Linux物理内存空间分为DMA内存区(DMA Zone)、低端内存区(Normal Zone)与高端内存区(Highmem Zone)三部分。
DMA Zone通常很小，只有几十M，低端内存区与高端内存区的划分来源于Linux内核空间大小的限制。
二、来源：过去，CPU的地址总线只有32位，32的地址总线无论是从逻辑上还是从物理上都只能描述4G的地址空间（232=4Gbit），在物理上理论上最多拥有4G内存（除了IO地址空间，实际内存容量小于4G），逻辑空间也只能描述4G的线性地址空间。
为了合理的利用逻辑4G空间，Linux采用了3：1的策略，即内核占用1G的线性地址空间，用户占用3G的线性地址空间。
所以用户进程的地址范围从0~3G，内核地址范围从3G~4G，也就是说，内核空间只有1G的逻辑线性地址空间。
如果Linux物理内存小于1G的空间，通常内核把物理内存与其地址空间做了线性映射，也就是一一映射，这样可以提高访问速度。
但是，当Linux物理内存超过1G时，线性访问机制就不够用了，因为只能有1G的内存可以被映射，剩余的物理内存无法被内核管理，所以，为了解决这一问题，Linux把内核地址分为线性区和非线性区两部分，线性区规定最大为896M，剩下的128M为非线性区。
从而，线性区映射的物理内存成为低端内存，剩下的物理内存被成为高端内存。
与线性区不同，非线性区不会提前进行内存映射，而是在使用时动态映射。
三、例子假设物理内存为2G，则低段的896M为低端内存，通过线性映射给内核使用，其他的1128M物理内存为高端内存，可以被内核的非线性区使用。
由于要使用128M非线性区来管理超过1G的高端内存，所以通常都不会映射，只有使用时才使kmap映射，使用完后要尽快用kunmap释放。
对于物理内存为1G的内核，系统不会真的分配896M给线性空间，896M最大限制。
EMC/HDS/IBM三款高端存储之结构对比作者：piner (转载请注明本文出处：)永久链接：/html/y2007/m05/98-storage-contrast.html我在前面介绍了现在比较流行的三款高端存储的基本体系结构，包括IBM 的ds8000系列，hds的usp系列以及EMC的dmx3系列。
我在这里将三款高端存储再做一个简单的对比。
1、体系结构hds与emc都采用了多点冗余的复合式体系结构，有多个专用的存储控制器，如专用的前端控制器，专用的后端控制器，并且以以专用的cache 控制器为核心，CPU集成在前/后端控制器中，操作系统以微码方式集成在硬件中，并可以方便的升级维护。
在这种结构中，前端，cache，后端均可实现系统均衡，并多点冗余。
所以，失败一个点的时候，影响量比较小。
不过，还有一点差别的是，hds前后端连接到核心cache，是采用交换方式，而EMC是采用直连方式，所以也叫直连矩阵。
至于IBM，采用的是传统的对称体系结构，采用其强大的570 pserver作为存储的控制器，所以，存储的管理OS运行在控制器内，CPU与内存也都在控制器内。
这一种体系结构是应当是说与现有的中端存储的结构很相似，IBM的这种方式的体系结构在可靠性方面是比上面的体系结构要欠缺一些的。
2、后端连接与RAIDIBM采用交换方式连接磁盘与后段卡，而HDS与EMC采用环路结构，在交换结构中，每个磁盘都有自己的线路连接到后端卡（口），所以，不容易产生后端瓶颈。
至于环路设计，则是现在的流行设计，但是，一个环路上的盘不能太多，否则，容易产生性能瓶颈。
如，一个2Gb的光纤环路，一般接到50-60颗盘，已经都达到负载极限了。
而一个4Gb的环路，如果考虑翻倍的话，也就最多可以接100-120颗磁盘。
不过，上面评估磁盘个数的时候，是根据流量，也就是带宽来考虑的，如果在OLTP环境中，我们还需要考虑IO个数，因为光纤通信的规则，在同一个时间，一个环路中只能有一个通信量，也就是一个IO。
1 GENERAL DESCRIPTIONThe NuMicro® NUC029 series 32-bit microcontroller is embedded with ARM® Cortex®-M0 core for industrial control and applications which need rich communication interfaces or require high performance, high integration, and low cost. The Cortex®-M0 is the newest ARM®embedded processor with 32-bit performance at a cost equivalent to the traditional 8-bit microcontroller. The NuMicro® NUC029 series includes four part numbers: NUC029LAN, NUC029NAN, NUC029ZAN, NUC029TAN and NUC029FAE.The NUC029LAN/NUC029NAN/NUC029ZAN/NUC029TAN can run up to 50MHz and operate at2.5V ~ 5.5V, -40℃ ~ 85℃, and the NUC029FAE can run up to 24 MHz and operate at 2.5V ~5.5V, -40℃ ~ 105℃. Therefore, the NUC029 series can afford to support a variety of industrialcontrol and applications which need high CPU performance.The NUC029LAN/NUC029NAN/NUC029ZAN/NUC029TAN offers 64K/64K/32K bytes flash, 4 Kbytes Data Flash, 4 Kbytes flash for the ISP, and 4 Kbytes SRAM. The NUC029FAE offers 16 Kbytes flash, size configurable Data Flash (shared with program flash), 2 Kbytes flash for the ISP, and 2K-bytes SRAM.Many system level peripheral functions, such as I/O Port, EBI (External Bus Interface), Timer, UART, SPI, I2C, PWM, ADC, WDT (Watchdog Timer), WWDT (Window Watchdog Timer), Analog Comparator and Brown-out Detector, have been incorporated into the NUC029 series in order to reduce component count, board space and system cost. These useful functions make the NUC029 series powerful for a wide range of applications.Additionally, the NuMicro®NUC029 series is equipped with ISP (In-System Programming) and ICP (In-Circuit Programming) functions, and IAP (In-Application Programming), which allow the user to update the program memory without removing the chip from the actual end product.Table 1-1 NuMicro® NUC029 Series Difference List2 FEATURES∙ARM® Cortex®-M0 core–Runs up to 50 MHz–One 24-bit system timer–Supports Low Power Sleep mode– A single-cycle 32-bit hardware multiplier–NVIC for the 32 interrupt inputs, each with 4-levels of priority–Supports Serial Wire Debug (SWD) interface and two watchpoints/four breakpoints–Provides hardware divider and supports signed 32-bit dividend, 16-bit divisor operation(NUC029xAN only)∙Operating voltage ranges from 2.5 V to 5.5 V∙Memory–16/32/64 KB Flash for program memory (APROM)–Up to 4 KB Flash for loader (LDROM)–Up to 4 KB SRAM for internal scratch-pad RAM (SRAM)– 4 KB Flash for data memory (Data Flash) (NUC029xAN only)–Configurable Data Flash (NUC029FAE only)∙Clock Control–Programmable system clock source–22.1184 MHz internal oscillator◆Dynamically calibrating the HIRC OSC to 22.1184 MHz ±3% from -40℃ to 105℃by external 32.768 kHz crystal oscillator (LXT) (NUC029FAE only)–4~24 MHz external crystal input–10 kHz low-power oscillator for Watchdog Timer and wake-up in Sleep mode–PLL allows CPU operation up to the maximum 50 MHz (NUC029xAN only)–32.768 kHz external crystal input (LXT) for Power-down wake-up and system operation clock (NUC029FAE only)∙GPIO–Up to 40 general-purpose I/O (GPIO) pins for LQFP/QFN 48-pin package–Four I/O modes:◆Quasi-bidirectional◆Push-pull output◆Open-drain output◆Input only with high impendence–TTL/Schmitt trigger input selectable–I/O pin can be configured as interrupt source with edge/level setting–Supports high driver and high sink I/O mode–Configurable I/O mode after POR∙Timer–Up to four sets of 32-bit timers with 24-bit up counter and one 8-bit prescale counter–Independent clock source for each timer–Provides up to four timer counting modes: one-shot, periodic, toggle and continuous counting–24-bit up counter value is readable through TDR (Timer Data Register)–Supports event counting function to count the input event from external counter pin–24-bit capture value is readable through TCAP (Timer Capture Data Register)–Supports external capture pin for interval measurement◆Supports external capture pin to reset 24-bit up counter◆Supports chip wake-up from Idle/Power-down mode if a timer interrupt signal isgenerated–Supports internal capture triggered while internal ACMP output signal transition(NUC029xAN only)–Supports Inter-Timer trigger mode (NUC029xAN only)–Supports internal signal (CPO0, CPO1) for interval measurement (NUC029FAE only)∙WDT (Watchdog Timer)–Multiple clock sources–Supports wake-up from Power-down or Sleep mode–Interrupt or reset selectable on watchdog time-out–Time-out reset delay period can be selected to 3/18/130/1026 * WDT_CLK (NUC029xAN only)∙WWDT (Window Watchdog Timer) (NUC029xAN only)–6-bit down counter with 11-bit pre-scale for wide range window selected∙PWM Generator and Capture Timer (NUC029xAN only)–Up to four built-in 16-bit PWM generators, providing eight PWM outputs or four complementary paired PWM outputs–Individual clock source, clock divider, 8-bit pre-scalar and dead-zone generator for each PWM generator–PWM interrupt synchronized to PWM period–16-bit digital Capture timers with rising/falling capture inputs–Supports capture interrupt–Internal 10 kHz to PWM clock source–Polar inverse function–Center-aligned type function–Timer duty interrupt enable function–Two kinds of PWM interrupt period type selection–Two kinds of PWM interrupt duty type selection–Period/duty trigger ADC function–PWM Timer synchronous start function∙Enhanced PWM Generator (NUC029FAE only)–Independent 16-bit PWM duty control units with maximum three outputs–Supports group/synchronous/independent/ complementary modes–Supports One-shot or Auto-reload mode–Supports Edge-aligned and Center-aligned type–Programmable dead-zone insertion between complementary channels–Each output has independent polarity setting control–Hardware fault brake protections–Supports duty, period, and fault break interrupts–Supports duty/period trigger ADC conversion–Timer comparing matching event trigger PWM to do phase change–Supports comparator event trigger PWM to force PWM output low for current period –Provides interrupt accumulation function∙UART–Up to two sets of UART devices–Programmable baud-rate generator–Buffered receiver and transmitter, each with 16 bytes FIFO–Optional flow control function (CTS and RTS)–Supports IrDA(SIR) function–Supports RS-485 function–Supports LIN function (NUC029xAN only)∙SPI–Up to two sets of SPI devices–Supports Master/Slave mode–Full-duplex synchronous serial data transfer–Provides 3 wire function–Variable length of transfer data from 8 to 32 bits–MSB or LSB first data transfer–Rx latching data can be either at rising edge or at falling edge of serial clock–Tx sending data can be either at rising edge or at falling edge of serial clock–Supports Byte Suspend mode in 32-bit transmission–4-level depth FIFO buffer–PLL clock source (NUC029xAN only)∙I2C–Up to two sets of I2C modules–Supports Master/Slave mode–Bi-directional data transfer between masters and slaves–Multi-master bus (no central master)–Arbitration between simultaneously transmitting masters without corruption of serial data on the bus–Serial clock synchronization allows devices with different bit rates to communicate via one serial bus–Serial clock synchronization can be used as a handshake mechanism to suspend and resume serial transfer–Programmable clocks allow versatile rate control–Supports 7-bit addressing mode–Supports multiple address recognition (four slave addresses with mask option)–Supports Power-down wake-up function–Supports FIFO function (NUC029FAE only)∙ADC–12-bit SAR ADC with 760 kSPS for NUC029xAN, and 10-bit SAR ADC with 300 kSPS for NUC029FAE–Up to eight single-end analog input channels◆Or four differential analog input channels (NUC029xAN only)–Four operation modes (NUC029FAE only support Single mode)◆Single mode: A/D conversion is performed one time on a specified channel◆Burst mode: A/D converter samples and converts the specified single channeland sequentially stores the result in FIFO◆Single-cycle Scan mode: A/D conversion is performed only one cycle on allspecified channels with the sequence from the smallest numbered channel tothe largest numbered channel◆Continuous Scan mode: A/D converter continuously performs Single-cycle Scanmode until software stops A/D conversion–An A/D conversion can be started by:◆Software Write 1 to ADST bit◆External pin (STADC)◆PWM trigger with optional start delay period–Each conversion result is held in data register with valid and overrun indicators–Each channel has individual data register (NUC029xAN only)–Conversion result can be compared with specified value and user can select whether to generate an interrupt when conversion result matches the compare register setting –Internal temperature sensor output (NUC029xAN only)∙Analog Comparator–Up to four sets of Comparator analog modules–External input or internal band-gap voltage selectable at negative node–Interrupt when compared results change–Power-down wake-up∙EBI (External Bus Interface) for external memory-mapped device access (NUC029LAN/ NUC029NAN only)–Accessible space: 64 KB in 8-bit mode or 128 KB in 16-bit mode–Supports 8-bit or 16-bit data width–Supports byte-write in 16-bit data width∙ISP (In-System Programming) and ICP (In-Circuit Programming)∙IAP (In-Application Programming)∙One built-in temperature sensor with 1℃ resolution (NUC029xAN only)∙BOD (Brown-out Detector)–With 4 levels: 4.4V/3.7V/2.7V/2.2V–Supports Brown-out interrupt and reset option∙96-bit unique ID (UID)∙LVR (Low Voltage Reset)–Threshold voltage level: 2.0V∙Operating Temperature:–NUC029LAN/NUC029NAN/NUC029ZAN/NUC029TAN: -40℃~85℃–NUC029FAE:-40℃~105℃∙Reliability: EFT > ± 4 KV, ESD HBM pass 4 KV∙Packages:–All Green package (RoHS)–48-pin LQFP, 48-pin QFN, 33-pin QFN, 20-pin TSSOP。
海康威视视频云存储解决方案正文目录第一章概述.............................................1.1 系统简介........................................1.2 设计原则........................................1.3 设计目标........................................1.4 术语及缩略语解释................................1.4.1 术语解释 (8)1.4.2 英文/缩略语解释............................. 第二章总体设计.........................................2.1 需求说明........................................2.1.1 功能性需求说明..............................2.1.2 非功能性需求说明............................2.2 技术路线........................................2.3 逻辑架构........................................2.4 系统特点........................................2.4.1 高效灵活的空间管理..........................2.4.2 海量数据的快速检索..........................2.4.3 持续可靠的数据服务..........................2.4.4 高可扩展的应用支撑..........................2.4.5 开放透明的兼容系统......... 错误!未指定书签。
