数字电子线路N答案
淮南师范学院20 - 20 学年度第学期试卷N卷 (闭卷) 课程数字电子线路院系专业年级、班级学号姓名
题号一二三四五总分阅卷人 3、有一个左移移位寄存器，当预先置入1011后，其串行输入固定接0，在4个移位脉冲CP作用
下，四位数据的移位过程是( A )。得分
A. 1011--0110--1100--1000--0000
B. 1011--0101--0010--0001--0000 得分
一、填空题:(每空2分，共26分) 阅卷人 C. 1011--1100--1101--1110--1111 D. 1011--1010--1001--1000--0111
4、F(A、B、C),A+,当A、B、C取何值，F,0 : ( D ) BC(A，B)
1、晶体管工作在放大状态时,集电结处于(反)偏置状态,发射结处于(正)偏置状态。
A、010
B、101
C、110
D、011 2、三态门电路的输出有(高电平)、低电平和高阻3种状态。 5、下列逻辑代数运算错误的是:(C)
DF,m3、逻辑函数式F=AB+AC的对偶式为()，最小项表达式为(5,6,7)。
F,(A，B)(A，C),A,0; A、A+A=A B、A C、A?A = 1 D、A+ A,1,
6、下列数码均代表十进制数8，其中按余3码编码的是 ( A )。 4、二进制数1100110.001101 转换为十六进制码为(66. 34)H 、八进制码为 (146.15)D 。
5、连续异或2006个1的结果是(0)。 A(0111 B( 0100 C(1001 D(1101
7、由与非门构成的基本RS触发器，欲将触发器置为1态，应在输入端加
( A ) 6、74LS138是3线—8线译码器，译码为输出低电平有效，若输入为
AAA=111时，输出 210
(A) R=1,S=0 (B) R=0,S=0 (C) R=0,S=1 (D) R=1,S=1
应为( 01111111 )。 YYYYYYYY765432108、表达式F=,可用来表示( C )。 AB
7、从结构上看，时序逻辑电路的基本单元是(触发器)。 A .AB C.A?B
D.A=B
8、A/D转换的一般步骤为:取样，保持，量化，(编码)。得分 9、由555定时器构成的三种电路中，(施密特触发器)和(单稳态触发器)是脉冲的整形电路。三、判断题(每题1分，共6分) 阅卷人
得分 1、逻辑变量的取值，0比1小。 ( F )
二、选择题:(每题2分，共16分) 阅卷人 2、计数器除了能对输入脉冲进行计数，还能作为分频器用。 ( T ) 1、十进制整数转换为二进制数的方法是:(A)
3、一个逻辑函数的全部最小项之积恒等于0。 ( T ) A、除2取余，逆序排列
B、除2取余，顺序排列;
4、CMOS与非门的未用输入端应接地。 ( F ) C、乘2取整，逆序排列 D、乘2取整，顺序排列
5、Mealy型时序电路的输出只与当前的外部输入有关。 ( F )
Y,Y,Y2、8线—3线优先编码器的输入为I—I ，当优先级别最高的I有效时，其输出的值是0772106、八路数据分配器的地址输入(选择控制)端有8个 ( F ) ( C)。得分四、化简题(3小题，共12分) A(111 B. 010 C. 000 D. 101 阅卷人
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1、F(A、B、C、D)=(0，2，4，5，8，10，12，13)(卡诺图化简法)。(4) ,M 得分
五、综合题(3小题，共40分) 阅卷人 AB CD
00
1、D触发器逻辑图如下，用适当的逻辑门将D触发器转换成JK触发器，画出电路图。(8分) 01
D 11
10 CP C1
( 2′)
F(A、B、C、D)= +B ( 2′) CBD
解: J-K触发器状态方程 : Q =J + Q KQ
2、数据选择器构成的函数发生器如下图所示，求其输出逻辑Y。(4分) D 触发器状态方程 : Q =D
则两者联立得到方程: D= J + Q ( 3′) KQ
K ,1 ?1 D
J
F,ABD0，ABD1，ABD2，ABD3 CP C1
F,AB,0，AB,1，AB,0，AB,1
逻辑图为:( 5′)
F,AB，AB
2、设计一个全加器，所用门电路自定。(10分) F,B 1) 真值表为:( 4′)
Ai Bi Ci-1 Si Ci 3、已知A、B为输入，F为输出，波形如下图所示。根据波形图写出真值表及
0 0 0 0 0 函数F的表达式。(4分) 0 0 1 1 0
0 1 0 1 0
解: (1) 由波形图可得真值表: 0 1 1 0 1
A B F 1 0 0 1 0 0 0 0 1 0 1 0 1 0 1 1 1 1 0 0 1 1 0 1 1 1 1 1 1 1 1
0 (2) 由真值表可知:F=A?B
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Q的波形(4分)。 4(Q、122) 表达式为:( 2′)Si=AiBiCi-1+AiBiCi-
1+AiBiCi-1+AiBiCi-1
Ci=AiBiCi-1+AiBiCi-1+AiBiCi-1+AiBiCi-1 CP 3) 逻辑图为:( 4′) A
Q 1
Q 2
4、试用JK触发器和门电路设计一个十三进制的计数器, 并检查设计的电路能否自启动。(10分) 解:根据题意，得状态转换图如下:
3、74LS161是同步4位二进制加法计数器，其逻辑功能表如下，试分析下列电路是几进制计数器，
并画出其状态图。(12分)
74LS161逻辑功能表
CT CP Q Q Q Q CTPT3210
CRLDQ Q Q 321& Q 0CC74LS161 C 0 × × × × 0 0 0 0 O P P CR LD CT CT D D PT321 0 × × D D D D 3210 D D10 1 1 0 × × Q Q Q Q3210
“1” “1” “1” 1 1 × 0 × Q Q Q Q3210
1 1 1 1 加法计数所以:
1(当74LS161从0000开始顺序计数到1010时，与非门输出“0”，清零信号到来，异步清零。(2
分)
2(该电路构成同步十进制加法计数器。(2分)
3(状态图(4分) 2 3 1 4 0000 0011 0010 0100 0001 5 1010 10 0101 0111 0110 1000 1001 6 9 8 7
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能自启动。因为:
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